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          串行RapidIO在WiMAX基站系統(tǒng)中的應(yīng)用

          作者:朱朝平 樊利民 華南理工大學(xué)電力學(xué)院 陳軍 華南理工大學(xué)電子與信息學(xué)院 時(shí)間:2009-12-10 來(lái)源:電子產(chǎn)品世界 收藏

            圖2所示系統(tǒng)是基于CPU的高性能DSP系統(tǒng)。PowerPC主要針對(duì)無(wú)需大量乘法運(yùn)算的一般應(yīng)用,如MAC層處理。DSP主要完成濾波、矢量乘法和查找以及圖像或視頻分析等信號(hào)處理操作。FPGA實(shí)現(xiàn)FFT或者PAPR算法等。

          本文引用地址:http://www.ex-cimer.com/article/101030.htm

            圖2所示的基帶系統(tǒng)具有極高的靈活性和可擴(kuò)展性,在這種架構(gòu)中,各個(gè)處理器的任務(wù)分工具有很大的靈活性。由于架構(gòu)已經(jīng)不再與運(yùn)算密切相關(guān),流量和處理能力可在運(yùn)行時(shí)間內(nèi)從一個(gè)器件轉(zhuǎn)移到另外一個(gè)器件。該架構(gòu)也具有可擴(kuò)展性,有助于滿足具體應(yīng)用在性能和成本方面所需的端點(diǎn)數(shù)量增減。例如,可以輕易改變 DSP型號(hào)和 DSP 數(shù)量,以實(shí)現(xiàn)相同的設(shè)計(jì)可以匹配到從微蜂窩到大型基站的設(shè)計(jì)要求。要在降低成本同時(shí)滿足更高性能和帶寬,關(guān)鍵在于采用模塊化和基于標(biāo)準(zhǔn)的架構(gòu)。構(gòu)建下一代基帶卡和基于連接了多個(gè)DSP、FPGA 和 ASIC 的 接口的結(jié)構(gòu)型架構(gòu)具有許多優(yōu)勢(shì)。

            系統(tǒng)在 BBU中的應(yīng)用

            · BBU系統(tǒng)架構(gòu)

            圖3是基于圖2的 BBU系統(tǒng),該系統(tǒng)硬件上包括一片PPC處理器MPC8548,兩片DSP處理器(TI的)和三片Xilinx FPGA V5LX110。FPGA與DSP之間使用SRIO口通信,DSP與PPC之間使用PCI接口和SRIO進(jìn)行通信,F(xiàn)PGA之間使用仿PCI接口進(jìn)行通信。DSP1與DSP2之間使用SRIO接口進(jìn)行通信。

            本系統(tǒng)中還保留PowerPC與DSP的PCI32互連,這樣有利于boot模式下程序的下載。FPGA1主要實(shí)現(xiàn)IFFT和PAPR算法;FPGA2主要實(shí)現(xiàn)RANGING和FFT算法;DSP1主要實(shí)現(xiàn)信道編碼、調(diào)制、空時(shí)編碼和子載波映射,DSP2主要實(shí)現(xiàn)信道解碼、解調(diào)、信道估計(jì)和子載波解映射。FPGA3主要實(shí)現(xiàn)TURBO的解碼。另外MIMO的上行算法會(huì)在DSP2、FPGA2和DSP1上協(xié)同處理。



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