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          在賽靈思FPGA設(shè)計(jì)中保留可重復(fù)結(jié)果

          作者: 時(shí)間:2011-04-29 來源:電子產(chǎn)品世界 收藏

            有關(guān)區(qū)域組平面布局規(guī)劃的更多信息,請參閱 UG632 《PlanAhead用戶指南》 (h t t p : / / w w w . x i l i n x .com/suppor t /documentat ion/sw_ma n u a l s / x i l i n x 1 1 /Pl a nAh e a d _UserGuide.pdf)以及 UG633 《平面布局方法指南》 (http://www.xi l inx.com/support/documentation/sw_manuals/xilinx12_1/Floorplanning_Methodology_Guide.pdf) 。

          本文引用地址:http://www.ex-cimer.com/article/119148.htm

            塊、模塊與路徑定位Block RAM、FIFO、DSP、DCM 以及全局時(shí)鐘資源等核心器件的定位往往有助于實(shí)現(xiàn)可重復(fù)性。其最佳做法是著眼于良好布局,同時(shí)采用相關(guān)設(shè)計(jì)知識(shí)布局規(guī)劃??梢圆捎?reportgen – clock_regions design.ncd 創(chuàng)建相關(guān)報(bào)告。PlanAhead 軟件能夠鎖定關(guān)鍵模塊的全部布局信息。在下一輪中,實(shí)施布局保持不變,但是并不保存布線信息。有關(guān) PlanAhead 軟件定位約束條件的更多信息,請參閱 UG632 《PlanAhead 用戶指南》 、UG633 《平面布局規(guī)劃方法指南》以及相關(guān) PlanAhead 手冊的 “設(shè)計(jì)的平面布局規(guī)劃”章節(jié)。

            如果鎖定整個(gè)模塊影響過大,則可以在 PlanAhead 軟件中鎖定某條關(guān)鍵路徑。但是使用該方法時(shí)應(yīng)當(dāng)慎之又慎。如果某條具體路徑導(dǎo)致某種主要問題,最好通過修改 HDL 來解決時(shí)序問題。否求。賽靈思 SmartGuide ™ 技術(shù)是另一種維持可重復(fù)結(jié)果的選擇,最適合不強(qiáng)求最高 QoR 或最高利用率的設(shè)計(jì)。如果設(shè)計(jì)保存和 SmartGuide 技術(shù)都不適用于一種設(shè)計(jì),則可以采用 SmartXplorer或 PlanAhead 軟件策略維護(hù)時(shí)序。

            對于 QoR 需求較高的設(shè)計(jì), 有一些高級(jí)實(shí)現(xiàn)選項(xiàng)可以幫助維持時(shí)序??刂评寐释蔷S持可重復(fù)結(jié)果的關(guān)鍵。隨著設(shè)計(jì)規(guī)模增大,維持可重復(fù)結(jié)果的難度也隨之提高。整個(gè)設(shè)計(jì)階段始終采用相同軟件版本有助于實(shí)現(xiàn)可重復(fù)結(jié)果。

            設(shè)計(jì)保存

            PlanAhead 中的設(shè)計(jì)保存流程采用分區(qū),這是能夠保證可重復(fù)結(jié)果的唯一驗(yàn)證相關(guān)位置是否適當(dāng)。在定位這些BRAM、FIFO 與 DSP 器件時(shí)需要考慮到控制信號(hào)和數(shù)據(jù)流 (總線校準(zhǔn)) ??梢栽谙嚓P(guān) .map 報(bào)告文件中找到用于定位現(xiàn)有設(shè)計(jì)的時(shí)鐘域的約束條件。保持相同的時(shí)鐘域可以防止布局器 (Placer) 修改時(shí)鐘域分區(qū),因?yàn)楹笳邥?huì)改變設(shè)計(jì)的則, 應(yīng)限制使用具體時(shí)序路徑定位。

            實(shí)現(xiàn)選項(xiàng)

            實(shí)現(xiàn)工具中的多種選項(xiàng)都可以改進(jìn)可重復(fù)性?;诜謪^(qū)的設(shè)計(jì)保存是保存實(shí)現(xiàn)方案的最佳方法,但是它并不適合于所有的設(shè)計(jì)而且確實(shí)存在 HDL 設(shè)計(jì)要方法。設(shè)計(jì)保存的主要目的是保持模塊性能的一致性,以減少時(shí)序收斂階段花費(fèi)的時(shí)間。另外,它還要求用戶盡可能遵從良好設(shè)計(jì)實(shí)踐。

            分區(qū)可以保存之前實(shí)現(xiàn)的設(shè)計(jì)的不變部分。如果分區(qū)網(wǎng)表保持不變,則實(shí)現(xiàn)工具可以采用復(fù)制 - 粘貼過程保證保存該分區(qū)的實(shí)現(xiàn)數(shù)據(jù)。通過保存實(shí)現(xiàn)結(jié)果,分區(qū)可以讓你在不影響已保存部分的情況下實(shí)現(xiàn)修改后的設(shè)計(jì)部分。在圖2 中,紅色模塊已經(jīng)修改并且得到實(shí)現(xiàn),而剩下的模塊已鎖定到位。

            在 12.1 版和未來版本中, PlanAhead軟件和命令行工具將支持設(shè)計(jì)保存功能。如欲了解更多信息, 請參閱 WP362 《基于設(shè)計(jì)保存的可重復(fù)結(jié)果》 (http://www.xilinx.com/support/documentation/white_papers/wp362.pdf ) 與 UG748 《分層設(shè)計(jì)方法指南》 (http://www.xilinx.com/support/documentation/sw_manuals/xilinx12_1/Hierarchical_Design_Methodology_Guide.pdf)。

            SmartGuide 技術(shù)

            SmartGuide 技術(shù)在執(zhí)行實(shí)現(xiàn)方案時(shí)采用之前的實(shí)現(xiàn)結(jié)果作為起點(diǎn),其主要目的是減少運(yùn)行時(shí)間??梢赃w移引導(dǎo)布局與布線或者同時(shí)遷移二者,以便完成設(shè)計(jì)的布線或滿足時(shí)序要求。SmartGuide 技術(shù)最適合不強(qiáng)求 QoR 或利用率的設(shè)計(jì)。

            以前版本的工具配套提供精準(zhǔn)引導(dǎo)(exact guide) 和杠桿 (leveraged) 引導(dǎo)。通常情況下,精準(zhǔn)引導(dǎo)方法過去會(huì)造成不可路由的設(shè)計(jì)。如果需要準(zhǔn)確保存,則建議流程是設(shè)計(jì)保存。SmartGuide 技術(shù)可替代杠桿引導(dǎo)。

            設(shè) 計(jì) 人 員 經(jīng) 常 詢 問 是 使 用Smar tGuide 技術(shù)還是分區(qū)技術(shù),答案取決于在設(shè)計(jì)流程中所處位置。



          關(guān)鍵詞: Xilinx FPGA

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