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          利用EP1C6Q240C8處理器的LCD滾屏設(shè)計(jì)

          作者: 時(shí)間:2012-02-16 來源:網(wǎng)絡(luò) 收藏

          摘要:NIOSII嵌入式以其靈活在嵌入式領(lǐng)域中得到廣泛應(yīng)用。文章以T6963C控制的240×128 液晶顯示屏模塊闡述了一種基于的液晶顯示屏的滾屏顯示的軟硬件控制方法,并給出硬件原理圖與部分軟件代碼。本方案對于NIOSII系統(tǒng)其他模塊的開發(fā)具有借鑒意義。
          關(guān)鍵詞:液晶顯示器;NiosII;可編程片上系統(tǒng)

          0 引言
          Nios II系列軟核是Altera的第二代嵌入式處理器,其性能超過200DMIPS,Altera的Stratix、Stratix GX、Stratix II和Cyclone系列全面支持Nios II處理器。Nios II系列包括3種產(chǎn)品:Nios II/f(快速)——最高的系統(tǒng)性能,中等使用量;NiosII/s(標(biāo)準(zhǔn))——高性能,低FPGA使用量;Nios II/e(經(jīng)濟(jì))——低性能,最低的FPGA使用量。這3種產(chǎn)品具有32位處理器的基本結(jié)構(gòu)單元——32位指令大小,32位數(shù)據(jù)和地址路徑,32位通用寄存器和32個(gè)外部中斷源;使用同樣的指令集架構(gòu)(ISA),100%二進(jìn)制代碼兼容,者可以根據(jù)系統(tǒng)需求的變化更改CPU,選擇滿足性能和成本的最佳方案,而不會(huì)影響已有的軟件投入。另外,Nios II系列支持60多個(gè)外設(shè)選項(xiàng),開發(fā)者能夠選擇合適的外設(shè),獲得最合適的處理器、外設(shè)和接口組合,而不必支付根本不使用的硅片功能。本文采用CvcloneTM器件中的EP1C6Q24 0C8來實(shí)現(xiàn)雷達(dá)仿真電路顯示模塊的

          本文引用地址:http://www.ex-cimer.com/article/149671.htm

          1 硬件設(shè)計(jì)
          本系統(tǒng)的硬件設(shè)計(jì)結(jié)構(gòu)如圖1所示,主要包括以下部分:

          a.jpg


          1.1 及其配置芯片
          本文系統(tǒng)中的處理器選用的是采用AItera公司提供的Cyclone系列的,該芯片采用240腳的PQFP封裝,提供185個(gè)IO接口。
          該芯片擁有5980個(gè)LEs;可提供92160bit的ram;芯片內(nèi)部還自帶有2個(gè)鎖相環(huán),可以在高速運(yùn)行的時(shí)候保證系統(tǒng)時(shí)鐘信號(hào)的穩(wěn)定性。
          在Nios II的硬件電路,通常使用Altera串行配置器件來存儲(chǔ)FPGA配置文件*.Sof。
          Altera串行配置器件可提供在系統(tǒng)編程(ISP)和多次編程能力,能夠使FPGA和配置器件能夠以最低的價(jià)格實(shí)現(xiàn)完整的可編程芯片系統(tǒng)(SO PC)解決方案。標(biāo)準(zhǔn)型配置器件,包括EPC2、EPC1、EPC1441、EPC1213、EPC1064和EPC1064V。本文使用EPC2配置器件。使用時(shí),首先使用下載電纜將計(jì)算機(jī)生成的FPGA配置文件+.Sof使用programmer燒入EPC2配置器件中,然后由EPC2配置器件控制配置時(shí)序?qū)PGA進(jìn)行配置,一次燒寫即可重復(fù)使用,編程完后可以脫離計(jì)算機(jī)工作。

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