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          RAM讀寫時(shí)序限制解決方案
          
						
          
				作者：
				時(shí)間：2011-10-28
				來源：網(wǎng)絡(luò)
				
				
				
				
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			變換編碼后一個(gè)塊內(nèi)的有效系數(shù)一般小于25，所以逆掃描、反量化的時(shí)鐘一般小于25個(gè)時(shí)鐘周期，而反變換的時(shí)鐘周期為22個(gè)，所以處理一個(gè)塊的時(shí)鐘周期大約為25個(gè)，大大提高了速度。由于寄存器的復(fù)用及設(shè)計(jì)的優(yōu)化，節(jié)省了硬件資源，本設(shè)計(jì)采用的FPGA為EP2C35F672C6，資源使用情況如圖7所示，可見使用的總的LE為3 059個(gè)。
          本文引用地址：http://www.ex-cimer.com/article/150086.htm
          　　
          　　本設(shè)計(jì)為了解決RAM讀寫時(shí)序限制的影響，采用了兩組寄存器陣列代替RAM實(shí)現(xiàn)乒乓操作，同時(shí)為了減少硬件資源，采用寄存器組復(fù)用技術(shù)，即反變換中的轉(zhuǎn)置矩陣與逆掃描后存儲(chǔ)寄存器組復(fù)用。最后給出了波形仿真結(jié)果，并與rm52j的輸出結(jié)果比較，驗(yàn)證了結(jié)果的正確性。通過在基于Nios II的SoPC系統(tǒng)上進(jìn)行測(cè)試，證明該設(shè)計(jì)能夠正確快速實(shí)現(xiàn)逆掃描、反量化及反變換功能。
          
				
            
                
			
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