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          更新傳統(tǒng)接口――串行RapidIO交換器的應(yīng)用優(yōu)勢(shì)

          作者: 時(shí)間:2010-03-03 來(lái)源:網(wǎng)絡(luò) 收藏
          EMIF64 是由 Texas Instruments 開發(fā)的一款專利,在業(yè)內(nèi)多年,反響良好。但是,EMIF64 現(xiàn)正用于從未嘗試的 DSP 至 DSP 連接等。本文闡述了與以相同有效帶寬運(yùn)行的 器相比,采用 FPGA 的八端口 EMIF64 器具有的優(yōu)缺點(diǎn)。

          本文引用地址:http://www.ex-cimer.com/article/152069.htm

          EMIF 標(biāo)準(zhǔn)是一種成熟、穩(wěn)定的并行外部存儲(chǔ)器,且已在許多中證明大有益處。但其能力僅限于主機(jī),且需要昂貴的 CPU 中斷服務(wù)程序,以便將系統(tǒng)內(nèi)其他主機(jī)的數(shù)據(jù)傳入設(shè)備。支持 EMIF 可能還需要龐大的軟件開銷(取決于數(shù)據(jù)傳輸?shù)拇笮〖邦l率)。圖 1 所示的是的EMIF 應(yīng)用示例,通過(guò)CPU 中斷+ EDMA 方法從 CR ASIC 傳至 DSP 的傳輸形式。


          通過(guò)選擇 等先進(jìn)的系列接口,可實(shí)現(xiàn)諸多一般優(yōu)點(diǎn):
          * 可配置性及性能 C 以 1.25、2.5 及 3.125Gb的速率支持每個(gè)鏈接,且可支持多達(dá)八個(gè) 4x鏈接或十六個(gè) 1x 鏈接。具有確定性及低延時(shí)的特點(diǎn),且提供無(wú)阻塞矩陣架構(gòu)。


          * 控制 C RapidIO 具有可配置的 CPU 中斷控制、支持錯(cuò)誤管理及通過(guò)性能監(jiān)控統(tǒng)計(jì)支持擁塞控制等特點(diǎn)。它還提供用于硬件錯(cuò)誤恢復(fù)的 CRC 處理。


          * 軟件支持 C 納入硬件終止端點(diǎn)從而實(shí)現(xiàn)較低的軟件開支。另外,RapidIO 只要求低水平的配置及功能支持,同時(shí)提供高度抽象的信息傳遞 API。它還具有 CPU 開銷無(wú)需由傳輸數(shù)據(jù)的大小決定(例如通過(guò)少量控制訊息)的優(yōu)點(diǎn)。


          圖2顯示與圖1相同的應(yīng)用,而在實(shí)施時(shí)采用 RapidIO。采用此方法而不選擇 EMIF64 的具體優(yōu)點(diǎn)可概述為以下幾點(diǎn):


          * 靈活性 CEMIF64 的局限性包括:它不是一個(gè)開放式標(biāo)準(zhǔn)接口,且其帶寬限于 8Gb/s 半雙工。另外,它并非可擴(kuò)展的解決方案。相反,串行 RapidIO 具有開放式標(biāo)準(zhǔn)接口、帶寬可擴(kuò)展至高達(dá) 20Gb/s 及可擴(kuò)展架構(gòu)。



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