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	 > 工控自動(dòng)化 > 設(shè)計(jì)應(yīng)用 > 基于IC74191的自動(dòng)進(jìn)給控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
          
    
          

          

          


	
	
	

          
	
          
		
          
			
          基于IC74191的自動(dòng)進(jìn)給控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
          
						
          
				作者：
				時(shí)間：2009-10-10
				來源：網(wǎng)絡(luò)
				
				
				
				
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			 圖3是進(jìn)給當(dāng)量CLK=9時(shí)的工作時(shí)序圖。接通電源時(shí)，常開延時(shí)打開定時(shí)開關(guān)S1，ontime=0．5 ms然后打開，其輸出接計(jì)數(shù)器清零端RD，實(shí)現(xiàn)通電清零。同時(shí)定時(shí)開關(guān)S2將進(jìn)給脈沖分配器置成QUQVQW=110，當(dāng)?shù)毒哌\(yùn)動(dòng)到預(yù)定位置時(shí)，位置檢測(cè)電路便會(huì)發(fā)出進(jìn)給啟動(dòng)負(fù)脈沖信號(hào)Ust，該信號(hào)通過7410構(gòu)成的RS觸發(fā)器在7410的引腳8輸出高電平Uo，將控制門G打開，使時(shí)鐘脈沖CLK通過G門達(dá)到74163的時(shí)鐘輸入端，開始進(jìn)行進(jìn)給計(jì)數(shù)；同時(shí)該時(shí)鐘脈沖經(jīng)過進(jìn)給脈沖分配器、功率放大電路，驅(qū)動(dòng)自動(dòng)進(jìn)給執(zhí)行元件步進(jìn)電機(jī)；當(dāng)?shù)毒哌_(dá)到預(yù)置進(jìn)給位置時(shí)，利用74163的LOAD'端出現(xiàn)的下跳信號(hào)Ustop，作用在RS觸發(fā)器上，并在7410的引腳8輸出低電平，關(guān)閉控制門G，時(shí)鐘脈沖被禁止，步進(jìn)電動(dòng)機(jī)停止轉(zhuǎn)動(dòng)，完成一個(gè)自動(dòng)進(jìn)給工作周期。
          本文引用地址：http://www.ex-cimer.com/article/163538.htm
          3 自動(dòng)進(jìn)給控制系統(tǒng)的仿真
                     對(duì)圖2所示的數(shù)控機(jī)床自動(dòng)進(jìn)給驅(qū)動(dòng)系統(tǒng)進(jìn)行計(jì)算機(jī)仿真實(shí)驗(yàn)，雙擊虛擬數(shù)字邏輯分析儀圖標(biāo)，打開Clock setup對(duì)話框，調(diào)節(jié)內(nèi)部時(shí)鐘設(shè)置，如圖4所示，使Internal clock rate=2 Hz，通過編程開關(guān)設(shè)定進(jìn)給量，接通電源后，按轉(zhuǎn)換開關(guān)[X]鍵，發(fā)出位置檢測(cè)負(fù)脈沖信號(hào)，自動(dòng)進(jìn)給驅(qū)動(dòng)系統(tǒng)開始工作，虛擬數(shù)字邏輯分析儀得到圖3所示各點(diǎn)的波形。進(jìn)給脈沖的個(gè)數(shù)可由七段譯碼顯示器LED顯示，見圖2。當(dāng)編程開關(guān)取值[D][C][B][A]=1111，輸出15個(gè)進(jìn)給脈沖。仿真與實(shí)驗(yàn)結(jié)果完全符合設(shè)計(jì)要求。
          4 結(jié) 語
           步進(jìn)電動(dòng)機(jī)自動(dòng)進(jìn)給驅(qū)動(dòng)系統(tǒng)是數(shù)控機(jī)床的核心部件，進(jìn)給量的控制采用可編程可變進(jìn)制計(jì)數(shù)器，編程邏輯開關(guān)代替機(jī)械波段開關(guān)，便于聯(lián)機(jī)聯(lián)網(wǎng)運(yùn)行，提高工作穩(wěn)定性、可靠性和使用壽命；利用EDA軟件對(duì)數(shù)控機(jī)床自動(dòng)進(jìn)給系統(tǒng)研究和設(shè)計(jì)，可根據(jù)工藝要求方便地改變電路及參數(shù)，觀測(cè)仿真結(jié)果，縮短了設(shè)計(jì)周期，為電路的設(shè)計(jì)與實(shí)現(xiàn)提供了基本依據(jù)。
          
				
            
                
			
							
          
                
			            
          
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          評(píng)論
          					
		
          
		
          
			
          
			
				
          
					
					
          
						
                        
					
          
				
          
                		
						
						
			
          
		
          
		
          
		
          
            
			
            
		
          
	
          
	
          
	
          
		

          
	
          
		
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