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          一種12位雙通道高速數(shù)據(jù)采集處理系統(tǒng)

          作者: 時間:2009-02-26 來源:網(wǎng)絡 收藏
          在科學技術(shù)高度發(fā)展的現(xiàn)代社會,超系統(tǒng)越來越廣泛地應用于雷達、通訊、圖像、軍工以及化工等領域。本文介紹的是基于12位閃爍式模/數(shù)轉(zhuǎn)換器AD9224、大容量FIFO芯片UPD42280及高性能浮點型數(shù)字信號器TMS320C32的系統(tǒng)。該系統(tǒng)能對兩路信號同時采樣,存入FIFO緩存器后再按需要由DSP控制進行分時處理。由于緩存的容量較大(256K字節(jié)),因此在高達33.3MHz的頻率下仍允許對信號連續(xù)采樣幾周波,以保持采樣的高度連續(xù)。其硬件原理框圖如圖1所示。

          本文引用地址:http://www.ex-cimer.com/article/163944.htm

          1 A/D

            A/D變換器選用了AD公司的AD9224。圖2為其管腳圖,說明如下:

            1(CLK) 時鐘輸入

            2(BIT12) 數(shù)據(jù)輸出最低位LSB

            3~12(BIT11~BIT2) 數(shù)據(jù)輸出

            13(BIT1) 數(shù)據(jù)輸出最高位MSB

            14(OTR) 數(shù)據(jù)溢出標志位

            15、26(AVDD) +5V模擬電源

            16、25(AVSS) 模擬地

            17(SENSE) 參考選擇

            18(VREF) 輸入?yún)⒖歼x擇

            19(REFCOM) 通用參考(AVSS)

            20、21(CAPB、CAPT) 減噪管腳

            22(CML) 共模方式

            23(VINA) 模擬輸入(+)

            24(VINB) 模擬輸入(-)

            27(DRVSS) 數(shù)字地

            28(DRVDD) 數(shù)字電源

            AD9224是高性能、單電源+5V、最高采樣頻率為40MSPS的12位ADC。在本設計中,由于FIFO讀寫時間的限制,A/D采樣頻率最高做到了33.3MHz。AD9224采用CMOS工藝制造,內(nèi)部集成了基準電壓源、寬帶輸入采樣保持放大器等,并且采用四級流水線式結(jié)構(gòu),前三級每級包括一個連接到開關電容器DAC、級間剩余放大器MDAC的閃爍式A/D,第四級只包括閃爍式A/D。閃爍式A/D是目前轉(zhuǎn)換速率最快的ADC。AD9224采用多級流水線結(jié)構(gòu)對輸出錯誤進行邏輯糾正,以保證在整個工作范圍內(nèi)不失碼,其數(shù)據(jù)以二進制形式輸出,并帶有信號溢出指示位。AD9224在+5V電源下功耗較低,為376mW。其微分非線性誤差為0.7LSB,信噪比和失真率為67.5dB。

            AD9224的輸入可以是單端或差分方式。本設計采用的是交流耦合單端輸入方式。信號經(jīng)過由放大器AD9631和并聯(lián)電容組成的電路后被偏置為關于AVDD/2(2.5V)對稱的正弦波,C1和C2由0.1μF的陶瓷電容和10μF的鉭電容并聯(lián),電容和電阻共同組成了一個高通濾波器。圖3所示為A/D部分的電路設計圖。


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