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          基于CX2443x的數(shù)字電視機頂盒設(shè)計

          作者: 時間:2011-09-19 來源:網(wǎng)絡(luò) 收藏
          音視頻解碼的原理和電路實現(xiàn)

          本文引用地址:http://www.ex-cimer.com/article/166047.htm

            1 音視頻信號解碼處理的流程

            技術(shù)的首要目標(biāo)是提高傳送圖像的質(zhì)量,完成對數(shù)字有線電視的相關(guān)改造后,不僅傳送圖像的質(zhì)量而且傳送圖像的數(shù)量均要得到提高。是高度集成的單片IC,它在一塊芯片上包含了完整的STB后端子系統(tǒng)和CM子系統(tǒng)。其后端子系統(tǒng)包含有一個視頻解碼器、一個音頻解碼器、三個多標(biāo)準(zhǔn)傳輸流解復(fù)用器和高性能的嵌入式32位ARM920T RISC處理器以及集成的外設(shè)I/O接口等。片上的解碼內(nèi)核能夠?qū)σ粢曨l流信號進行完全的解碼并最終輸出數(shù)字的視頻和音頻信號到編碼模塊。

            信號流的處理過程如圖4所示。完成了解調(diào)和信道解碼的MPEGⅡ格式或其他格式的音視頻信號傳輸流在解復(fù)用模塊進入DTDC子系統(tǒng),它包含了音視頻的基本碼流、同步信息、程序?qū)Ш胶徒饷苄畔ⅰ=鈴?fù)用分析器標(biāo)識這些不同格式的數(shù)據(jù)并輸送每一格式的數(shù)據(jù)到相應(yīng)的內(nèi)存緩沖器。程序?qū)Ш胶徒饷苄畔t被輸送到DTDC外部主機;音視頻的基本碼流被輸送到專用的SDRAM中,并通過存儲橋傳送到相應(yīng)的解碼器以輸出音視頻的解碼數(shù)字信號;同步信息則被輸送到一個音視頻同步機。

            

            圖4 數(shù)字解碼子系統(tǒng)結(jié)構(gòu)圖

            2 音視頻解碼模塊的電路實現(xiàn)

            和其他子芯片以及晶振電路協(xié)同完成信號的解碼處理,如圖5所示,這部分主要包含音頻視頻信號模塊、系統(tǒng)調(diào)試用的JTAG口的電路連接,以及一些外圍電路。CX2443x芯片輸出完成數(shù)字解碼的音頻和視頻到相應(yīng)的編碼模塊。JTAG口用來連接外部的調(diào)試設(shè)備,在實際電路設(shè)計中要注意外部晶振電路的配合。

            

            圖5 音視頻解碼模塊的電路

            音視頻解碼測試

            經(jīng)過初步的測試,本樣機設(shè)計符合以下標(biāo)準(zhǔn):信道解碼遵循DVB-C EN300 429;視頻解碼遵循MPEG-2 Video(MP@ML)和MPEG-1 Video;音頻解碼遵循MPEG-2、MPEG-1和線性PCM。數(shù)字電視信號解碼處理后的圖像如圖6所示。

            

            圖6 解碼圖像的顯示


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