基于H.264的嵌入式無線視頻監(jiān)控系統(tǒng)
1 引言
本文引用地址:http://www.ex-cimer.com/article/171651.htm對圖像監(jiān)控系統(tǒng),用戶常常對使用環(huán)境提出一些特殊需求,他們希望能夠監(jiān)控距離比較遠的對象,這些對象有可能是深山的電網(wǎng)、荒原的油井或者其它無人值守或人無法到達場合的重要設(shè)備何地;另一方面他們希望獲取比較清晰的圖象,同時他們對圖象傳輸?shù)膶崟r性要求比較高,很明顯,用傳統(tǒng)的PC機加圖像采集卡的方式很難滿足這樣的需求[1]。
以往的視頻監(jiān)控系統(tǒng)很多都使用了MPEG-4標準,而新一代視頻壓縮標準H.264是面向無線網(wǎng)絡(luò)和因特網(wǎng)的視頻圖像編碼與傳輸技術(shù),相對MPEG-4標準,除了增強網(wǎng)絡(luò)適應(yīng)能力外,大幅度提高了壓縮編碼效率,在相同的碼率下能夠獲得更高的主客觀質(zhì)量。
碼分多址無線網(wǎng)絡(luò)具有覆蓋面廣、高效、低成本的特點。碼分多址網(wǎng)絡(luò)的數(shù)據(jù)傳輸速率可達150 kb/s。這里開發(fā)的嵌入式無線視頻定位監(jiān)控系統(tǒng)就是充分利用了H.264視頻壓縮技術(shù)碼分多址無線網(wǎng)絡(luò)技術(shù)和嵌人式系統(tǒng)的特點而搭建的數(shù)據(jù)傳輸系統(tǒng)。
本文提出了一種采用海思公司的Hi3510系統(tǒng)的設(shè)計方案,分別對系統(tǒng)軟硬件的設(shè)計進行了詳細討論,完成視頻信號的采集、壓縮及傳輸功能。
2 系統(tǒng)架構(gòu)
該系統(tǒng)由無線或有線互聯(lián)網(wǎng)監(jiān)控用戶、中心服務(wù)器、嵌入式監(jiān)控終端組成,系統(tǒng)架構(gòu),如圖1所示。無線終端用戶或者有線互聯(lián)網(wǎng)用戶向中心服務(wù)器發(fā)送用戶請求命令,先通過碼分多址網(wǎng)關(guān)接入Internet,然后到達中心服務(wù)器。中心服務(wù)器收到用戶命令后進行命令解析,再通過無線網(wǎng)絡(luò)向監(jiān)控終端發(fā)送控制命令,監(jiān)控終端收到中心端的監(jiān)控任務(wù)之后,就通過圖像采集模塊拍攝現(xiàn)場圖像,并將經(jīng)過H.264壓縮編碼后的圖像數(shù)據(jù)按照RTP通信協(xié)議,經(jīng)由碼分多址模塊發(fā)送回中心服務(wù)器。對于無線用戶,中心服務(wù)器再通過無線網(wǎng)絡(luò)向用戶發(fā)送監(jiān)控視頻或圖片,而對于互聯(lián)網(wǎng)用戶中心服務(wù)器則直接通過 Internet向網(wǎng)絡(luò)用戶提供視頻或圖片監(jiān)控。中心服務(wù)器首先需要處理在數(shù)據(jù)傳輸過程中出現(xiàn)的數(shù)據(jù)包錯序、校驗出錯、丟包、重包等現(xiàn)象,即在通訊協(xié)議中增加請求丟包重發(fā)機制和超時機制;其次,中心服務(wù)器還要監(jiān)控碼分多址傳輸數(shù)據(jù)質(zhì)量,并進行反饋,由此來控制碼分多址在不同信號質(zhì)量下發(fā)送數(shù)據(jù)的速度;最后,服務(wù)器還要為用戶提供監(jiān)控系統(tǒng)的Web瀏覽、視頻數(shù)據(jù)的硬盤存儲、下載等功能。系統(tǒng)采用雙C/S架構(gòu),具有非常好的擴容性,多個監(jiān)控終端安裝在不同的地點,就能夠?qū)崿F(xiàn)對不同目標的實時監(jiān)控。
圖1. 監(jiān)控系統(tǒng)構(gòu)架圖
3 監(jiān)控終端設(shè)計
監(jiān)控端系統(tǒng)基于華為海思公司的高性能通信媒體處理器碼分多址搭建。Hi3510是一款基于ARM9、DSP雙處理器內(nèi)核以及硬件加速引擎的高集成、可編程、支持MPEG-4 AVC/H.264協(xié)議的高性能通信媒體處理器。圍繞Hi3510分別搭建相應(yīng)的硬件和軟件環(huán)境,就可以很方便的實現(xiàn)監(jiān)控終端的設(shè)計。
3.1 監(jiān)控終端硬件設(shè)計
要能夠正確運行一個系統(tǒng),硬件方面至少應(yīng)該包括CPU、內(nèi)存和固態(tài)存儲器、系統(tǒng)內(nèi)部總線以及外設(shè)接口,Hi3510處理器系統(tǒng)很好滿足了這些條件。具體硬件系統(tǒng)結(jié)構(gòu)見圖2。
圖2. Hi3510處理器機構(gòu)圖
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