一種高速低壓用增益增強型運算跨導放大器設(shè)計
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按照12位100MHz采樣頻率流水線A／D轉(zhuǎn)換器的采樣保持電路的指標來設(shè)計這個運算放大器。對動態(tài)誤差和靜態(tài)誤差所各自需要的增益和單位增益帶寬進行了折衷，將0．002％分配給靜態(tài)誤差，余下的0．008％給動態(tài)誤差。電路采用中芯國際(SMIC)0．18 μm混合信號CMOS工藝設(shè)計，1．8V電壓供電。具體設(shè)計指標為：開環(huán)增益：102dB：建立時間：4．3ns；精度：0．01％；單位增益帶寬：1．27GHz。頻率響應(yīng)的曲線如圖4所示。本文引用地址：http://www.ex-cimer.com/article/188745.htm
對運算放大器一些重要的性能參數(shù)在TT下仿真，結(jié)果的歸納見表1。
對階躍輸入響應(yīng)的仿真在如圖5所示的閉環(huán)中進行。從運算放大器的輸入端引入一個±1V的大階躍信號，對應(yīng)的建立時間曲線如圖6所示，表明所設(shè)計的電路能夠在4．3ns內(nèi)達到終態(tài)0．01％的精度。
3 結(jié)論
本文提出了一種可用于增益增強運放高速設(shè)計的優(yōu)化方法，并采用SMIC 0．18 μm混合信號CMOS工藝設(shè)計，實現(xiàn)了一個單級全差分增益增強的折疊共源共柵運算放大器。詳細分析并克服了零極點對可能引起的慢動態(tài)性能。仿真結(jié)果表明，此運算放大器能夠滿足高性能流水線A／D轉(zhuǎn)換器設(shè)計的要求。
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