基于CPLD的多路數(shù)據(jù)采集系統(tǒng)的設(shè)計

摘要：隨著數(shù)字化生活的到來，數(shù)據(jù)采集系統(tǒng)在日常生活中的應(yīng)用越來越顯著。模擬信號和數(shù)字信號之間的轉(zhuǎn)換已成為計算機控制系統(tǒng)中不可缺少的環(huán)節(jié)。較傳統(tǒng)數(shù)據(jù)采集系統(tǒng)，以可編程邏輯器件實現(xiàn)的數(shù)據(jù)采集系統(tǒng)具有時鐘頻率高，內(nèi)部延時小，速度快，效率高，組成形式靈活等特點。
關(guān)鍵詞：CPLD；數(shù)據(jù)采集；VHDL；狀態(tài)機

數(shù)據(jù)采集系統(tǒng)具有極強的通用性，可廣泛應(yīng)用于軍事、工業(yè)生產(chǎn)、科學(xué)研究和日常生活中。隨著計算機的普及，數(shù)據(jù)采集系統(tǒng)在日常生活中的應(yīng)用越來越顯著。由于基于DSP芯片的高速電子器件成本和制作工藝，以及高密集的技術(shù)含量，使得高速數(shù)據(jù)采集卡的價格昂貴。而復(fù)雜可編程邏輯器件(CPLD)能夠?qū)⒋罅康倪壿嫻δ芗捎谝粋€單片集成電路中，以其時鐘頻率高，內(nèi)部延時小，速度快，效率高，組成形式靈活等特點在高速數(shù)據(jù)采集方面有著單片機和DSP無法比擬的優(yōu)勢。

1 設(shè)計思路
該系統(tǒng)由數(shù)據(jù)輸入單元、數(shù)據(jù)處理單元、數(shù)據(jù)輸出單元三大部分組成。其中數(shù)據(jù)輸入單元是由狀態(tài)機控制ADC0809實現(xiàn)。輸入信號可以是各種形式，它可以是語音信號、調(diào)制后的電話信號、編碼的數(shù)字信號、壓縮的圖像信號，也可以是各種傳感器輸出的信號。A／D能將模擬信號變換成數(shù)字信號，但必須滿足香農(nóng)采樣定理，也就是為了保證不丟失信息的所有信息，采樣頻率必須高于輸入信號最高頻率的2倍。A／D變換后得到的數(shù)字信號輸人到CPLD芯片；再由CPLD芯片對該數(shù)字信號進行各種數(shù)字信號算法的處理。經(jīng)過處理后的數(shù)字信號再經(jīng)過數(shù)／模轉(zhuǎn)換器ADC0832將其輸出。

2 系統(tǒng)各部分的功能及實現(xiàn)
2．1 數(shù)據(jù)輸入電路
數(shù)據(jù)輸入電路主要是由狀態(tài)機控制ADC0809實現(xiàn)。其中START為轉(zhuǎn)換控制信號，高電平有效；ALE是3位通道選擇地址(ADDC，ADDB，ADDA)信號的鎖存信號，高電平有效；EOC是轉(zhuǎn)換情況狀態(tài)信號(類似于AD574的STATUS)，當(dāng)啟動轉(zhuǎn)換約100 μs后，EOC產(chǎn)生一個高電平，以示轉(zhuǎn)換結(jié)束，轉(zhuǎn)換期間一直處于低電平。一旦START有效后，狀態(tài)信號EOC即變?yōu)榈碗娖?，表示進入轉(zhuǎn)化狀態(tài)。轉(zhuǎn)換結(jié)束后，EOC將變?yōu)楦唠娖?。OE為數(shù)據(jù)輸出允許信號，當(dāng)OE為高電平時，則控制打開三態(tài)緩沖器，把轉(zhuǎn)換好的8位數(shù)據(jù)結(jié)果輸至數(shù)據(jù)總線。其工作時序如圖1所示。

對ADC0809的工作過程分析可知：其工作處于6個狀態(tài)。在狀態(tài)St1中，ALE高電平將ADC0809的8路采樣輸入通道地址存入ADC0809地址鎖存器中。在狀態(tài)St3中需要對ADC0809工作狀態(tài)信號EOC進行循環(huán)檢測，如果為低電平，表示轉(zhuǎn)換沒有結(jié)束，仍需要停留在St3狀態(tài)中等待，直到EOC變成高電平后才說明轉(zhuǎn)換結(jié)束，在下一時鐘脈沖到來時轉(zhuǎn)向狀態(tài)St4。在狀態(tài)St4，由狀態(tài)機向ADC0809發(fā)出轉(zhuǎn)換好的8位數(shù)據(jù)輸出命令，這一狀態(tài)周期同時可作為數(shù)據(jù)輸出穩(wěn)定周期，以便能在下一狀態(tài)中向鎖存器中鎖入可靠的數(shù)據(jù)。在狀態(tài)St5，由狀態(tài)機向CPLD中的鎖存信號(LO-CK的上升沿)，將ADC-0809輸出的數(shù)據(jù)進行鎖存。其采樣控制狀態(tài)圖如圖2所示。