嵌入式脈象采集儀電路設(shè)計(jì)
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完整編譯綜合采集部分后由兩部分組成，如圖2所示。
3．2 基于NiosⅡ的SoPC硬件設(shè)計(jì)
利用Altera公司的QuartusⅡ軟件和SoPCBuilder開發(fā)工具，可以方便地定制一個(gè)從硬件到軟件的完整系統(tǒng)。FPGA內(nèi)部需要設(shè)計(jì)以下模塊：NiosⅡ、SRAM控制器、SDRAM控制器、EPCS控制器、FLASH控制器、定時(shí)器、VGA控制器、RS 232控制器、脈象采集控制器等。除脈象采集控制器沒有現(xiàn)成的IP核可用，需開發(fā)控制時(shí)序外，其他控制器采用Altera公司提供的IP核。
SoPC系統(tǒng)生成完成后，在QuartusⅡ下建立原理圖窗口，調(diào)用設(shè)計(jì)好的NiosⅡ系統(tǒng)與自己設(shè)計(jì)的脈象采集系統(tǒng)的控制連接，設(shè)計(jì)完成后，鎖定引腳，進(jìn)行完整編譯。完成后的電路如圖3所示。
編譯后配置到系統(tǒng)中的FPGA去，后面的工作就是嵌入式操作系統(tǒng)的移植和嵌入式應(yīng)用程序的開發(fā)，這時(shí)會(huì)利用到該硬件平臺(tái)。
4 結(jié)語
設(shè)計(jì)出嵌入式脈象采集儀的總體方案，并完成了基于FPGA的脈象采集儀硬件電路設(shè)計(jì)。根據(jù)脈象采集的特點(diǎn)，設(shè)計(jì)脈象采集部分電路，利用IP核構(gòu)建了脈象采集的SoPC系統(tǒng)。設(shè)計(jì)的脈象采集儀具有成本低，功耗低，體積小，便于擴(kuò)展，使用方便，穩(wěn)定性高，可靠性高，系統(tǒng)維護(hù)方便等特點(diǎn)。
本文引用地址：http://www.ex-cimer.com/article/195166.htm linux操作系統(tǒng)文章專題:linux操作系統(tǒng)詳解（linux不再難懂）
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