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          SOPC技術(shù)在視覺(jué)測(cè)量中的應(yīng)用

          作者: 時(shí)間:2009-08-26 來(lái)源:網(wǎng)絡(luò) 收藏

            3.3 邊緣細(xì)化模塊

            本文的邊緣是建立在二值化之后的,因此處理的圖像都是二值化的,邊緣非常清晰,不需要太復(fù)雜的算法。這里采用兩個(gè) 3×3模板作乘積,如圖所示, X為待處理像素。如果模板乘積不為 0,于是中心象素為 1,反之為 0,即點(diǎn)的周?chē)谢叶葹?0的象素,則保留此點(diǎn),否則剔除。如此很容易得到二值化后點(diǎn)的單象素邊緣。

            3.4 后續(xù)處理部分

            后續(xù)處理部分由于其數(shù)據(jù)處理量并不大且算法比較復(fù)雜,所以在本系統(tǒng)中,這部分算法在 NiosⅡ中以軟件的方法實(shí)現(xiàn)。由于篇幅所限,在此不作詳細(xì)介紹。

            4 系統(tǒng)測(cè)試結(jié)果的分析與總結(jié)

            圖 4為原始圖像。圖 5為處理后的最終圖像,點(diǎn)中心已經(jīng)標(biāo)注如圖所示。

            經(jīng)測(cè)試,本系統(tǒng)所有算法用 C語(yǔ)言在 PC機(jī)(配置: Pentium( R) 4 CPU 3.00GHz, 512MB內(nèi)存)上實(shí)現(xiàn),所需時(shí)間為 2'12,而本系統(tǒng)僅需 30,其中主要耗時(shí)為 NiosII軟件處理部分,系統(tǒng)的硬件算法部分所耗時(shí)間不到 1。

            本文作者創(chuàng)新點(diǎn):一是采用 FPGA設(shè)計(jì)硬件模塊實(shí)現(xiàn)圖像預(yù)處理算法,這是系統(tǒng)在處理效率上的創(chuàng)新;二是在系統(tǒng)中加入Nios II CPU,用以 FPGA難以實(shí)現(xiàn)的算法,從而使基于 技術(shù)的系統(tǒng)更具靈活性,這是系統(tǒng)在靈活性方面的創(chuàng)新?;谝陨蟽牲c(diǎn)創(chuàng)新設(shè)計(jì)的視覺(jué)測(cè)量系統(tǒng)兼顧了效率和靈活性,為視覺(jué)測(cè)量系統(tǒng)的設(shè)計(jì)和研究提供了一種新的思路。


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