STM學(xué)習(xí)筆記--STM32F10X時(shí)鐘

　　一：系統(tǒng)(SYSCLK)時(shí)鐘3種 (注：時(shí)鐘頻率較高)

　　HSI振蕩器時(shí)鐘 8MHZ

　　HSE振蕩器時(shí)鐘 4-16MHZ

　　PLL 時(shí)鐘 2-16倍頻 PLL的設(shè)置必須在其激活前完成，激活后不能改變其狀態(tài)。

　　1:HSI為內(nèi)部8MHz RC振蕩產(chǎn)生，啟動(dòng)時(shí)間比HSE短，精度較低。出廠校準(zhǔn)精度為1%(25℃)。校準(zhǔn)值存放在HSICAL[7：0]。

　　軟件判斷HIS是否啟動(dòng)完成：通過(guò)判斷HSIRDY位是否為1。啟動(dòng)時(shí)，等HIS穩(wěn)定后，硬件置位HSIRDY。可以產(chǎn)生中斷，如果中斷使能(RCC_CIR)。

　　時(shí)鐘切換：HSI在復(fù)位后為默認(rèn)系統(tǒng)時(shí)鐘，若改變時(shí)鐘源，需等到目標(biāo)時(shí)鐘源準(zhǔn)備就緒，才能夠發(fā)送切換。準(zhǔn)備就緒的標(biāo)準(zhǔn)是：RCC_CR寄存器里的狀態(tài)位。

　　2:HSE時(shí)鐘

　　產(chǎn)生方式兩種：

　　à外部時(shí)鐘源(HSE旁路)：最大至25MHz

　　à外部晶體/陶瓷諧振器(HSE晶體)：4-16MHz 負(fù)載電容需根據(jù)晶振調(diào)試

　　硬件配置：

　　軟件判斷HSE是否穩(wěn)定：HSERDY=1，則HSE穩(wěn)定。啟動(dòng)時(shí)，得等到HSE穩(wěn)定時(shí)，硬件置位HSERDY。可以產(chǎn)生中斷，如果中斷使能(RCC_CIR)。

　　3:PLL為倍頻HSI RC及HSE時(shí)鐘。

　　SYSCLK外設(shè)應(yīng)用

　　SYSCLK時(shí)鐘 àI2S2/I2S3

　　àAPB預(yù)分頻器(1-512)

　　à USB時(shí)鐘48MHZàUSBCLK

　　à SDIO, FSMCCLK

　　à (HCLK最大72M)AHB總線，核心存儲(chǔ)器，DMA

　　à APB1預(yù)分頻器(1-16)最大時(shí)鐘36MHZà PCLK1

　　à APB2預(yù)分頻器(1-16)最大時(shí)鐘72MHZ àPCLK2

　　à HCLK/2àSDIO的AHB接口

　　PCLK1給APB1外設(shè)使用

　　(DAC,，PWR，BKP，CAN，USB，I2C(1-2)，USART(2-5)，SPI(2-3)，WWDG，TIM2-7)

　　PCLK2給APB2外設(shè)使用

　　(ADC(1-3),，USART1，TIM(1，8)，SPI1，IOP(A-G),AFIO)

　　二：低速時(shí)鐘LSE/LSI應(yīng)用于RTC及IWDG

　　同理LSE 分為 àLSE旁路

　　àLSE外部晶體/時(shí)鐘

　　LSE穩(wěn)定軟件判斷：LSERDY為1，啟動(dòng)時(shí)，等待時(shí)鐘穩(wěn)定，當(dāng)時(shí)鐘穩(wěn)定后，硬件置1。可以產(chǎn)生中斷。

　　應(yīng)用：RTC

　　LSE OSC 32.768KHZ à RTC

　　LSI為內(nèi)部RC振蕩，等待LSIRDY為1，若穩(wěn)定，硬件置1，可以產(chǎn)生中斷。

　　應(yīng)用：獨(dú)立看門狗IWDOG及RTC

　　LSI RC 40KHZ(30-60KHZ) à RTC 及 IWDG

　　三：時(shí)鐘安全系統(tǒng)：CSS

　　作用是檢測(cè)HSE是否出現(xiàn)故障，若出現(xiàn)故障，HSE自動(dòng)關(guān)閉，立即產(chǎn)生中斷NMI，直到CSS位中斷掛起位(RCC_CIR)被清除。