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CMOS電路中ESD保護(hù)結(jié)構(gòu)的設(shè)計(jì)原理與要求

作者：時(shí)間：2016-09-12 來(lái)源：網(wǎng)絡(luò)

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4 結(jié)束語(yǔ)

ESD保護(hù)設(shè)計(jì)隨著CMOS工藝水平的提高而越來(lái)越困難，ESD保護(hù)已經(jīng)不單是輸入腳或輸出腳的ESD保護(hù)設(shè)計(jì)問(wèn)題，而是全芯片的靜電防護(hù)問(wèn)題。

芯片里每一個(gè)I/O電路中都需要建立相應(yīng)的ESD保護(hù)電路，此外還要從整個(gè)芯片全盤(pán)考慮，采用整片(whole-chip)防護(hù)結(jié)構(gòu)是一個(gè)好的選擇，也能節(jié)省I/OPAD上ESD元件的面積。

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