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CMOS電路中ESD保護結(jié)構(gòu)的設(shè)計原理與要求

作者：時間：2016-09-12 來源：網(wǎng)絡(luò)

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4 結(jié)束語

ESD保護設(shè)計隨著CMOS工藝水平的提高而越來越困難，ESD保護已經(jīng)不單是輸入腳或輸出腳的ESD保護設(shè)計問題，而是全芯片的靜電防護問題。

芯片里每一個I/O電路中都需要建立相應(yīng)的ESD保護電路，此外還要從整個芯片全盤考慮，采用整片(whole-chip)防護結(jié)構(gòu)是一個好的選擇，也能節(jié)省I/OPAD上ESD元件的面積。

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