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          stm32的時鐘設(shè)定

          作者: 時間:2016-11-26 來源:網(wǎng)絡(luò) 收藏
          時鐘圖



          本文引用地址:http://www.ex-cimer.com/article/201611/321735.htm


          //RCC_HSEConfig(RCC_HSE_OFF); // 關(guān)閉外部時鐘

          //RCC_HSEConfig(RCC_HSE_ON);//開啟外部時鐘


          //RCC_HSICmd(ENABLE);// 開啟內(nèi)部時鐘

          //RCC_HSICmd(DISABLE);// 開啟內(nèi)部時鐘

          //雙高級外設(shè)總線結(jié)構(gòu):高速APB(APB2)速度達到72MHz、低速APB(APB1)速度達到36MHz。

          //允許用戶優(yōu)化外設(shè)的使用(18MHz的SPI、4.5Mbps的USART、72MHz的PWM定時器、18MHz觸發(fā)I/O口)。



          //RCC_PLLConfig(RCC_PLLSource_HSE_Div1, RCC_PLLMul_8); // 使用外部時鐘源F,倍頻輸出等于 F*8/1
          //RCC_PLLConfig(RCC_PLLSource_HSI_Div2, RCC_PLLMul_8); // 使用內(nèi)部時鐘源F,倍頻輸出等于 F*8/2

          void RCC_Configuration(void)

          {

          RCC_DeInit();//將外設(shè)RCC寄存器重設(shè)為缺省值(即默認值)

          RCC_HSEConfig(RCC_HSE_ON);//打開外部晶振

          if(RCC_WaitForHSEStartUp() == SUCCESS) //判斷起振是否成功

          {

          RCC_HCLKConfig(RCC_SYSCLK_Div1); //設(shè)置AHB時鐘(HCLK)(這時設(shè)置為=系統(tǒng)時鐘)

          RCC_PCLK2Config(RCC_HCLK_Div1); //設(shè)置高速AHB時鐘(HCLK2)(這時設(shè)置為=HCLK)

          RCC_PCLK1Config(RCC_HCLK_Div2);//設(shè)置低速AHV時鐘(HCLK1)(這時設(shè)置為=HCLK/2)

          FLASH_SetLatency(FLASH_Latency_2);//設(shè)置FLASH存儲器延時時鐘周期數(shù)。(設(shè)置為延時2個時鐘周期)

          FLASH_PrefetchBufferCmd(FLASH_PrefetchBuffer_Enable);//使能預(yù)取指緩存

          RCC_PLLConfig(RCC_PLLSource_HSE_Div1, RCC_PLLMul_9);//PLL的時鐘來源及倍頻的倍數(shù)

          while(RCC_GetFlagStatus(RCC_FLAG_PLLRDY) == RESET) //檢測PLL是否就緒

          {

          }

          RCC_SYSCLKConfig(RCC_SYSCLKSource_PLLCLK); //設(shè)置PLL為系統(tǒng)時鐘

          while(RCC_GetSYSCLKSource() != 0x08) //檢測系統(tǒng)的時鐘源是否是PLL

          {

          }

          }

          RCC_APB2PeriphClockCmd(RCC_APB2Periph_USART1 | RCC_APB2Periph_GPIOA, ENABLE);//使能USART GPIOA時鐘

          }



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