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S3C44B0X應(yīng)用設(shè)計(jì) - 存儲(chǔ)器組設(shè)計(jì)

作者：時(shí)間：2016-12-02 來源：網(wǎng)絡(luò)

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圖 4-8.用半字 SRAM 設(shè)計(jì)的半字 SRAM 組

圖 4-9.字 EEPROM/SRAM 組設(shè)計(jì)

S3C44B0X的EDO DRAM組的設(shè)計(jì)

DRAM組6-7，可以有著不同的數(shù)據(jù)總線寬度，并且數(shù)據(jù)總線寬度由S/W，一個(gè)BWSCON 特殊功能寄存器組控制的。DRAM 組 6-7 的一個(gè)設(shè)計(jì)樣例如圖 4-10 和 4-11 所示。

圖 4-10.半字 EDO/Normal DRAM 組設(shè)計(jì)

圖 4-11.字 EDO/Normal DRAM 組

S3C44B0X的SDRAM 組的設(shè)計(jì)

S3C44B0X 同步 DRAM 接口特性如下：(1)SDRAM 的最大行地址：10 位；(2)CAS 延遲：2/3 周期。

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