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          討論s3c2440的時(shí)鐘與DMA
          
						
          
				作者：
				時(shí)間：2016-12-02
				來(lái)源：網(wǎng)絡(luò)
				
				
				
				
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			s3c2440的時(shí)鐘與電源管理模塊包括3個(gè)部分，時(shí)鐘控制，USB控制和電源控制。時(shí)鐘源如下圖有兩個(gè)，左邊的是外部晶振提供，右邊是外部時(shí)鐘提供。









          由這個(gè)表可以看出來(lái)時(shí)鐘源的選擇是在引導(dǎo)的時(shí)候由OM[3:2]引腳決定的。






          如圖，剛上電一小段時(shí)間后，F(xiàn)CLK=晶振時(shí)鐘，等待4個(gè)時(shí)鐘周期后，PLL鎖存有效，自動(dòng)插入一段PLL Lock Time，即PLL鎖定時(shí)間，此時(shí)，F(xiàn)CLK停止震蕩，CPU停止工作，Lock time的長(zhǎng)短由寄存器LOCKTIME設(shè)定。PLL Lock Time之后，MPLL輸出正常，CPU工作在新的FCLK下。










          有兩個(gè)PLL，一個(gè)是MPLL，一個(gè)是UPLL。MPLL分頻得到FCLK（用于CPU），HCLK（用于AHB BUS），PCLK（用于APB BUS）。UPLL產(chǎn)生UCLK給USB提供48M或96M時(shí)鐘。上邊的是s3c2440a的體系結(jié)構(gòu)圖，最上邊的是CPU wrapper，也就是CPU核，中間的AHB BUS相當(dāng)于系統(tǒng)總線，APB相當(dāng)于IO總線。中間的Bridge相當(dāng)于康柏（Compaq）公司提出的南橋。這個(gè)Bridge的作用就是連接高速和低速總線。這種結(jié)構(gòu)類似于：


          
				
            
                
			
							
          
                
			            
          
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          關(guān)鍵詞：
            			            s3c2440時(shí)鐘DM
                        
            
          
            
			
          
		
          	
		

	

          
	
	
          
		
          
			
          評(píng)論
          					
		
          
		
          
			
          
			
				
          
					
					
          
						
                        
					
          
				
          
                		
						
						
			
          
		
          
		
          
		
          
            
			
            
		
          
	
          
	
          
	
          
		
		

          


	
          
	
          
		
		
	
          


    
          
        
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	    關(guān)閉
	
          
	
	

          







	
	





          



          


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