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          示波器高級(jí)觸發(fā)類型和控制(上)

          作者: 時(shí)間:2017-01-12 來(lái)源:網(wǎng)絡(luò) 收藏

          窗口觸發(fā)

          在許多高速設(shè)計(jì)中,多個(gè)內(nèi)部元件總線在一塊電路板上共享相同的總線。硬件或軟件控制的緩沖陣列用來(lái)把正確數(shù)據(jù)復(fù)用到主總線上。復(fù)用器邏輯設(shè)計(jì)成在任一時(shí)間只允許一個(gè)單元使用總線。設(shè)計(jì)錯(cuò)誤可能會(huì)導(dǎo)致總線爭(zhēng)用,即在有兩個(gè)邏輯電平的一條總線中會(huì)經(jīng)歷一種“中間”狀態(tài),在這種狀態(tài)下,信號(hào)既不是‘1’也不是‘0’。窗口觸發(fā)可以輕松捕獲總線爭(zhēng)用。通過(guò)窗口觸發(fā)功能,示波器會(huì)觸發(fā)進(jìn)入(或退出)由兩個(gè)用戶可調(diào)節(jié)的門限定義的窗口的事件。此外,還可以使用窗口觸發(fā)上的時(shí)間限定指標(biāo),構(gòu)成一個(gè)矩形時(shí)間窗口,如果信號(hào)進(jìn)入或退出這個(gè)窗口,那么會(huì)觸發(fā)采集。最小窗口寬度是150 ps,最小重新準(zhǔn)備時(shí)間為500 ps。圖1g說(shuō)明了捕獲的總線爭(zhēng)用事件。觸發(fā)電平設(shè)置成相應(yīng)邏輯家族的高和低門限電壓。

          圖1g.窗口觸發(fā)。

          邏輯限定

          通過(guò)Pinpoint觸發(fā)系統(tǒng),還可以選擇對(duì)上面所有高級(jí)觸發(fā)類型(毛刺、寬度、欠幅脈沖、超時(shí)、跳變時(shí)間、建立時(shí)間和保持時(shí)間、窗口)進(jìn)行邏輯判斷,為隔離事件提供了另一個(gè)強(qiáng)大的工具。圖2說(shuō)明了使用邏輯限定捕獲建立時(shí)間和保持時(shí)間,其中通道1 (黃色)和通道2 (藍(lán)色)分別是時(shí)鐘和數(shù)據(jù)。通道3 (洋紅色)和通道4 (綠色)的觸發(fā)事件都限定為邏輯高。只有在滿足邏輯條件時(shí),

          才會(huì)在建立時(shí)間和保持時(shí)間違規(guī)時(shí)觸發(fā)采集。在數(shù)字電路中,通常需要根據(jù)觀察的信號(hào)的邏輯狀態(tài)定義觸發(fā)條件。4通道示波器可以使用最多四條輸入的邏輯狀態(tài)觸發(fā)示波器。

          圖2.邏輯判定建立時(shí)間和保持時(shí)間觸發(fā)

          Pinpoint觸發(fā)系統(tǒng)中有兩種邏輯觸發(fā):

          ◆邏輯碼型觸發(fā)

          ◆邏輯狀態(tài)觸發(fā)

          ◆邏輯碼型觸發(fā)

          邏輯觸發(fā)(圖3a)允許在提供的輸入通道的任何邏輯組合上觸發(fā)采集,特別適合檢驗(yàn)數(shù)字邏輯操作。在輸入通道滿足邏輯碼型(AND, OR, NAND, NOR)時(shí),示波器會(huì)觸

          發(fā)采集。傳統(tǒng)的邏輯家族(TTL 和ECL)提供了預(yù)先定義的門限電平,也可以使用USER 為邏輯家族設(shè)置門限,如高速CMOS。在MSO70000 系列上,可以把寬達(dá)20位的邏輯碼型定義為觸發(fā)條件。這特別適合隔離復(fù)雜設(shè)計(jì)中的特定系統(tǒng)狀態(tài),如定時(shí)檢驗(yàn)至關(guān)重要的存儲(chǔ)器總線。

          圖3a. 邏輯碼型觸發(fā)。

          邏輯狀態(tài)觸發(fā)

          與邏輯碼型觸發(fā)類似,在邏輯狀態(tài)觸發(fā)中,觸發(fā)通過(guò)由通道4(及MSO70000 上的Clk/Qual)上的邊沿提供時(shí)鐘的通道1、2 和3(及MSO70000上的通道D0-D15)的任何邏輯碼型定義,如圖3b 所示。可以在時(shí)鐘上升沿或下降沿上觸發(fā)系統(tǒng)。在包含觸發(fā)和位移寄存器的電路中調(diào)試傳播時(shí)延和亞穩(wěn)定問(wèn)題時(shí),這類觸發(fā)非常有用。邏輯狀態(tài)觸發(fā)可以用來(lái)調(diào)試存在離散時(shí)鐘線路和多個(gè)數(shù)據(jù)信號(hào)的并行總線;串行觸發(fā)(后面將進(jìn)行討論) 則適用于觸發(fā)串行總線中的嵌入式時(shí)鐘數(shù)據(jù)。

          圖3b. 邏輯狀態(tài)觸發(fā)。


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