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          時(shí)延估計(jì)算法的FPGA實(shí)現(xiàn)

          作者: 時(shí)間:2017-06-05 來(lái)源:網(wǎng)絡(luò) 收藏

          是雷達(dá)、聲納等領(lǐng)域經(jīng)常遇到的一個(gè)問(wèn)題,提出了利用相關(guān)計(jì)算法實(shí)現(xiàn),并通過(guò)互譜插值提高。結(jié)合器件特性,運(yùn)用VHDL語(yǔ)言編程,實(shí)現(xiàn)了整個(gè)相關(guān)算法。利用QuartusⅡ和Matlab軟件進(jìn)行了聯(lián)合仿真,結(jié)果證明了設(shè)計(jì)的正確性。

          本文引用地址:http://www.ex-cimer.com/article/201706/349312.htm

          算法的實(shí)現(xiàn).pdf



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