一個FPGA中現(xiàn)在可集成多少32位RISC處理器?
Jan Gray是在FPGA中集成32位RISC處理器的專家,他寫了一篇博客叫作FPGA CPU 新聞,副標題為 “使用FPGA開發(fā)并行計算機體系架構(gòu)”。 Jan Gray的最新帖子為FPGAs, 當時和現(xiàn)在,這篇帖子將1995年在Xilinx XC4010PC84-5 FPGA中集成J32 32-bit RISC CPU與目前XilinxVirtex-7XC7VX690T FPGA 集成同一處理器進行了對比。Gray 使用的J32處理器采用經(jīng)典RISC架構(gòu),帶有3-operand操作指令,4=stage流水線(提取、寄存器讀、執(zhí)行、回寫),和32位操作數(shù)寄存器文件。
本文引用地址:http://www.ex-cimer.com/article/201710/365710.htm1995年,Gray使用的J32處理器基本消耗了XC4010 FPGA中800個4-input LUT。處理器排列看起來是這樣:
13年以后。同一J32處理器內(nèi)核集成在Virtex - 7 FPGA,它支持433,000以上的6輸入 LUT,是250個路由器核心與1000個處理器互連預(yù)留空間的1000倍。J32 RISC處理器的排列看起來像這樣:
“也就是說過去18年摩爾定律將每個FPGA集成1K LUT升級至每個FPGA集成1K 32-bit CPU。(順便說下,規(guī)模最大的Virtex Ultrascale 3D FPGA有440萬個邏輯單元,所以邏輯容量足夠10,000個以上Jan Gray所提到的 32位RISC J32 CPU進行互連。且看以下的注釋說明?。?/p>
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