解讀多間隔脈沖信號(hào)連接器電路

　　單片機(jī)應(yīng)用系統(tǒng)工作時(shí)，除了進(jìn)入系統(tǒng)正常的初始化之外，當(dāng)由于程序運(yùn)行出錯(cuò)或操作錯(cuò)誤使系統(tǒng)處于死鎖狀態(tài)時(shí)，為擺脫困境，也需按復(fù)位鍵以重新啟動(dòng)。所以系統(tǒng)的復(fù)位電路必須準(zhǔn)確、可靠地工作。單片機(jī)的復(fù)位都是靠外部電路實(shí)現(xiàn)的，在時(shí)鐘電路工作后，只要在單片機(jī)的RST引腳上出現(xiàn)24個(gè)時(shí)鐘振蕩脈沖（即2個(gè)機(jī)器周期）以上的高電平，單片機(jī)便實(shí)現(xiàn)初始化狀態(tài)復(fù)位。為了保證應(yīng)用系統(tǒng)可靠地復(fù)位，系統(tǒng)采用按鍵電平復(fù)位方式。

　　單片機(jī)AT89S52的P1口與液晶顯示模塊LCD1602的數(shù)據(jù)端口相連，P3.2控制液晶模塊的讀寫(xiě)；對(duì)比度調(diào)整端連接一個(gè)10 kΩ的可調(diào)電阻，用來(lái)調(diào)整液晶顯示亮度。另外，單片機(jī)的P2口與CPLD的8個(gè)I/O口相連，以進(jìn)行數(shù)據(jù)傳輸，其電路設(shè)計(jì)如圖2所示。

　　CPLD電路設(shè)計(jì)

　　晶振是為處理器提供頻率基準(zhǔn)的元器件，屬于系統(tǒng)不可或缺的一部分。通常分為有源晶振和無(wú)源晶振兩個(gè)大類，無(wú)源晶振要求芯片內(nèi)部有震蕩器，并且其信號(hào)電壓根據(jù)起振電路而定，允許不同的電壓，但無(wú)源晶振通常信號(hào)質(zhì)量和精度較差，需要精確的匹配外圍電路，如需更換晶振要同時(shí)更換外圍電路。有源晶振不需要芯片的內(nèi)部振蕩器，可以提供高精度的頻率基準(zhǔn)，信號(hào)質(zhì)量也較無(wú)源晶振要好。

　　EPM7128SLC84需要提供外部時(shí)鐘信號(hào)，由于CPLD對(duì)時(shí)鐘精度要求甚高，通過(guò)前面的分析可知有源晶振的通信質(zhì)量和精度較無(wú)源晶振高，所以采用1.000 MHz的有源晶體振蕩器，電路的輸出端口與處理器EPM7128SLC84的GCKL1連接，其具體電路設(shè)計(jì)如圖3所示。