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          屏幕保護系統設計

          作者:時間:2023-12-18來源:電子森林收藏
          • 任務:基于底板 完成設計并觀察調試結果
          • 要求:通過底板上的VGA接口驅動液晶顯示器在800×600@60Hz的模式下顯示,實現經典屏幕保護的界面效果,讓小腳丫Logo不斷反彈移動。
          • 解析:將小腳丫Logo取模得到128×128像素的圖片數據,通過FPGA編程驅動VGA液晶顯示器,實現現經典屏幕保護的界面效果。

          在圖片顯示系統實驗中我們學習過圖片取模的方法,根據取模數據創建ram模塊,本實驗我們要學習VGA接口液晶顯示器的驅動原理及方法,結合圖片ram數據,最終實現的總體設計。VGA接口顯示有固定的模式,本實驗800×600@60Hz模式需要40MHz的時鐘主頻,可以按照簡易電壓表實驗中的方法例化PLL的IP核實現。

          本文引用地址:http://www.ex-cimer.com/article/202312/453983.htm
          • 了解VGA接口時序及相關原理
          • 學習VGA接口驅動方法,完成VGA驅動設計
          • 完成設計實現

          根據前面的實驗解析我們可以得知,該設計總體可以拆分成如下功能模塊實現,

          • pll:pll IP核模塊例化,倍頻產生40MHz VGA主頻時鐘
          • VgaModule:VGA接口驅動模塊,屏保顯示控制 * steprom:圖片取模數據存儲器

          Top-Down層次設計

           

          模塊結構設計

          VGA接口介紹

          VGA(Video Graphics Array)是IBM在1987年隨PS/2機一起推出的一種視頻傳輸標準,具有分辨率高、顯示速率快、顏色豐富等優點,在彩色顯示器領域得到了廣泛的應用,VGA接口定義如下:

          VGA接口(左側為公口,右側為母口)

          VGA接口定義如下:

          VGA接口定義

          一個標準的VGA接口硬件連接應該有以下端口:

          • 紅綠藍三色信號(RGB)
          • 行場同步信號(HSVS)

          其中三色信號(RGB)都是模擬信號,行場同步信號(HSVS)都是數字信號。

          對于VGA的接口模擬電壓(RGB),為0~0.714V范圍峰峰值,0代表無色,0.714代表滿色,一些非標準的顯示器使用的是1Vpp的滿色電平。三基色信號源端和終端匹配電阻均為75歐姆,如下圖所示:

          VGA三基色匹配電阻示意

          FPGA為數字邏輯器件,想要得到0~0.714V范圍電壓主要有兩種方法,DAC轉換方式和電阻分壓方式,我們的擴展板卡上就是采用的電阻分壓的方式,因VGA顯示器端有75歐的下拉電阻,為了得到0.714V的電壓我們給RGB信號線上串入270歐姆的電阻,3.3V*75/(270+75)=0.717V。如下圖所示:

          VGA電阻分壓方式示意

          當FPGA驅動輸出高電平(3.3V)時,模擬分壓為0.714V,為滿色,當FPGA驅動輸出低電平(0V)時,模擬分壓為0V,為無色,這樣RGB三基色都對應兩種狀態輸出,共有2^3=8種顏色輸出。

          VGA 接口時序是對其實現驅動與控制的關鍵所在,也是難點所在。難不光難在時序的產生,更多的是在于處理速度上的問題。VGA掃描顯示其實就是兩條線,一個是行掃描,一個是場掃描,在行有效和場有效的時候把數據發送給VGA即可顯示了。顯示標準就是行分辨率x列分辨率@60hz即一秒屏幕刷新60次,以800×600@60Hz模式為例,即行為800個像素,場為600個像素。

          VGA 800×600@60Hz模式示意

          顯示器掃描一般采用逐行掃描的方式實現:逐行掃描是掃描從屏幕左上角一點開始,從左像右逐點掃描,每掃描完一行,電子束回到屏幕的左邊下一行的起始位置,在這期間,CRT對電子束進行消隱,行與行之間的返回過程稱為水平消隱,也稱行消隱(HBlank),每行結束時,用行同步信號進行同步;當掃描完所有的行,形成一幀,掃描點掃描完一幀后,要從圖像的右下角返回到圖像的左上角,開始新一幀的掃描,這一時間間隔,叫做垂直消隱,也稱場消隱(VBlank),用場同步信號進行場同步。

          VGA行場消隱示意

          VGA掃描時序圖

          VGA顯示常用模式列舉如下:

          VGA顯示模式

          VGA模塊硬件連接

          以下是底板上的VGA模塊電路,其電路圖如下:

          VGA模塊電路

          底板上的VGA顯示電路與1.8寸串行彩色液晶屏電路復用部分FPGA管腳,兩者不能同時使用,當使用VGA接口模塊電路時,FPGA直接驅動VGA接口完成VGA液晶顯示器控制即可。VGA硬件采用電阻分壓方式連接,每個基色智能顯示無色或滿色,所以顯示效果最多有2^3=8種顏色顯示(包含黑色)。

          VGA模塊驅動設計

          端口列表中三基色控制管腳定義為vga[2:0],高位到低位依次接紅綠藍,那么8中顏色對應的數據如下:

          output reg [2:0] vga;    // vga,MSB~LSB = {R,G,B}
          localparam  RED = 3'b100, GREEN = 3'b010, BLUE = 3'b001;
          localparam  YELLOW = 3'b110, CYAN = 3'b011, PURPLE = 3'b101;
          localparam  WHITE = 3'b111, BLACK = 3'b000;

          本實驗使用800×600@60Hz的VGA顯示模式,首先將該VGA顯示模式下的參數定義,在40MHz的主頻下,參數如下:

          水平方向


          同步脈沖 Thp后廊 Thb有效線數 Thd前廊 Thf
          1288880040

          垂直方向


          同步脈沖 Thp后廊 Thb有效線數 Thd前廊 Thf
          4236001

          將參數定義,更改VGA顯示模式時,只需要更改下面參數,參數定義如下:

          //-- Horizonal timing information
          `define HSYNC_A   16'd128   // 128
          `define HSYNC_B   16'd216   // 128 + 88
          `define HSYNC_C   16'd1016  // 128 + 88 + 800
          `define HSYNC_D   16'd1056  // 128 + 88 + 800 + 40
          //-- Vertical  timing information
          `define VSYNC_O   16'd4     // 4 
          `define VSYNC_P   16'd27    // 4 + 23
          `define VSYNC_Q   16'd627   // 4 + 23 + 600
          `define VSYNC_R   16'd628   // 4 + 23 + 600 + 1

          根據VGA掃描的時序,在40MHz主頻時鐘下,每一行需要1056個主頻時鐘周期的時間,而每一幀需要628行掃描時間,我們定義兩個計數器,分別對主頻時鐘和行掃描進行計數,程序實現如下:

          reg [15:0] x_cnt,y_cnt;
          always @ (posedge clk or negedge rst_n)  // Count for HSYNC
              if(!rst_n) x_cnt <= 16'd1;
              else if(x_cnt == `HSYNC_D) x_cnt <= 16'd1;else x_cnt <= x_cnt + 1'b1; 
              always @ (posedge clk or negedge rst_n) // Count for VSYNC
              if(!rst_n) y_cnt <= 16'd1;
              else if(x_cnt == `HSYNC_D) begin
                  if(y_cnt == `VSYNC_R) y_cnt <= 16'd1;
                  else y_cnt <= y_cnt + 1'b1;
              end else y_cnt <= y_cnt;

          當行計數器xcnt計數到1056且場計數器ycnt計數到628時,就是VGA掃描一幀的時間,行計數和場計數開始的時候為同步信號,行場同步信號端口輸出,根據時序要求程序實現如下:

          output  reg         sync_v;     // sync_v
          output  reg         sync_h;     // sync_h 
          always @ (posedge clk or negedge rst_n) // HSYNC signal
              if(!rst_n) sync_h <= 1'b1;
              else if(x_cnt <= `HSYNC_A) sync_h <= 1'b0;
              else sync_h <= 1'b1;  
              always @ (posedge clk or negedge rst_n) // VSYNC signal
              if(!rst_n) sync_v <= 1'b1;
              else if(y_cnt <= `VSYNC_O) sync_v <= 1'b0;
              else sync_v <= 1'b1;

          行同步和場同步的信號有了,接下來就是三基色數據的控制了,如果整個掃描過程中三基色端口一直輸出紅色數據,那么我們就可以看到整個顯示器顯示紅色,整個掃描過程分為消隱區和顯示區,只有在顯示區的數據才能顯示出來,落在消隱區的顏色數據沒有任何意義,顯示區就是當行場計數器都在對應有效線數的區間。即是說,如果我們讓三基色端口只在行計數器xcnt計數在216~1056之間且場計數器ycnt計數在27~627之間時輸出紅色數據,依然可以看到整個顯示器顯示紅色。

          圖片坐標軌跡區間

          屏幕保護實驗需要小腳丫Logo圖片顯示并反彈移動,圖片顯示在液晶顯示器上我們需要知道圖片所在顯示區的坐標,圖片寬度和高度已知,我們以圖片左上角的像素點作為基點,就可以知道圖片ram數據中每個數據對應的坐標,假設我們知道了圖片基點的坐標為(xset,yset)。圖片的顯示程序實現如下:

          注:這里講的坐標是是以行計數器xcnt和場計數器ycnt為基準的。

          `define P_WIDTH 8'd128  // 圖片像素的水平寬度
          `define P_DEPTH 8'd128  // 圖片像素的垂直高度
          always @ (posedge clk or negedge rst_n) // rom address
              if(!rst_n) rom_addr <= 1'b0;
              else if((x_cnt>=x_set)&(x_cnt<(x_set+`P_WIDTH))&(y_cnt>=y_set)&(y_cnt<(y_set+`P_DEPTH)))
                  rom_addr <= y_cnt - y_set;else rom_addr <= rom_addr; 
                  always @ (posedge clk or negedge rst_n) // rom data display
              if(!rst_n) vga <= BLACK;
              else if((x_cnt>=x_set)&(x_cnt<(x_set+`P_WIDTH))&(y_cnt>=y_set)&(y_cnt<(y_set+`P_DEPTH)))
                  if(rom_data[x_cnt - x_set]) vga <= color;
                  else vga <= BLACK;
              else vga <= BLACK;

          圖片可能顯示在屏幕的任何位置,那么基點(xset,yset)的移動軌跡范圍為上圖中紅色虛線框區域,只要控制基點移動和反彈就可以實現圖片的移動和反彈,這里需要考慮兩個參數:移動速度和反彈方向。

          移動速度

          移動速度就是基點(xset,yset)變化的速度,我們設置一個計數器延遲來控制基點的變化速度,cnt的計數周期為2^19 * 1000ms / 12000000 = 44ms,基點坐標每秒移動次數為1s / 44ms = 23次,計數程序實現如下:

          reg         [18:0]  cnt;
          always @ (posedge clk or negedge rst_n)  // delay count
              if(!rst_n) cnt <= 1'b0;
              else cnt <= cnt + 1'b1;

          反彈方向

          屏幕保護圖片碰到顯示器邊沿會反彈,反彈效果同鏡面反射一樣,與邊沿平行方向不變,垂直方向反向,所以行方向和場方向的反彈控制是相互獨立的,實現方法相同,這里我們以行(水平)方向的控制為例,程序實現如下:

          always @ (posedge clk or negedge rst_n) //水平方向反彈標志
              if(!rst_n) x_flag <= 1'b1;
              else if(x_set == `HSYNC_B) x_flag <= 1'b1; 
              else if(x_set == (`HSYNC_C - `P_WIDTH)) x_flag <= 1'b0;
              else x_flag <= x_flag; 
              always @ (posedge clk or negedge rst_n) //根據水平方向反彈標志移動基點
              if(!rst_n) x_set <= `HSYNC_B;
              else if(!cnt)  //控制基點行坐標x_set的變化速度
                  if(x_flag) x_set <= x_set + 1'b1; //根據水平方向反彈標志移動基點 
                  else x_set <= x_set - 1'b1;
              else x_set <= x_set;

          系統總體實現

          例化pll IP核得到40MHz時鐘信號,提供給VGA驅動模塊做時鐘信號,例化配置方法在簡易電壓表實驗中有講解,這里不再重復。

          屏幕保護圖片數據的ram模塊,提供小腳丫Logo圖片數據,圖片顯示系統實驗中也有相關內容,調整一下圖像分辨率的寬度和高度就可以直接使用。

          綜合后的設計框圖如下:

          RTL設計框圖

          1. 雙擊打開Quartus Prime工具軟件;
          2. 新建工程:File → New Project Wizard(工程命名,工程目錄選擇,設備型號選擇,EDA工具選擇);
          3. 新建文件:File → New → Verilog HDL File,鍵入設計代碼并保存;
          4. 設計綜合:雙擊Tasks窗口頁面下的Analysis & Synthesis對代碼進行綜合;
          5. 管腳約束:Assignments → Assignment Editor,根據項目需求分配管腳;
          6. 設計編譯:雙擊Tasks窗口頁面下的Compile Design對設計進行整體編譯并生成配置文件;
          7. 程序燒錄:點擊Tools → Programmer打開配置工具,Program進行下載;
          8. 觀察設計運行結果。

          將程序加載到FPGA中,使用VGA線連接液晶顯示器和FPGA底板,觀察顯示現象。小腳丫Logo圖片在顯示屏上移動,到達邊沿后反彈,每次反彈都會顏色改變,共有6中顏色。



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