FPGA三人表決器

相信大家對電視中的選秀節目并不陌生，我們常常能夠見到一種比賽規則：當三名評委中有兩名及以上同意選手晉級時，該選手才能晉級，那么如何去實現該項目呢？

其實這一切都離不開數字電路，首先我們可以繪制出三人表決器的真值表，然后用Verilog去實現它，真值表如下：

通過對此項目進行評估我們發現：
1.該項目需要三個輸入，我們可以通過撥碼開關進行實現；
2.需要顯示模塊來表示投票情況，這里我們選用數碼管進行實現；

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// >>>>>>>>>>>>>>>>>>>>>>>>> COPYRIGHT NOTICE <<<<<<<<<<<<<<<<<<<<<<<<<
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// File name    : debounce.v
// Module name  : debounce
// Author       : STEP
// Description  : 
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// Code Revision History : 
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// Version: |Mod. Date:   |Changes Made:
// V1.0     |2017/03/14   |Initial ver
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// Module Function:三人表決器 
module voter(a,b,c,num_led,result_led); 	
        input a;				//評委A
	input b;				//評委B
	input c;				//評委C
	output [2:0] num_led;	//投票數顯示；
	output result_led;		//投票結果顯示； 	
	assign num_led=~{a,b,c};	//用三個LED表示投票情況，另根據硬件電路，LED為0時亮，故取反
	assign result_led=~((!a&b&c)||(a&!b&c)||(a&b&!c)||(a&b&c))?1:0;		
	//此處請參閱真值表，另根據硬件電路，LED為0時亮，故取反 
	endmodule

撥碼開關1、2、3分別代表評委A、B、C，LED1~3代表投票狀態，例如，評委A投票，LED1亮，LED4代表是否通過。
下圖為無人投票時，

下圖為有一位評委投票時，

下圖為兩人進行投票時，可見投票通過指示燈已經亮起；

最后，三人同時投票