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          FPGA:數(shù)字示波器

          作者: 時間:2024-01-12 來源:EEPW編譯 收藏

          與模擬示波器相比,具有許多優(yōu)勢,例如能夠捕獲單個事件,并顯示觸發(fā)前發(fā)生的情況。

          本文引用地址:http://www.ex-cimer.com/article/202401/454715.htm

          您只需將ADC和連接在一起,即可構(gòu)建。
          這種特殊設(shè)計使用100MHz閃存ADC,因此我們正在構(gòu)建一個100MSPS(每秒兆采樣數(shù))示波器。

          這種示波器設(shè)計很有意思,因為它展示了現(xiàn)代 的強大和實用性。 但是,如果您不熟悉 技術(shù),請記住,這不是本網(wǎng)站上最容易理解的設(shè)計。

          HDL設(shè)計

          或者如何在FPGA內(nèi)部創(chuàng)建示波器邏輯。

          硬件

          • 此設(shè)計是使用 Flashy 板創(chuàng)建的。

          • 另請參閱有關(guān)如何構(gòu)建簡單示波器的“動手”頁面。

          軟件

          截屏

          這是27MHz信號的視圖,以100MHz采樣,并使用“采樣等效時間”技術(shù)重建。



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