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          基于USB的樁基靜載荷無(wú)線測(cè)控系統(tǒng)設(shè)計(jì)

          作者: 時(shí)間:2009-12-21 來(lái)源:網(wǎng)絡(luò) 收藏

          2 接收機(jī)設(shè)計(jì)
          接收機(jī)由Cypress公司的CY7C68013芯片擴(kuò)展而來(lái)。CY7C68013包括1個(gè)8051處理器,1個(gè)串行接口引擎(SIE),1個(gè)收發(fā)器,8.5 KB片上RAM,4 KBFIFO存儲(chǔ)器以及1個(gè)通用可編程接口(GPIF)。智能串行接口引擎(SIE)執(zhí)行所有基本的功能,并將嵌入式MCU解放出來(lái)以用于實(shí)現(xiàn)專用的功能,保證其持續(xù)的高性能的傳輸速率。
          2.1 硬件設(shè)計(jì)
          CY7C68013有三種可用的接口模式:端口、GPIF主控和從FIFO。本系統(tǒng)采用此GPIF主控模式,GPIF作為內(nèi)部的主控制器與FIFO直接相連,通過(guò)編程來(lái)決定控制信號(hào)的輸出狀態(tài)。對(duì)于接口數(shù)據(jù)的總8位,選擇FD[7:0]引腳,并設(shè)置WORDWIDE=0??刂戚敵鲆_CTLn被用作讀和寫選通信號(hào)。準(zhǔn)備好輸入引腳RDYn,通過(guò)GPIF采樣,并且能強(qiáng)制進(jìn)行等待,繼續(xù)或重復(fù)等操作,直至進(jìn)入特定的狀態(tài)。GPIF地址線隨著數(shù)據(jù)傳輸產(chǎn)生地址累加。芯片時(shí)鐘被配置為48 MHz的內(nèi)部時(shí)鐘,通過(guò)IFCLK引腳輸出,見(jiàn)圖2。

          本文引用地址:http://www.ex-cimer.com/article/202590.htm

          2.2 程序設(shè)計(jì)
          2.2.1 固件設(shè)計(jì)
          固件(Firmware)直接與硬件進(jìn)行通信,主要功能是負(fù)責(zé)接受和處理主機(jī)發(fā)給設(shè)備的各種請(qǐng)求,并向主機(jī)返回設(shè)備的狀態(tài)信息。Cypress公司為了簡(jiǎn)化固件代碼的開發(fā)過(guò)程,特別設(shè)計(jì)一個(gè)固件程序框架,框架如圖3所示。主要工作是完成初始化、標(biāo)準(zhǔn)設(shè)備請(qǐng)求的處理和USB掛起電源管理服務(wù)。使用框架來(lái)構(gòu)造固件程序,首先框架初始化內(nèi)部的狀態(tài)變量,調(diào)用用戶初始化函數(shù)TD_Init()。該函數(shù)返回后,初始化USB接口到未配置狀態(tài)并使能中斷。每隔1s進(jìn)行一次設(shè)備重枚舉,直到端點(diǎn)接受到一個(gè)SETUP包。函數(shù)TD_Init()在框架初始化期間被調(diào)用,在設(shè)備重枚舉和任務(wù)調(diào)度啟用之前調(diào)用該函數(shù),用來(lái)初始化用戶的全局變量。



          關(guān)鍵詞: USB 樁基 無(wú)線測(cè)控

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