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          時鐘抖動時域分析(中)

          作者: 時間:2013-09-10 來源:網(wǎng)絡(luò) 收藏
          動,可以計算出ADC的SNR,并與實際測量結(jié)果對比。使用ADC孔徑抖動可以通過測得SNR值計算出CDCE72010的采樣,如表4所列。乍一看,預(yù)計SNR值有些接近測得值。但是,將兩種ADC計算得出的采樣與90fs測得值對比時,出現(xiàn)另一幅不同的場景,其有相當(dāng)多的不匹配。

            不匹配的原因是,計算得出的孔徑抖動是基于時鐘源生成器的快速轉(zhuǎn)換速率。CDCE72010的LVCMOS輸出消除了時鐘信號的高階諧波,其有助于形成快速升降沿。圖13所示波形圖表明了帶通濾波器急劇降低未濾波LVCMOS輸出轉(zhuǎn)換速率,以及將方波轉(zhuǎn)換為正弦波的過程。

            

          時鐘抖動對采樣時鐘轉(zhuǎn)換速率的影響

            圖13 對采樣時鐘轉(zhuǎn)換速率的影響

            

          時鐘抖動時域分析(中)

            

          90-fs時鐘抖動的SNR結(jié)果

            表4 90-fs時鐘抖動的SNR結(jié)果

          改善轉(zhuǎn)換速率的一種方法是:在CDCE72010的LVCMOS輸出和帶通濾波器之間添加一個具有相當(dāng)量增益的低噪聲RF放大器,參見圖14。該放大器應(yīng)該放置于濾波器前面,這樣便可以將其對時鐘信號的噪聲影響程度限定在濾波器帶寬,而非ADC的時鐘輸入帶寬。由于下一個試驗的放大器具有21dB的增益,因此我們在帶通濾波器后面增加了一個可變衰減器,旨在匹配濾波后LVCMOS信號到時鐘生成器濾波后輸出的轉(zhuǎn)換速率。該衰減器可防止ADC的時鐘輸入超出最大額定值。

            

          帶通濾波器前面添加RF放大器來降低轉(zhuǎn)換速率

            圖14 帶通濾波器前面添加RF放大器來降低轉(zhuǎn)換速率

            通過在時鐘輸入通路中安裝低噪聲RF放大器,兩個數(shù)據(jù)轉(zhuǎn)換器重復(fù)進行了高輸入頻率的SNR測量,其結(jié)果如表5所示。我們可以看到,測得SNR和預(yù)計SNR匹配的非常好。使用下面的方程式 5,計算得到的時鐘抖動值在90-fs時鐘抖動的5fs以內(nèi),其結(jié)果通過相位噪聲測得推導(dǎo)得出。

            



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