CPLD在多功能諧波分析儀設(shè)計中的應(yīng)用

1采樣方法比較

對三相電壓、電流6路模擬量進(jìn)行數(shù)據(jù)采集時，一般有兩種方法：①同相電壓電流交替采樣法：在被測信號的一個周期內(nèi)，采樣256點(diǎn)，其中128個奇數(shù)點(diǎn)為電壓采樣點(diǎn)；128個偶數(shù)點(diǎn)為電流采樣點(diǎn)。采電壓和采電流的時差為δt=t/256(t為被測信號周期)。由δt引起的同相電壓電流的相位誤差為δui=360*f*n*δt(度)。式中f——被測信號頻率，n——諧波次數(shù)。由上式可知相位誤差隨時差δt、諧波次數(shù)n增大而增大，這是造成相位差存在并且不一致的根本原因。另外還有一個原因，當(dāng)電網(wǎng)頻率畸變時，由于采樣是定時采樣，不能跟隨頻率變化，也會造成測量誤差。②同相電壓電流整周期同步采樣法：同相電壓、電流采取的是同步采樣，分時傳輸?shù)姆椒?。這樣，就不存在時差問題，相位差也就不存在；對于電網(wǎng)頻率畸變的問題，常用的方法是鎖相環(huán)技術(shù)。它是通過對電網(wǎng)電壓信號取樣進(jìn)行帶通濾波，提取出電網(wǎng)基波信號，然后進(jìn)行整形處理，獲得與基波信號頻率一致的方波信號，將它進(jìn)行鎖相倍頻，獲得輸出頻率為f0=n*fi的方波信號，以此作為整周期同步采樣脈沖信號。由此，采樣間隔也就隨被測信號的頻率變化而相應(yīng)變化，但是，這又增加了硬件的開銷。在本設(shè)計中，采用的是整周期同步采樣方法：由cpld和單片機(jī)配合產(chǎn)生符合要求的整周期同步采樣脈沖信號。

2工作原理及硬件構(gòu)成

2.1系統(tǒng)的工作原理

首先讓被測信號經(jīng)過抗混疊低通濾波器電路進(jìn)行預(yù)處理，對其中1路信號通過測頻模塊進(jìn)行精確的頻率測量，把頻率參數(shù)傳輸?shù)絾纹瑱C(jī)，由其通過運(yùn)算確定分頻系數(shù)，然后，回送到cpld的總控制器中，總控制器由此產(chǎn)生采樣脈沖信號。在采樣過程中，對于同相電壓、電流信號采用的是同步保持，通過多路開關(guān)分時采樣。其中，3路采樣保持器的控制信號ca，cb，cc，多路開關(guān)的地址選通信號a1，a2，a3由cpld控制產(chǎn)生。把選通的1路信號送入ad開始轉(zhuǎn)換，并檢測轉(zhuǎn)換結(jié)束信號。當(dāng)一次ad轉(zhuǎn)換結(jié)束時，通過ram地址發(fā)生器產(chǎn)生的地址和讀寫控制時序，把a(bǔ)d轉(zhuǎn)換的結(jié)果直接送入雙口ram存儲。然后，進(jìn)行下一次采樣。當(dāng)a相信號采樣完成后，就順序采樣b相、c相信號。本設(shè)計中的mcs?51單片機(jī)主要負(fù)責(zé)運(yùn)算及人機(jī)接口的管理，這將大大提高整個系統(tǒng)的運(yùn)行效率，提高了運(yùn)算的精度，又兼顧了運(yùn)算的響應(yīng)速度。

2.2主要硬件的選擇

由于cpld是高速器件，所以在采樣頻率很高的時候，多路開關(guān)和ad轉(zhuǎn)換器就成為制約采樣頻率的主要因素。當(dāng)采樣頻率達(dá)到兆級的時候，ram的存儲速度又成為了另外一個制約因素。

在本設(shè)計中，要求分析的諧波次數(shù)達(dá)到50次，被測信號在45hz～55hz范圍內(nèi)，頻率自動跟隨。根據(jù)香農(nóng)定理知：采樣頻率應(yīng)該大于或者等于被測信號頻率的2倍。要求每個周期采樣128點(diǎn)，這樣總的采樣頻率為f=128*55*2=14.08khz，所以采樣周期為t=1/fs=71.02μs。采樣保持器選擇ad582，它是反饋型結(jié)構(gòu)，在精度要求不高(≤0.1％)而速度要求較高時，可選用ch=1000pf，捕捉時間tac≤6μs。多路開關(guān)選用max382，它開關(guān)速度快，在雙電源，連續(xù)供電工作方式下，典型開關(guān)時間在100ns左右。它的主要特點(diǎn)是：工作電壓低、通道電阻小(≤100ω)、具有數(shù)字輸入鎖存、ttl/cmos電平兼容、具有esd靜電保護(hù)功能等。adc轉(zhuǎn)換器選用max172，該芯片是5v電源供電的12位模數(shù)轉(zhuǎn)換芯片，cmos工藝制造，速度快，轉(zhuǎn)換時間為10μs，具有基準(zhǔn)源，外接時鐘，頻率要求為1.25mhz。

2.3cpld器件簡介

在本設(shè)計中選用的是ep1k100qc208-3，它是altera公司推出的acex1k系列下的一款fpga芯片。上電時需要重新對芯片進(jìn)行配置。片內(nèi)有100，000可用門，有4，992個邏輯單元，內(nèi)嵌12個eab。每個eab的容量為512byte，可以非常方便地構(gòu)造ram、rom、fifo或雙口ram等功能。本設(shè)計中6kb的雙口ram正是基于此構(gòu)建的。其有208個管腳，可用i/o管腳數(shù)為147個。

3cpld內(nèi)部電路實(shí)現(xiàn)

本設(shè)計的軟件是在max+plusii10.2下完成的，頂層文件是*.gdf圖形文件，低層用ahdl硬件描述語言來描述。

3.1測頻模塊

測頻模塊的主要作用是：①測量電網(wǎng)頻率；②確定分頻系數(shù)，產(chǎn)生跟隨頻率變化的同步脈沖。測頻原理：由于測量的頻率在50hz左右，采用脈寬測量方式，即首先對被測信號進(jìn)行2分頻，使信號的正負(fù)脈寬相等，然后利用正脈寬對50mhz的標(biāo)準(zhǔn)脈沖進(jìn)行計數(shù)。正脈寬上升沿來時，計數(shù)器開始對標(biāo)準(zhǔn)脈沖計數(shù)；下降沿來時，鎖存當(dāng)前的計數(shù)值con。通過以下關(guān)系確定頻率f、分頻系數(shù)n?！　?

分頻系數(shù)為：系統(tǒng)時鐘源頻率與分頻得到脈沖頻率(256*f)的比值的一半再減去1，即：

3.2s/h時序控制模塊

由于采用的是同相電壓、電流同步采樣技術(shù)，所以對s/h的控制時序要求嚴(yán)格。同步采集某相電壓電流1次的時間≤71.02μs。同相電壓、電流間要求是同時保持，分時采樣。由于adc582的捕捉時間約為6μs，所以s/h時序脈沖低電平應(yīng)至少為10μs，在此期間，采樣保持器處于跟蹤狀態(tài)；高電平為60μs，在高電平期間，采樣保持器處于保持狀態(tài)。前30μs對電壓信號進(jìn)行ad轉(zhuǎn)換并存儲；后30μs對電流信號進(jìn)行ad轉(zhuǎn)換并存儲。仿真波形如圖2。

3.3多路開關(guān)max382的地址產(chǎn)生及adc控制模塊

在ad582控制脈沖一個周期的高電平期間，要采集電壓、電流各1次，所以多路開關(guān)max382需要選通2次，ad芯片max172也需要啟動2次。第1次max382選通起始于ad582控制脈沖上升沿來臨以后的1μs時刻；第2次起始于中間31μs處，延時1μs。這是因?yàn)椴蓸颖３制鞯妮敵鲞€有一段波動，經(jīng)過一定時間tst才保持穩(wěn)定，為了量化的準(zhǔn)確，所以在保持指令發(fā)出后，延時1μs。ad啟動脈沖開始于ad582控制脈沖2μs、32μs處，也延時1μs。max172的控制端有：cs，hen，rd；轉(zhuǎn)換結(jié)束狀態(tài)線：busy。當(dāng)cs=0，rd=0，busy=0時，ad正在轉(zhuǎn)換；busy=1時，轉(zhuǎn)換結(jié)束；hen=1，讀轉(zhuǎn)換結(jié)果的高4位數(shù)據(jù)，hen=0時，讀轉(zhuǎn)換結(jié)果的低8位數(shù)據(jù)。該模塊要結(jié)合硬件來仿真。max172的控制時序圖如圖3。

3.4雙口ram地址發(fā)生器及讀寫控制模塊

acex1k100器件內(nèi)嵌eab單元，可構(gòu)成容量大約1kb的雙口ram，由于max1721位ad，而mcs-51的數(shù)據(jù)總線只1位，所以，需要1次采樣的數(shù)據(jù)分1個字節(jié)，分別存儲。因?yàn)殡妷?、電流分時交替轉(zhuǎn)換，所以，在地址發(fā)生器中要有一個確定的映射規(guī)則，調(diào)整其存儲地址，以使電壓、電流在雙口ram中分塊順序存儲。另外，在雙口ram中，當(dāng)對同一地址單元同時進(jìn)行讀寫時，要有一個仲裁機(jī)制，對其進(jìn)行控制；當(dāng)讀寫發(fā)生沖突時，我們約定：cpld寫雙口ram具有優(yōu)先權(quán)，只有當(dāng)寫操作結(jié)束后，mcs-51單片機(jī)才被允許讀該單元。該模塊的仿真波形見1。

3.5通信模塊

該模塊是在cpld內(nèi)部構(gòu)建一個串行發(fā)送電路端口，實(shí)現(xiàn)mcs-51單片機(jī)與cpld器件之間的通信功能。(1)在正常工作模式下，頻率、同步脈沖的分頻系數(shù)等重要數(shù)據(jù)需要通信。(2)在系統(tǒng)升級模式下，單片機(jī)發(fā)送控制數(shù)據(jù)給cpld實(shí)現(xiàn)升級。通信方式為串行單工通信，mcs-51單片機(jī)發(fā)送數(shù)據(jù)，cpld接受數(shù)據(jù)。通信波特率約定1bps，通信的幀結(jié)構(gòu)11位數(shù)據(jù)1位起始位(低電平)1位數(shù)據(jù)位，低位在前1位停止位(高電平)。幀與幀之間1位空閑位(高電平)以確保通信正確。
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4結(jié)論

在電力諧波分析儀的設(shè)計中，cpld的應(yīng)用使采樣的速率大大提高，由于采用頻率跟隨技術(shù)，可以滿足高精度的測量需要。另外，也減輕了mcs-51單片機(jī)的負(fù)擔(dān)，提高了系統(tǒng)的響應(yīng)速度，實(shí)時性更強(qiáng)。該設(shè)計還有另外一個優(yōu)點(diǎn)，系統(tǒng)升級方便，只要把a(bǔ)dc芯片換成max162，單片機(jī)的程序稍做修改即可。當(dāng)然也可以實(shí)現(xiàn)在線修改，實(shí)現(xiàn)遠(yuǎn)程控制等功能。