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          高集成度設(shè)計(jì)應(yīng)對(duì)無(wú)線通信設(shè)備需求

          作者: 時(shí)間:2011-04-15 來(lái)源:網(wǎng)絡(luò) 收藏
          通信推出的JAV5001 PA,是采用標(biāo)準(zhǔn)CMOS工藝實(shí)現(xiàn)的。JAV5001整合了基帶和收發(fā)器。在3×3mm封裝內(nèi),它集成了功率調(diào)節(jié)、PA偏置、輸入和輸出匹配以及功率控制電路。JAV5001采用單電源供電。在W-CDMA調(diào)制時(shí),其線性輸出功率可達(dá)28.0dBm。其增益范圍從5dB(低功率模式)到27dB(高功率模式)。達(dá)到2.5kV的人體模式(HBM) 防靜電(ESD)等級(jí)。其相鄰信道泄漏功率比(ACLR)的典型值是-40dBc(最大值是-38dBc),偏置是±5MHz。在大功率模式,JAV5001的功率附加效率(PAE)是40%;在中 功率模式,JAV5001的PAE是28%。在 2400到2484MHz,其最大噪聲是 -150dBm/Hz;在RX頻段,噪聲是-147dBm/Hz;偏置是190MHz。

            隨著數(shù)字電路能處理或支持的高頻功能越來(lái)越多,最大的障礙可能在于保持模擬性能。正如TowerJazz的市場(chǎng)營(yíng)銷及業(yè)務(wù)拓展總監(jiān)Ramesh Ramchandani指出的:“力促將數(shù)字和模擬功能真正集成于一個(gè)芯片內(nèi)的IC設(shè)計(jì)人員發(fā)現(xiàn),與單獨(dú)比,要想從數(shù)字/模擬集成芯片中獲得預(yù)期性能是越來(lái)越難了。許多工程師在發(fā)揮創(chuàng)造力以尋找能彌補(bǔ)模擬性能不理想的電路方案。但是,其中的一個(gè)缺點(diǎn)是這里面必須包含一個(gè)額外的電路,而且為得到同等性能,可能需要額外增加電容、電阻、電感等無(wú)源元件?!边@一歷時(shí)數(shù)十年的困境仍“毫不妥協(xié)”:集成非常有必要,但不能以犧牲絲毫性能為代價(jià)。


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