如何在FPGA內(nèi)實現(xiàn)最佳化車用MCU設(shè)計方案？

　　RISC CPU

　　在Altera設(shè)計概念中使用的CPU是軟RISC處理器。然而，與一般情況不同，該處理器并不是建構(gòu)在一個預(yù)先設(shè)定好、無法改變的芯片內(nèi)。相反地，它采用的作法是依據(jù)系統(tǒng)架構(gòu)師/設(shè)計工程師，借助可用工具定義的規(guī)格自動產(chǎn)生，并與整個電路所需的其余邏輯同時載入FPGA。因此對于特定應(yīng)用需求，可使用相關(guān)開發(fā)工具對處理器核心進(jìn)行參數(shù)化。更重要的是，它可根據(jù)所需功能以及實現(xiàn)這些所需功能所需的邏輯資源，無縫地實現(xiàn)設(shè)計。

　　在基于Altera的靈活MCU應(yīng)用中，Nios II嵌入式處理器采用一款帶32位元獨立位址和資料匯流排的標(biāo)準(zhǔn)RISC架構(gòu)。兩個匯流排都透過獨立快取記憶體執(zhí)行，且可獨立地連續(xù)饋送到匯流排系統(tǒng)。最后，系統(tǒng)架構(gòu)師決定對程式碼和資料采用個別記憶體或是兩者共用記憶體。任何處理器包含的功能單元都呈現(xiàn)在Nios II嵌入式處理器中，根據(jù)不同設(shè)定決定它們的特性。例如可選擇硬件乘法器、桶式移位器以及硬件除法器作為選項，同樣地，對指令和資料緩沖記憶體進(jìn)行精確的處理，其尺寸可不同或是徹底被排除在外。

　　匯流排架構(gòu)

　　傳統(tǒng)上在MCU內(nèi)一直是采用單匯流排，一個仲裁器用于監(jiān)控匯流排，以便使匯流排成為一種分散式資源。隨著作為系統(tǒng)中心資源的匯流排迅速成為一項瓶頸，這種安排導(dǎo)致了嚴(yán)重的損害。因此，在較新的系統(tǒng)，特別是在許多匯流排平行工作的系統(tǒng)級芯片(SoC)上，已開始采用多層匯流排架構(gòu)。目前FPGA的匯流排組織結(jié)構(gòu)也以相似的原則進(jìn)行，不同的是，在其他多層匯流排中所呈現(xiàn)的層數(shù)是固定的，但FPGA匯流排建構(gòu)能讓使用者依需求自由選擇層數(shù)。

　　當(dāng)考慮到電磁相容性(EMC)和功耗問題時，附加一個有別于整體系統(tǒng)執(zhí)行功率的周邊模組有時是合理的。舉例而言，以較高速度執(zhí)行一個記憶體界面，將可縮短存取時間，而系統(tǒng)內(nèi)其余元件便得以較低的時脈速率運作。另一種方案是可在相對較低時脈便已足夠的地方整合多個模組。

　　為滿足EMC或功耗要求，采用諸如SOPC Builder等高階系統(tǒng)設(shè)計工具可輕易地將這些部分與系統(tǒng)內(nèi)以很高頻率工作的部分分離。這些工具可自動產(chǎn)生同步這些不同時脈域所需的邏輯，而設(shè)計師只需指定在一個特定時脈域中執(zhí)行哪些模組。

　　在FPGA內(nèi)實現(xiàn)MCU

　　由于汽車MCU系統(tǒng)的復(fù)雜性比純繪圖控制器要高得多，所以FPGA大多用于原型邏輯產(chǎn)生。以FPGA產(chǎn)生原型能大幅降低開發(fā)風(fēng)險，因為它能提供全面驗證、韌體開發(fā)以及現(xiàn)場測試的功能。除此之外，藉由使用FPGA產(chǎn)生原型，設(shè)計師能以‘在系統(tǒng)內(nèi)’的方式執(zhí)行元件，并以真實情境的方式運作，以識別出一些模擬時沒被偵測出的潛在設(shè)計缺失。

　　軟件發(fā)展在整個開發(fā)周期中占了絕大部份。隨著軟件發(fā)展要花更長時間及更多資源，原型系統(tǒng)可縮短整個開發(fā)周期、發(fā)現(xiàn)設(shè)計缺失、解決相容性問題、緩解對新硬件功能的需求，以支援無法用軟件有效處理或?qū)崿F(xiàn)的功能。

　　用真實系統(tǒng)進(jìn)行現(xiàn)場測試有助于察覺無法在實驗室發(fā)現(xiàn)的系統(tǒng)或元件缺陷。在許多情況，銷售人員為了說服客戶提前下單，擁有一個展示系統(tǒng)是不可或缺的。

　　而一些在最初規(guī)格中沒有的特性和功能也許也將成為必須。無論是因為之前沒發(fā)現(xiàn)的缺陷還是必須需增加新功能，F(xiàn)PGA產(chǎn)生的原型都可以快速地被修改，無須一再花費巨額工程成本或忍受漫長制造周期。

　　靈活MCU概念中的最后步驟是ASIC開發(fā)。一旦建構(gòu)并測試完原型系統(tǒng)，則可著手將設(shè)計轉(zhuǎn)換為結(jié)構(gòu)化ASIC。例如，若采用Altera元件，設(shè)計立即被轉(zhuǎn)換為HardCopy結(jié)構(gòu)化ASIC元件。與其它結(jié)構(gòu)化ASIC不同，若采用該設(shè)計流程，則無須重新進(jìn)行設(shè)計合成或花費額外的驗證周期，因這些元件采用的是與其FPGA互補的構(gòu)件。

　　采用該結(jié)構(gòu)化ASIC流程提供的快速轉(zhuǎn)換速度能讓設(shè)計師快速簽核FPGA邏輯，因而實現(xiàn)快速、低成本的轉(zhuǎn)換。

　　本文小結(jié)

　　下一代汽車電子系統(tǒng)需要高度專用、成本最佳化的元件以滿足市場需求?？紤]到先進(jìn)制程技術(shù)開發(fā)成本的急劇成長，對傳統(tǒng)MCU針對特殊應(yīng)用而設(shè)計的作法在商業(yè)考量上已不再適用。

　　針對廣泛應(yīng)用市場所設(shè)計的功能豐富型元件也因為過于昂貴而漸被市場淘汰。取而代之的則是靈活的MCU概念，只要將它安置在FPGA中來產(chǎn)生原型，就能提供為特定應(yīng)用開發(fā)恰到好處MCU的程序。設(shè)計完成后，甚至在設(shè)計過程中可立即進(jìn)行驗證、軟件發(fā)展和現(xiàn)場測試。

　　為進(jìn)行量產(chǎn)，F(xiàn)PGA設(shè)計被直接映射為一個結(jié)構(gòu)化ASIC而無須重新合成或額外驗證。不只是軟件發(fā)展，該方法實現(xiàn)了將硬件定義掌控在汽車電子系統(tǒng)設(shè)計師手中。創(chuàng)造了一種與當(dāng)今任何固定功能MCU相比，均可花費更少時間以及更低成本的應(yīng)用最佳化車用MCU。