Vivado IP集成器設(shè)計演示

Vivado IP集成器

Vivado起航

大家好，歡迎Vivado的一個快速演示，它是Xilinx新的設(shè)計套件，應(yīng)用到7系列和以上的系列器件。

以下是中文釋義：

開始

當(dāng)你打開Vivado IDE集成設(shè)計環(huán)境的時候，你首先看到的是開始頁，在右邊是文檔，方法指導(dǎo)手冊和指引。
左邊是向?qū)?，他指?dǎo)你創(chuàng)建新的工程，包括如何從ISE 和Planahead工具遷移到Vivado。

快速集成設(shè)計環(huán)境概要

創(chuàng)建一個新的工程后，Vivado IDE集成設(shè)計環(huán)境包含工程總結(jié)標(biāo)簽就打開了，這個標(biāo)簽給你有關(guān)你的工程信息，比如現(xiàn)在的狀態(tài)，編譯流程，設(shè)置，錯誤和警告信息。

這個頂層菜單和工具條給你訪問到通用的功能。

你工程的設(shè)計源被列在源視圖里。

左邊的這個部分叫做流程導(dǎo)航器。這是你控制和分析Vivado能力的地方，在后面的演示里，我們會一步一步來討論。在Vivado集成設(shè)計環(huán)境里，你能管理源文件，實現(xiàn)流程和所有的設(shè)計分析。

在Vivado里，有一個新的功能是IP裝配，也叫做IP集成。這個演示的剩下部分會顯示如何快速和容易地使用IP集成來創(chuàng)建一個復(fù)雜的子系統(tǒng)。

創(chuàng)造IP集成器設(shè)計演示

IP 集成器是一個圖形化設(shè)計工具，它在復(fù)雜的IP block（模塊）之間做接口級的連接。然而，因為IP集成器緊緊地連接到了Vivado IDE，設(shè)計者能在圖形化環(huán)境和Tcl互動之間切換。

我們開始運(yùn)行一個簡單的MicroBlaze軟處理器系統(tǒng)腳本。

當(dāng)這個腳本在運(yùn)行的時候，你能看見獨(dú)立的IP 模塊放置在模塊框圖里，還有在這些模塊之間的接口級網(wǎng)線連接。

我要加一些模塊到這個設(shè)計里，開始，打開這個MicoBlaze配置對話框，同時使能調(diào)試接口和AXI4數(shù)據(jù)接口。 通過右擊這個圖，IP就能被加到這個設(shè)計里，你也能使用查找對話框快速地來找到這些接口。這個IP可以來自第三方，也可以是你自己的。一個調(diào)試模塊被加上了，也連接到了處理器。注意開始很深的綠色線標(biāo)記表明可能的連接，很深的藍(lán)色線表示這是個接口級的連接。這個連接由多個相關(guān)的信號組成。在IP打包進(jìn)程中，這是通過IP-XACT自動地創(chuàng)建。

現(xiàn)在，一個AXI GPIO外設(shè)會被連接到處理器，來自這個GPIO的輸出信號會作為外部的信號。

為了演示接口級連接的強(qiáng)大功能，我會在MicroBlaze處理器展開這個AXI接口。所有要求的AXI4信號需要用單一連接連接到GPIO的外設(shè)。當(dāng)這些接口級的連接創(chuàng)建時，互聯(lián)的DRC（設(shè)計規(guī)則檢查）也被實時地運(yùn)行。

IP集成器支持任意的層次級。組成存儲系統(tǒng)的5個IP模塊現(xiàn)在會移動成自己的層次。這個白色盒子顯示了你的層次。IP整合器支持任意的設(shè)計層次級。

IP集成器在互聯(lián)的IP模塊之間支持全部的參數(shù)傳播，確保結(jié)構(gòu)化設(shè)計的正確性。一旦一個設(shè)計完成，Verilog或VHDL從這個框圖中就被產(chǎn)生。這整個IP框圖，或者任意的層次級能被快速地封裝并添加到Vivado的IP 目錄中。使系統(tǒng)級的IP模塊可以被重用。