SoC處理單元性能評估及功能劃分

　　有多個處理單元的SoC器件目前是產(chǎn)品設計鏈上的重要一環(huán)。本文綜合各種因素評估了不同處理單元的優(yōu)缺點，并通過衛(wèi)星無線電接收器的設計實例幫助開發(fā)人員理解SoC所涉及處理任務之間的復雜平衡并有效掌握系統(tǒng)功能的劃分。

　　在準備開發(fā)目前越來越復雜的便攜式系統(tǒng)時，設計人員面對的最大挑戰(zhàn)之一就是采用什么樣的處理器組合來實現(xiàn)最優(yōu)化的“3P”指標，即系統(tǒng)性能最高、價格最低及功耗最小。系統(tǒng)級芯片(SoC)集成使得今日的創(chuàng)新成為可能，但它常常涉及把不同的處理器單元結(jié)合在單一的器件之上。這些單元可以包括可編程功能，如通用微處理器(通常是RISC)、DSP、FPGA和加速器，而且還可能有固定功能的加速器。由于這些單元都可以專用器件形式獲得，因此對設計人員來說，在它們之中進行全面的性能評估，進而決定以最有效的方式組合使用它們，有可能是一項相當困難的工作。

　　處理單元的優(yōu)缺點分析

　　在實現(xiàn)多內(nèi)核處理器之前，在RISC和DSP之間進行挑選曾相對較為簡單。如果大量的系統(tǒng)處理工作和數(shù)據(jù)有關，那么采用RISC，即使信號處理會受些損失。如果大量的處理工作和信號有關，那么采用DSP，并力爭獲得差強人意的控制和

　　各種處理單元的基本優(yōu)點和缺點概括在表1之中。通用RISC處理器專為數(shù)據(jù)處理而優(yōu)化，很容易使用而且很靈活，其成本、功耗和性能都可接受。DSP為實時信號而優(yōu)化，它們處理實時信號所需的功耗和成本通常比RISC低，不過，它們常常更難使用。

　　可編程加速器或半可編程處理器可設計用來數(shù)據(jù)或信號處理。一個例子就是用于通信系統(tǒng)的Viterbi處理器，對Viterbi編碼或解碼來說它是完全可編程的，但對任何其它功能來說毫無用處。就其功能而言，一個可編程加速器的成本、功耗總是比RISC或DSP要低，而性能要高，但從本質(zhì)上講，它稍欠靈活、更難使用，而且對缺陷(bug)的容忍度低，不容易更改。

表1處理器單元優(yōu)缺點對比

　　用于數(shù)據(jù)或信號處理的固定功能加速器(一般為ASIC)只能完成一種特定的功能。固定功能加速器總是一種成本最低、功耗最低、性能最高的解決方案，但它們?nèi)鄙偃魏纬潭鹊撵`活性。一旦ASIC設計出來并調(diào)試通過，到了系統(tǒng)開發(fā)人員手里，它會變得非常易用。但是其設計和調(diào)試與可編程器件相比非常困難，而且以后不可能進行再編程。

　　劃分系統(tǒng)處理功能

　　盡管在各種處理單元之中做決定是一件復雜的工作，但有一個可行的選擇程序，就是把各種系統(tǒng)功能劃分到各種處理單元之中。把一個系統(tǒng)的處理需求映射到一個現(xiàn)有的多內(nèi)核SoC之中，與通過映射處理需求創(chuàng)建一個新多內(nèi)核SoC有所不同。然而，其過程是類似的。

　　為了把該系統(tǒng)映射到一個現(xiàn)有的SoC之中，系統(tǒng)設計人員必須確定該系統(tǒng)方案以及它所針對市場的幾個細節(jié)。在這當中包括產(chǎn)品特性和算法組件，以及添加特性和解決bug的策略，不管是在設計期間還是在整個產(chǎn)品壽命期內(nèi)。一旦這些細節(jié)確定，系統(tǒng)功能必須確定成信號或數(shù)據(jù)處理任務，隨后再分成三個性質(zhì)不同的類。

　　明確并將保持不變的功能：這些功能包括離散余弦變換(DCT)或快速傅立葉變換(FFT)，它們將不會再有任何變化，而且已問世足夠長的時間，因此所有bug都已消除。這些功能使用固定功能加速器或最優(yōu)化。