ADC081S051與51的接口電路及驅(qū)動(dòng)程序設(shè)計(jì)
引言
本文引用地址:http://www.ex-cimer.com/article/236796.htm自然界存在的信號(hào)通常為模擬信號(hào),在測(cè)控系統(tǒng)中通常將采集到的模擬信號(hào)數(shù)字化,然后交給微處理器或微控制器進(jìn)行處理。因此模數(shù)轉(zhuǎn)換器成為測(cè)控系統(tǒng)中不可缺少的部分。ADC081S051 模數(shù)轉(zhuǎn)換器是國家半導(dǎo)體公司生產(chǎn)的低功率單通道CMOS 8位A/D轉(zhuǎn)換器,它采用串行外設(shè)接口方式進(jìn)行數(shù)據(jù)輸出。與傳統(tǒng)的器件不同的是,傳統(tǒng)器件的采樣速率是固定的,而ADC081S051 的采樣速率可以在200~500 KSPS 范圍內(nèi)可變。
ADC081S051 的數(shù)據(jù)輸出是串行數(shù)據(jù)輸出,它與SPI、QSPI 等一些標(biāo)準(zhǔn)相兼容。它的工作電壓范圍在2.7~5.25 V,因此可以采用3 V或者5 V電源供電。它可以應(yīng)用于便攜式系統(tǒng)、遠(yuǎn)程數(shù)據(jù)采集、儀器與控制系統(tǒng)等領(lǐng)域。具有體積小、轉(zhuǎn)換速度快、使用簡單等優(yōu)點(diǎn)。
1 ADC081S051 引腳及功能
ADC081S051 是8 位的逐次逼近模數(shù)轉(zhuǎn)換器,其封裝形式采用6?lead LLP封裝,管腳圖如圖1所示。引腳的功能簡要分類說明如下。
VA:正電源引腳,一般接+5 V或者+3 V.
GND:正電源地和信號(hào)地VIN:模擬信號(hào)輸入引腳,信號(hào)變化范圍在0~VA之間。
SCLK:數(shù)字時(shí)鐘信號(hào)輸入,該信號(hào)直接控制轉(zhuǎn)換和輸出過程。
SDATA:數(shù)字信號(hào)輸出,輸出采樣在SCLK 引腳下降沿被鎖定。
C-S-:芯片選擇,在下降沿開始一個(gè)轉(zhuǎn)換過程。
2 ADC081S051 的使用方法
2.1 采樣放大電路的設(shè)計(jì)
傳感器輸出的模擬信號(hào)一般都比較微弱,須經(jīng)過放大器對(duì)信號(hào)進(jìn)行放大,然后在送到A/D轉(zhuǎn)換器進(jìn)行模數(shù)轉(zhuǎn)換,最后交由處理器進(jìn)行處理。
圖2是一個(gè)實(shí)用的采樣放大電路,它由兩級(jí)放大電路組成,第一級(jí)放大電路采用AD620AN放大器,第二級(jí)采用OP07 放大器。傳感器的輸出信號(hào)接到AD620AN放大器的第2、3 管腳,采用差動(dòng)輸入,AD620AN具有極高的輸入阻抗,對(duì)電壓失調(diào)、溫度漂移和共模信號(hào)有著極好的抑制作用,AD620AN的放大倍數(shù)由電阻R1 決定。經(jīng)過AD620AN放大后的信號(hào),經(jīng)過兩個(gè)RC一階低通濾波器,送到第二級(jí)放大電路OP07的同相輸入端進(jìn)行放大。
第二級(jí)放大電路具有調(diào)零和放大功能。放大后的信號(hào)又經(jīng)過一個(gè)RC一階低通濾波器,輸入到ADC081S051模擬信號(hào)輸入引腳VIN,進(jìn)行模數(shù)轉(zhuǎn)換。
2.2 轉(zhuǎn)換過程
ADC081S051的串行接口時(shí)序圖如圖3所示。上電后,片選C-S 必須從高電平轉(zhuǎn)換到低電平,才能開始一個(gè)工作過程。當(dāng)C-S 由高變低時(shí),它初始化一個(gè)轉(zhuǎn)換過程和數(shù)據(jù)傳輸。在C-S 的下降沿,SDATA 管腳脫離高阻態(tài),轉(zhuǎn)換器從采樣模式轉(zhuǎn)換到保持模式,采樣數(shù)據(jù)隨著SCLK時(shí)鐘脈沖的加入,在時(shí)鐘脈沖的下降沿從SDATA管腳一位一位串行輸出。在SCLK 的第13個(gè)脈沖的上升沿,轉(zhuǎn)換器從保持模式轉(zhuǎn)換到采樣模式。SCLK的第16個(gè)下降沿之后或者在C-S 的上升沿,SDATA管腳重新回到高阻態(tài)。在一個(gè)轉(zhuǎn)換過程完成之后在C-S 重新變成低電平開始另一個(gè)轉(zhuǎn)換過程之前必須滿足一定的空閑時(shí)間,才能保證下一次轉(zhuǎn)換工作正常。要想從ADC081S051 讀出一個(gè)完整的采樣數(shù)據(jù),在C-S 下降沿和上升沿之間,必須加入16個(gè)SCLK 時(shí)鐘脈沖,否則讀出的數(shù)據(jù)是無效數(shù)據(jù)。從SDATA管腳輸出的數(shù)據(jù)格式是,3個(gè)先導(dǎo)0位,接著是8位數(shù)據(jù)位,在8位數(shù)據(jù)位之后接著是4個(gè)尾部0位。
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評(píng)論