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	 > 電源與新能源 > 設計應用 > 使用八進制CMOS緩沖器的二象限乘法DAC
          
    
          

          

          


	
	
	

          
	
          
		
          
			
          使用八進制CMOS緩沖器的二象限乘法DAC
          
						
          
				作者：
				時間：2014-04-14
				來源：網(wǎng)絡

				
				
				
				
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          本設計實例使用一個八進制CMOS緩沖器的大工作電壓范圍，呈現(xiàn)一個由緩沖器/線驅動器IC74HC244組成的簡單的八位二象限乘法數(shù)字模擬轉換器（DAC）。

          如圖1所示，一個八位數(shù)字字通過電阻器R1~R8寫入CMOS緩沖器U1的八個輸入中。U1的各個輸出通過由電阻器R9~R23組成的1：2：4：8……128加權電阻網(wǎng)絡產(chǎn)生。DAC參考電壓Vref饋送給U1VCC，因此，U1的輸出電壓跟蹤Vref的變化。電阻器R1~R8必須要使U1的輸出電壓免受數(shù)字輸入的電壓水平的影響。


          圖1 1個八位數(shù)字通過電阻器寫入CMOS緩沖器中

          在U2的引腳3處形成一個八位電壓-輸出單極DAC，其中Vref等于VCC.C1會視情況低通過濾該輸出，而該輸出在進行緩沖處理后，乘以因數(shù)2進行放大，然后由Vref抵消，進而在運算放大器LF357的引腳6處提供一個雙極DAC輸出。


          圖2 16采樣/周期DAC輸出，2V-7V參考電壓3750Hz合成正弦波

          圖2給出的是16采樣/周期DAC輸出，2V~7V參考電壓3750Hz合成正弦波。該DAC測量穩(wěn)定時間為200ns，其中C1取值為200pF.
          本文引用地址：http://www.ex-cimer.com/article/258370.htm            
				
            
                
			
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