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          DSP與單片機(jī)通信的多種方案設(shè)計(jì)

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          作者:劉政 葉漢民 時(shí)間:2007-03-02 來(lái)源:?jiǎn)纹瑱C(jī)及嵌入式系統(tǒng)應(yīng)用 收藏
          構(gòu)成雙CPU處理器平臺(tái),可以充分利用對(duì)大容量數(shù)據(jù)和復(fù)雜算法的處理能力,以及接口的控制能力。而之間快速正確的通信是構(gòu)建雙CPU處理器的關(guān)鍵問題。下面就此問題分別設(shè)計(jì)串行SCI、SPI和并行HPI三種連接方式。

          1 串行通信設(shè)計(jì)與實(shí)現(xiàn)

          1 1 SCI串行通信設(shè)計(jì)

          1.1.1 多通道緩沖串行口McBSP原理

          TMS320VC5402(簡(jiǎn)稱VC5402)提供了2個(gè)支持高速、全雙工、帶緩沖、多種數(shù)據(jù)格式等優(yōu)點(diǎn)的多通道緩沖串行口McBSP。MCESP分為數(shù)據(jù)通路和控制通路。①數(shù)據(jù)通路負(fù)責(zé)完成數(shù)據(jù)的收發(fā)。CPU或DMAC能夠向數(shù)據(jù)發(fā)送寄存器DXR寫入數(shù)據(jù),DXR中的數(shù)據(jù)通過發(fā)送移位寄存器XSR輸出到DX引腳。DR引腳接收數(shù)據(jù)到接收移位寄存器RSR,再?gòu)?fù)制到接收緩沖寄存器RBR,最后復(fù)制到數(shù)據(jù)接收寄存器DRR。這兩種數(shù)據(jù)多級(jí)緩沖  方式使得數(shù)據(jù)搬移和片外數(shù)據(jù)通信能夠同時(shí)進(jìn)行。②控制通路負(fù)責(zé)內(nèi)部時(shí)鐘產(chǎn)生,幀同步信號(hào)產(chǎn)生,信號(hào)控制和多通道選擇。另外.還具有向CPU發(fā)送中斷信號(hào)和向DMAC發(fā)送同步事件的功能。MCBSP時(shí)鐘

          和幀同步信號(hào)通過CLKR、CLKX、FXR、FSX引腳進(jìn)行控制,接收器和發(fā)送器可以相互獨(dú)立地選擇外部時(shí)鐘和幀同步信號(hào),也可以選擇由內(nèi)部采樣率發(fā)生器產(chǎn)生時(shí)鐘和幀同步信號(hào)。幀同步脈沖有效表示傳輸?shù)拈_始。

          1.1.2 SCI串行接口設(shè)計(jì)

          設(shè)置VC5402的McRSP輸出時(shí)鐘和幀同步信號(hào)由內(nèi)部采樣率發(fā)生器產(chǎn)生,內(nèi)部數(shù)據(jù)時(shí)鐘CLKG和幀同步信號(hào)FSG驅(qū)動(dòng)發(fā)送時(shí)鐘CLKX和幀同步FSX(CLKXM=l,F(xiàn)SXM=l,F(xiàn)SGM=1),輸入時(shí)鐘也由內(nèi)部采樣率發(fā)生器產(chǎn)生,內(nèi)部數(shù)據(jù)時(shí)鐘CLKG驅(qū)動(dòng)接收時(shí)鐘CLKR(CLKRM=1),同時(shí)由CPU時(shí)鐘驅(qū)動(dòng)采樣率發(fā)生器(CLKSM=1)。考慮到AT89C51(簡(jiǎn)稱C51)串口發(fā)送數(shù)據(jù)幀中第l位為起始位,因此可以利用該位驅(qū)動(dòng)輸入幀同步信號(hào)FSR,同時(shí)要置忽略幀同步信號(hào)標(biāo)志為1。其中FSG幀同步脈沖寬度=(FWID+1)



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