DSP與單片機通信的多種方案設計

1 1 SCI串行通信設計

1.1.1 多通道緩沖串行口McBSP原理

TMS320VC5402(簡稱VC5402)提供了2個支持高速、全雙工、帶緩沖、多種數(shù)據(jù)格式等優(yōu)點的多通道緩沖串行口McBSP。MCESP分為數(shù)據(jù)通路和控制通路。①數(shù)據(jù)通路負責完成數(shù)據(jù)的收發(fā)。CPU或DMAC能夠向數(shù)據(jù)發(fā)送寄存器DXR寫入數(shù)據(jù)，DXR中的數(shù)據(jù)通過發(fā)送移位寄存器XSR輸出到DX引腳。DR引腳接收數(shù)據(jù)到接收移位寄存器RSR，再復制到接收緩沖寄存器RBR，最后復制到數(shù)據(jù)接收寄存器DRR。這兩種數(shù)據(jù)多級緩沖  方式使得數(shù)據(jù)搬移和片外數(shù)據(jù)通信能夠同時進行。②控制通路負責內(nèi)部時鐘產(chǎn)生，幀同步信號產(chǎn)生，信號控制和多通道選擇。另外．還具有向CPU發(fā)送中斷信號和向DMAC發(fā)送同步事件的功能。MCBSP時鐘

1.1.2 SCI串行接口設計

設置VC5402的McRSP輸出時鐘和幀同步信號由內(nèi)部采樣率發(fā)生器產(chǎn)生，內(nèi)部數(shù)據(jù)時鐘CLKG和幀同步信號FSG驅動發(fā)送時鐘CLKX和幀同步FSX(CLKXM=l，F(xiàn)SXM=l，F(xiàn)SGM=1)，輸入時鐘也由內(nèi)部采樣率發(fā)生器產(chǎn)生，內(nèi)部數(shù)據(jù)時鐘CLKG驅動接收時鐘CLKR(CLKRM=1)，同時由CPU時鐘驅動采樣率發(fā)生器(CLKSM=1)?？紤]到AT89C51(簡稱C51)串口發(fā)送數(shù)據(jù)幀中第l位為起始位，因此可以利用該位驅動輸入幀同步信號FSR，同時要置忽略幀同步信號標志為1。其中FSG幀同步脈沖寬度=(FWID+1)