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          淺談四層板和33歐電阻

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          作者: 時(shí)間:2007-10-26 來(lái)源:嵌入式在線論壇 收藏

           

          選用不僅是電源和地的問(wèn)題,高速數(shù)字電路對(duì)走線的阻抗有要求,二層板不好控制阻抗。33歐一般加在驅(qū)動(dòng)器端,也是起阻抗匹配作用的;布線時(shí)要先布數(shù)據(jù)地址線,和需要保證的高速線。

           
          在高頻的時(shí)候,PCB板上的走線都要看成傳輸線。傳輸線有其特征阻抗,學(xué)過(guò)傳輸線理論的都知道,當(dāng)傳輸線上某處出現(xiàn)阻抗突變(不匹配)時(shí),信號(hào)通過(guò)就會(huì)發(fā)生反射,反射對(duì)原信號(hào)造成干擾,嚴(yán)重時(shí)就會(huì)影響電路的正常工作。采用時(shí),通常外層走信號(hào)線,中間兩層分別為電源和地平面,這樣一方面隔離了兩個(gè)信號(hào)層,更重要的是外層的走線與它們所靠近的平面形成稱為“微帶”(microstrip) 的傳輸線,它的阻抗比較固定,而且可以計(jì)算。對(duì)于兩層板就比較難以做到這樣。這種傳輸線阻抗主要于走線的寬度、到參考平面的距離、敷銅的厚度以及介電材料的特性有關(guān),有許多現(xiàn)成的公式和程序可供計(jì)算。

           
          33歐通常串連放在驅(qū)動(dòng)的一端(其實(shí)不一定33歐,從幾歐到五、六十歐都有,視電路具體情況) ,其作用是與發(fā)送器的輸出阻抗串連后與走線的阻抗匹配,使反射回來(lái)(假設(shè)解收端阻抗沒有匹配) 的信號(hào)不會(huì)再次反射回去(吸收掉),這樣接收端的信號(hào)就不會(huì)受到影響。接收端也可以作匹配,例如采用并聯(lián),但在數(shù)字系統(tǒng)比較少用,因?yàn)楸容^麻煩,而且很多時(shí)候是一發(fā)多收,如地址總線,不如源端匹配易做。


          這里所說(shuō)的高頻,不一定是時(shí)鐘頻率很高的電路,是不是高頻不止看頻率,更重要是看信號(hào)的上升下降時(shí)間。通常可以用上升(或下降) 時(shí)間估計(jì)電路的頻率,一般取上升時(shí)間倒數(shù)的一半,比如如果上升時(shí)間是1ns,那么它的倒數(shù)是1000MHz,也就是說(shuō)在設(shè)計(jì)電路是要按500MHz的頻帶來(lái)考慮。有時(shí)候要故意減慢邊緣時(shí)間,許多高速IC其驅(qū)動(dòng)器的輸出斜率是可調(diào)的

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