基于MDA的嵌入式軟件開發(fā)平臺設計

　　1 引言

　　短波通信是通過電離層反射來實現(xiàn)遠程信息傳輸，因而其通信受地形限制小；其次通信成本低，靈活性強。但它也存在一些缺點，如：信息傳輸?shù)目煽啃圆睿嬖谏钏ヂ浜投鄰綍r延失真等。在一般在短波信道中傳輸數(shù)據(jù)，信息的誤碼率通常在10-2-10-3的數(shù)量級，這些嚴重的衰落以及多徑效應造成的碼間串擾，限制了通信質量的進一步提高。近年來，由于在短波數(shù)據(jù)通信系統(tǒng)中，采用了各種有效的抗衰落和抗多徑的措施，使系統(tǒng)的誤碼率差不多提高了兩個數(shù)量級。其中，時頻組合調(diào)制技術（即FTSK）是目前廣泛采用的抗衰落和抗多徑技術之一。針對這種情況，本文提出采用DSP（數(shù)字信號處理器）實現(xiàn)4FTSK調(diào)制，并取得較好的效果。

　　2 4FTSK調(diào)制方式

　　在一個或一組二進制符號的持續(xù)時間內(nèi)，用若干個調(diào)制頻率的組合來傳送原二進制數(shù)據(jù)流，每一個調(diào)制頻率在不同的時隙內(nèi)有不同的頻率，這種由不同時隙和不同頻率所構成的信號，稱為"時頻調(diào)制信號"；在某種意義上又可看成是一種時頻編碼調(diào)制，組成的系統(tǒng)稱頻率分集接收系統(tǒng)，即按一定的規(guī)則在數(shù)據(jù)符號的不同時隙發(fā)射不同頻率信號來實現(xiàn)信號傳輸?shù)恼{(diào)制方式。FTSK又可分為幾種調(diào)制方式，包括二時二頻制，二進制四時四頻制，四進制四時四頻制、八進制四時四頻制以及十六進制相位調(diào)制等。

　　FTSK碼組的編碼原則是，所編碼組既具有強的抗衰落和抗干擾能力，又容易實現(xiàn)同步，也就是要求編出能從信息序列中提取同步信息的正交碼組。首先，為了提高抗衰落能力，要求每一個碼組的不同時隙中應含有不同的頻率。這樣，二時二頻基本上具有二重頻率分集的效果，而四時四頻基本上具有四重頻率分集的效果；其次，為了加強抗干擾性，任何兩個碼組的碼距應最大，所以首先要選用正交碼，即要求所有的碼組在同一時隙內(nèi)含有不同的頻率，對于四時四頻制而言，在表示四進制信息時，很容易形成正交碼，但表示八進制信息時，只能形成部分正交的碼組；最后，在碼組配置時還應考慮從碼組本身能提取同步信息，即要求編碼方式是非循環(huán)碼，且任何兩個碼組都沒有相同的二聯(lián)碼或三聯(lián)碼。

        表1 各種調(diào)制方式性能比較

　　由表1可以看出，從性能而言，"四進制四時四頻制"是最好的。對于4FTSK調(diào)制，我們選用正交編碼方式，如表2所示

        表2 4FTSK編碼方式

　　3 系統(tǒng)的實現(xiàn)

　　由于本設計的主要目的是利用軟件及簡單的硬件實現(xiàn)4FTSK調(diào)制，并且力求產(chǎn)生的信號精確，故系統(tǒng)選用了當今比較流行的數(shù)字信號處理器（TI公司的TMS320C5402）和一片D/A(CA3338)轉換芯片，用匯編語言編程實現(xiàn)調(diào)制信號輸出。

　　3．1 TMS320C5402特點

　　TMS320C5402是TI公司TMS320家族的定點DSP（數(shù)字信號處理器）芯片。DSP可廣泛應用于雷達信號處理，無線通信，語音信號處理等。實際上，DSP技術在工程應用中，就是要用數(shù)字信號處理的方式實現(xiàn)系統(tǒng)的功能。

　　DSP器件采用了與傳統(tǒng)微處理器系統(tǒng)不同的總線結構，同時增加了硬件運算單元，把軟件計算變?yōu)橛布嬎闾幚?，因此極大地提高了系統(tǒng)的數(shù)字處理速度。

　　C5402的CPU通過使用改進的哈佛結構，實現(xiàn)了高度的并行運算能力。同時，多種尋址模式和完善的指令提高了整個系統(tǒng)的性能。C5402主要有以下特點：

　　增強的哈佛結構，四條地址總線和四條數(shù)據(jù)總線。
　　高度并行的先進CPU設計，性能更好的面向應用的硬件邏輯。
　　為快速算法和高級語言優(yōu)化設計的專用指令集。
　　標準化的模塊結構，適于快速開發(fā)。
　　先進的IC處理技術，提高了性能，降低了電源消耗。
　　
　　3．2 CA3338芯片性能

　　CA3338是HARRIS公司推出采用CMOS工藝制成的高速數(shù)模轉換器，最高工作頻率可達50M。它可以采用單電源+5V供電，并且能產(chǎn)生"軌對軌"的輸出。

　　CA3338內(nèi)部采用改進的R-2R梯形電阻網(wǎng)絡，對高三位進行3位-7位的線性熱編碼來驅動7位加權電阻，這樣，減少了由于輸出電壓值的改變產(chǎn)生的寄生電壓。其內(nèi)部功能框圖如圖1所示：

                                              圖1 CA3338功能框圖

　　LE是片選信號，低電平有效。
　　D0-D7是數(shù)字信號輸入端；COMP控制是否對輸入信號的電平取反，高電平有效。
　　VREF+及VREF-是參考電壓。
　　VDD接+5V電源，VSS是數(shù)字地，VEE可以接模擬地也可以接負電壓。電平轉換部分就是將輸入電壓范圍在VDD和VSS之間的數(shù)字信號轉
　　換到電壓范圍為VDD和VEE之間。
　　VOUT是輸出的模擬信號。