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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測距和雷達(dá)功能以實(shí)現(xiàn)高級IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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fpga 文章進(jìn)入 fpga技術(shù)社區(qū)

基于FPGA的FIR濾波器的性能研究

摘要：目前FIR濾波器的一般設(shè)計方法比較繁瑣，開發(fā)周期長，如果采用設(shè)計好的FIR濾波器的IP核，則開發(fā)效率大為提高。本方案基于Altera公司的CycloneⅡ系列芯片EP2C8Q208C8N，首先利用MATLAB中的濾波器函數(shù)fir2得出需產(chǎn)
關(guān)鍵字： FPGA FIR 濾波器性能

基于FPGA的幅值可調(diào)信號發(fā)生器設(shè)計

摘要：針對信號發(fā)生器時輸出頻率精度高和幅值可調(diào)的要求，采用直接數(shù)字頻率合成(DDS)技術(shù)，提出一種基于FPGA的幅值、頻率均可調(diào)的、高分辨率、高穩(wěn)定度的信號發(fā)生器設(shè)計方案。采用AT89S52單片機(jī)為控制器，控制FPGA產(chǎn)
關(guān)鍵字： FPGA 幅值信號發(fā)生器

基于FPGA的QDPSK調(diào)制器的設(shè)計與實(shí)現(xiàn)

摘要：介紹了QDPSK信號的優(yōu)點(diǎn)，并分析了其實(shí)現(xiàn)原理，提出一種QDPSK高性能數(shù)字調(diào)制器的FPGA實(shí)現(xiàn)方案。采用自頂向下的設(shè)計思想，將系統(tǒng)分成串／并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊，用原理圖
關(guān)鍵字： QDPSK FPGA 調(diào)制器

紅外目標(biāo)識別跟蹤系統(tǒng)的DSP+FPGA實(shí)現(xiàn)

紅外目標(biāo)識別跟蹤系統(tǒng)的DSP+FPGA實(shí)現(xiàn),現(xiàn)場可編程門陣列(FPGA)是在專用ASIC的基礎(chǔ)上發(fā)展出來的，它克服了專用ASIC不夠靈活的缺點(diǎn)。與其他中小規(guī)模集成電路相比，其優(yōu)點(diǎn)主要在于它有很強(qiáng)的靈活性，即其內(nèi)部的具體邏輯功能可以根據(jù)需要配置，對電路的修改和
關(guān)鍵字： DSP FPGA 實(shí)現(xiàn) 系統(tǒng) 跟蹤目標(biāo) 識別紅外

FPGA實(shí)現(xiàn)OFDM水聲通信系統(tǒng)定時同步

FPGA實(shí)現(xiàn)OFDM水聲通信系統(tǒng)定時同步,引言　　正交頻分復(fù)用(Orthogonal Frequency Division Multiplexing，OFDM)技術(shù)是一種多載波調(diào)制技術(shù)，它將寬帶信道分解為相互正交的一組窄帶子信道，利用各個子信道進(jìn)行并行數(shù)據(jù)傳輸，因此其頻譜利用率高、抗多徑衰
關(guān)鍵字：系統(tǒng) 定時同步通信水聲實(shí)現(xiàn) OFDM FPGA

S2C為Xilinx原型驗(yàn)證系統(tǒng)提供突破性驗(yàn)證模塊技術(shù)

S2C 日前宣布其Verification Module技術(shù)（專利申請中）已可用于其基于Xilinx的FPGA原型驗(yàn)證系統(tǒng)中。V6 TAI Verification Module可以實(shí)現(xiàn)在FPGA原型驗(yàn)證環(huán)境和用戶驗(yàn)證環(huán)境之間高速海量數(shù)據(jù)傳輸。用戶可以使用Xilinx ChipScope或者第三方調(diào)試環(huán)境，同時查看4個FPGA。另外，V6 TAI Verification Module還可以用于1.3M～4.7M ASIC門的原型設(shè)計。V6 TAI Verification Module具有PCIe G
關(guān)鍵字： S2C Xilinx FPGA

一款用DSP+FPGA實(shí)現(xiàn)的數(shù)字相關(guān)器

引　言數(shù)字相關(guān)器作為軟件無線電的典型應(yīng)用，在擴(kuò)頻通信中成為必不可少的技術(shù)。在傳統(tǒng)的擴(kuò)頻通信中，采用模擬器件(如：聲表面波器) 來實(shí)現(xiàn)解擴(kuò)單元，而用數(shù)字相關(guān)器可以增加系統(tǒng)的靈活性和穩(wěn)定性，因此，對數(shù)字相關(guān)器
關(guān)鍵字：相關(guān) 數(shù)字實(shí)現(xiàn) FPGA DSP

基于FPGA的混合信號驗(yàn)證流程

基于FPGA的混合信號驗(yàn)證流程,隨著SoC設(shè)計上的混合信號組件數(shù)量增加了，基本的功能驗(yàn)證對于硅初期能否成功也愈來愈重要。FPGA在系統(tǒng)整合難題上加入了一個新特點(diǎn)。在核心上，此新范例-可編程系統(tǒng)單芯片(programmable system chip,PSC)整合FPGA電閘
關(guān)鍵字：驗(yàn)證流程信號混合 FPGA 基于

基于FPGA的檢糾錯邏輯算法的實(shí)現(xiàn)

基于FPGA的檢糾錯邏輯算法的實(shí)現(xiàn),星載計算機(jī)系統(tǒng)中電子器件容易受到空間環(huán)境電磁場的輻射和重粒子的沖擊，從而導(dǎo)致器件運(yùn)行出錯，特別是存儲器中數(shù)據(jù)容易出現(xiàn)錯誤，需要具有檢糾錯功能的電路模塊對其進(jìn)行糾正，以免造成嚴(yán)重的后果?；跐h明碼的糾錯
關(guān)鍵字：算法實(shí)現(xiàn) 邏輯糾錯 FPGA 基于

音頻編解碼芯片接口的FPGA應(yīng)用

音頻編解碼芯片接口的FPGA應(yīng)用,介紹了音頻編解碼芯片WM8731基于FPGA的接口電路的設(shè)計，包括芯片配置模塊與音頻數(shù)據(jù)接口模塊等，使得控制器只通過寄存器就可以方便地對其進(jìn)行操作。整個設(shè)計以VHDL和Verilog HDL語言在Max+Plus Ⅱ里實(shí)現(xiàn)，并進(jìn)行了驗(yàn)
關(guān)鍵字： FPGA 應(yīng)用接口芯片解碼音頻

Altera演示第一款基于模型的FPGA浮點(diǎn)DSP工具

　　Altera公司日前演示了使用FPGA的浮點(diǎn)DSP新設(shè)計流程，這是業(yè)界第一款基于模型的浮點(diǎn)設(shè)計工具，支持在FPGA中實(shí)現(xiàn)復(fù)數(shù)浮點(diǎn)DSP算法。伯克萊設(shè)計技術(shù)公司 (Berkeley Design Technology, Inc, BDTI) 進(jìn)行的獨(dú)立分析驗(yàn)證了能夠在Altera 的Stratix 和Arria FPGA系列中簡單方便的高效實(shí)現(xiàn)高性能浮點(diǎn)DSP設(shè)計。　　
關(guān)鍵字： Altera FPGA

應(yīng)用于除顫器的FPGA解決方案

越來越多的人們認(rèn)識到當(dāng)心臟病患者的心臟驟停時，快速及時的救治能夠帶來很大的好處。這促使更多公共場所和辦...
關(guān)鍵字： FPGA 除顫器

一種基于Spartan3E的DDS優(yōu)化設(shè)計

在高可靠應(yīng)用領(lǐng)域，如果設(shè)計得當(dāng)，將不會存在類似于MCU的復(fù)位不可靠和PC可能跑飛等問題。CPLD/FPGA的高可靠性還...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

基于ARM和FPGA架構(gòu)的三維圖形加速系統(tǒng)

引言隨著圖形處理的巨額運(yùn)算量，CPU變得不堪重負(fù)。此時，需要使用特定的硬件設(shè)備來為嵌入式CPU承擔(dān)圖形處...
關(guān)鍵字： FPGA 圖形加速

為參加2011 Digilent Design Contest的中國代表團(tuán)壯行

??????? 2011年9月12日，中秋月圓之夜，參加 2011 DDC? 德國總決賽的中國代表團(tuán)整裝待發(fā)，即將登機(jī)遠(yuǎn)赴德國慕尼黑參加DDC總決賽，與來自世界各地的16支隊(duì)伍進(jìn)行角逐。讓我們?yōu)樗麄儔研?！預(yù)祝他們?nèi)〉煤贸煽儯? ??????
關(guān)鍵字： Digilent FPGA

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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