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詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實現(xiàn)目標

詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實現(xiàn)目標-FPGA的開發(fā)流程是遵循著ASIC的開發(fā)流程發(fā)展的，發(fā)展到目前為止，F(xiàn)PGA的開發(fā)流程總體按照圖1進行，有些步驟可能由于其在當前項目中的條件的寬度的允許，可以免去，比如靜態(tài)仿真過程，這樣來達到項目時間上的優(yōu)勢。
關(guān)鍵字： FPGA

一文了解FPGA與DSP的區(qū)別、特點及用途

一文了解FPGA與DSP的區(qū)別、特點及用途-FPGA是一種可編程的硅芯片，DSP是數(shù)字信號處理，當系統(tǒng)設計人員在項目的架構(gòu)設計階段就面臨到底采用FPGA還是DSP的重要問題。本文將首先分別介紹FPGA和DSP的特點，然后再從內(nèi)部資源、編程語言、功能多個角度解析兩者的不同。
關(guān)鍵字： FPGA DSP

通過FPGA智能調(diào)試工具縮短驗證時間

通過FPGA智能調(diào)試工具縮短驗證時間-設計人員選擇具有優(yōu)秀調(diào)試能力的FPGA器件，可以縮短開發(fā)周期并降低成本，同時顯著加快上市速度。
關(guān)鍵字： FPGA 邏輯分析儀

基于FPGA的虛擬現(xiàn)實定位系統(tǒng)

基于FPGA的虛擬現(xiàn)實定位系統(tǒng)-虛擬現(xiàn)實技術(shù)是目前計算機信息科學中的前沿學科，文中設計了一種以FPGA 為核心的數(shù)據(jù)采集處理系統(tǒng).利用HMC5883L和ADXL345對虛擬場景中物體的方位和朝向進行確定并通過以太網(wǎng)給虛擬場景主機發(fā)送數(shù)據(jù).整個系統(tǒng)以 FPGA作為主控制器，配以傳感器數(shù)據(jù)采集，內(nèi)部FIFO存儲，以太網(wǎng)高速傳輸，從而把定位系統(tǒng)參數(shù)實時傳送到上位機中，具有傳輸速度快.實時性等優(yōu)點，實現(xiàn)了虛擬現(xiàn)實高精度定位的功能.
關(guān)鍵字： FPGA 虛擬現(xiàn)實

電路設計常見的八個誤區(qū)

電路設計常見的八個誤區(qū)-電路設計常見的八個誤區(qū)：現(xiàn)象一：這板子的PCB設計要求不高，就用細一點的線，自動布吧；現(xiàn)象二：這些總線信號都用電阻拉一下，感覺放心些；現(xiàn)象三：CPU和FPGA的這些不用的I/O口怎么處理呢？先讓它空著吧，以后再說。
關(guān)鍵字：電路設計 PCB fpga

FPGA實戰(zhàn)開發(fā)技巧（6）

FPGA實戰(zhàn)開發(fā)技巧（6）-時序性能是FPGA 設計最重要的指標之一。造成時序性能差的根本原因有很多，但其直接原因可分為三類：布局較差、邏輯級數(shù)過多以及信號扇出過高。
關(guān)鍵字： FPGA 時序性能

FPGA實戰(zhàn)開發(fā)技巧（7）

FPGA實戰(zhàn)開發(fā)技巧（7）-通常我們會為工程添加UCF 約束指定時序要求和管腳約束。但是UCF 約束是給MAP，PAR 等實現(xiàn)使用的，綜合工具XST 并不能感知系統(tǒng)的時序要求。而為XST 添加XCF 約束卻是使實現(xiàn)結(jié)果擁有最高頻率的關(guān)鍵。
關(guān)鍵字： FPGA XCF UCF

利用FPGA的自身特性實現(xiàn)隨機數(shù)發(fā)生器

利用FPGA的自身特性實現(xiàn)隨機數(shù)發(fā)生器-本文主要介紹利用FPGA的自身的特性實現(xiàn)隨機數(shù)發(fā)生器，在Virtex-II Pro開發(fā)板上用ChipScope觀察隨機數(shù)序列，以及在PCIe4Base（基于Virtex-4 FPGA）上實現(xiàn)。
關(guān)鍵字： fpga

談談如何利用FPGA開發(fā)板進行ASIC原型開發(fā)

談談如何利用FPGA開發(fā)板進行ASIC原型開發(fā)-ASIC設計在尺寸和復雜性上不斷增加，現(xiàn)代FPGA的容量和性能的新進展意味著這些設計中的2/3能夠使用單個FPGA進行建模。
關(guān)鍵字： FPGA ASIC

FPGA實戰(zhàn)開發(fā)技巧（5）

FPGA實戰(zhàn)開發(fā)技巧（5）-一般來講，添加約束的原則為先附加全局約束，再補充局部約束，而且局部約束比較寬松。其目的是在可能的地方盡量放松約束，提高布線成功概率，減少ISE 布局布線時間。典型的全局約束包括周期約束和偏移約束。
關(guān)鍵字： FPGA 周期約束

FPGA實戰(zhàn)開發(fā)技巧（4）

FPGA實戰(zhàn)開發(fā)技巧（4）-在代碼編寫完畢后，需要借助于測試平臺來驗證所設計的模塊是否滿足要求。ISE 提供了兩種測試平臺的建立方法，一種是使用HDL Bencher 的圖形化波形編輯功能編寫，另一種就是利用HDL 語言，相對于前者使用簡單、功能強大。
關(guān)鍵字： FPGA ISE

FPGA實戰(zhàn)開發(fā)技巧（3）

FPGA實戰(zhàn)開發(fā)技巧（3）-所謂綜合，就是將HDL語言、原理圖等設計輸入翻譯成由與、或、非門和RAM、觸發(fā)器等基本邏輯單元的邏輯連接( 網(wǎng)表)，并根據(jù)目標和要求( 約束條件) 優(yōu)化所生成的邏輯連接，生成EDF 文件。XST 內(nèi)嵌在ISE 3 以后的版本中，并且在不斷完善。
關(guān)鍵字： FPGA 賽靈思

FPGA電路必須遵循的原則和技巧

FPGA電路必須遵循的原則和技巧-在調(diào)試FPGA電路時要遵循必須的原則和技巧，才能降低調(diào)試時間，防止誤操作損壞電路。通常情況下，能夠參考以下步驟執(zhí)行 FPGA硬件系統(tǒng)的調(diào)試。
關(guān)鍵字： FPGA

寫verilog代碼要有硬件的概念

寫verilog代碼要有硬件的概念-因為Verilog是一種硬件描述語言，所以在寫Verilog語言時，首先要有所要寫的module在硬件上如何實現(xiàn)的概念，而不是去想編譯器如何去解釋這個module
關(guān)鍵字： verilog FPGA

學好FPGA應該要具備的知識

學好FPGA應該要具備的知識-閱讀本文的人群：熟悉數(shù)字電路基本知識（如加法器、計數(shù)器、RAM等），熟悉基本的同步電路設計方法，熟悉HDL語言，對FPGA的結(jié)構(gòu)有所了解，對FPGA設計流程比較了解。
關(guān)鍵字： FPGA 同步電路

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利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設計與實現(xiàn)
基于FPGA的LCD顯示遠程更新

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