京微雅格 文章 進(jìn)入京微雅格技術(shù)社區(qū)
再續(xù)FPGA初心，京微齊力脫胎京微雅格重新起航
- 新的一年開啟新的希望，新的空白承載新的夢想。這是年初一集微網(wǎng)給讀者們拜年時寫的寄語。在中國農(nóng)歷新年開年之際，半導(dǎo)體產(chǎn)業(yè)里也迎來了許多新的起點。例如長江存儲在與蘋果就采購前者的Nand閃存芯片一事談判，又例如前京微雅格副總裁王海力堅守18個月后的二次創(chuàng)業(yè)。 2005年年底，即將從清華大學(xué)計算機專業(yè)博士畢業(yè)的王海力加入了一家新成立的中外合資公司——雅格羅技，開始了國產(chǎn)FPGA芯片研發(fā)。2010年在北京市政府相關(guān)引導(dǎo)資金支持下，該公司也轉(zhuǎn)換身份并更名為“京微雅格&r
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京微雅格重磅之作―新版FPGA/CAP設(shè)計套件Primace5.0
- 簡介作為國內(nèi)唯一一家具有完全自主知識產(chǎn)權(quán)的FPGA與可配置應(yīng)用平臺CAP(Configurable Application Platform)產(chǎn)品供應(yīng)商，京微雅格一直在快節(jié)奏的改進(jìn)與產(chǎn)品配套的軟件開發(fā)環(huán)境。最近，新一代FPGA/CAP設(shè)計套件Primace5
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基于京微雅格CME-C1的典型應(yīng)用介紹
- CME-C1是京微雅格新近推出的高性能大容量“云”系列首顆產(chǎn)品，邏輯容量折合2000萬門級。CME-C1采用TSMC 40nm先進(jìn)工藝，采用全新的6輸入查找表架構(gòu)，獨創(chuàng)36x18的DSP單元，內(nèi)嵌大容量每塊18K位ram，高速串行接口可達(dá)6.5Gbps，通用差分I/O可達(dá)1.3Gbps，同時還內(nèi)置硬核PCIe支持5G速率Gen2、DDR3/2控制器以及PHY讀寫速率可達(dá)1333Mbps，各項指標(biāo)均達(dá)國內(nèi)領(lǐng)先水平?！ ME-C1緊跟當(dāng)前市場的需要，定位于無線通信、有線網(wǎng)、電力保護(hù)、工業(yè)控制(
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基于京微雅格CME-C1的典型應(yīng)用介紹
- CME-C1是京微雅格新近推出的高性能大容量“云”系列首顆產(chǎn)品，邏輯容量折合2000萬門級。CME-C1采用TSMC 40nm先進(jìn)工藝，采用全新的6輸入查找表架構(gòu)，獨創(chuàng)36x18的DSP單元，內(nèi)嵌大容量每塊18K位ram，高速串行接口可達(dá)6.5Gbps，通用差分I/O可達(dá)1.3Gbps，同時還內(nèi)置硬核PCIe支持5G速率Gen2、DDR3/2控制器以及PHY讀寫速率可達(dá)1333Mbps，各項指標(biāo)均達(dá)國內(nèi)領(lǐng)先水平?！ ME-C1緊跟當(dāng)前市場的需要，定位于無線通信、有線網(wǎng)、電力保護(hù)、工業(yè)控制(
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京微雅格：越走越好的國產(chǎn)FPGA生存之路
- 015年 3月 17日至 19 日，京微雅格(北京)科技有限公司參加了在上海舉行的 2015慕尼黑上海電子展。活動期間，京微雅格將展示其FPGA產(chǎn)品在多個市場領(lǐng)域的應(yīng)用方案，包括消費電子、智能家居、金融安全、機器人、物聯(lián)網(wǎng)、汽車電子等。 FPGA芯片被稱為“萬能芯片”，它和專業(yè)集成電路的區(qū)別就在于：從技術(shù)角度來說，它是一種可以編程的產(chǎn)品，在不改變芯片本身硬件組成的情況下可以反復(fù)使用。根據(jù)市場變化，在同樣的載體上實現(xiàn)不同功能，而且不用更改硬件載體。聽起來很美好，但研發(fā)起來很
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利用CME-M5實現(xiàn)1080P高清字符疊加的設(shè)計要點分析
- 隨著信息化技術(shù)的提高，人們對于視覺欣賞的要求越來越高。“視覺沖擊力”成為人們評判顯示性能的一個標(biāo)準(zhǔn)。視覺沖擊力不僅要求畫面尺寸超大，最主要的還要要求畫面顯示清晰，包括圖片與文字。為了滿足這種訴求，本文以京微雅格CME-M5(金山)為例，為您分析如何在HDMI高清信號中疊加字符，并且最終實現(xiàn)高清輸出的過程。 如下圖所示，不難看出， 就是把一路HDMI高清信號通過HDMI轉(zhuǎn)RGB芯片送到CME-M5后，與外部的字符芯片進(jìn)行高清疊加后，再通過RGB轉(zhuǎn)HDMI送出來。
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基于京微雅格低功耗FPGA的8b/10b SERDES的接口設(shè)計
- 摘要 串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES (串化器/ 解串器)所取代。起初， SERDES 是獨立的ASSP 或ASIC 器件。在過去幾年中已經(jīng)看到有內(nèi)置SERDES 的FPGA 器件系列，但多見于高端FPGA芯片中，而且價格昂貴。 本方案是以CME最新的低功耗系列FPGA的HR03為平臺，實現(xiàn)8/10b的SerDes接口，包括SERDES收發(fā)單元，通過完全數(shù)字化的方法實現(xiàn)SERDES的CD
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京微雅格介紹
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