信號(hào)時(shí)延 文章 進(jìn)入信號(hào)時(shí)延技術(shù)社區(qū)
PCB走線寬度變化產(chǎn)生的反射
- 在進(jìn)行PCB布線時(shí)，經(jīng)常會(huì)發(fā)生這樣的情況：走線通過某一區(qū)域時(shí)，由于該區(qū)域布線空間有限，不得不使用更細(xì)的線條，通過這一區(qū)域后，線條再恢復(fù)原來的寬度。走線寬度變化會(huì)引起阻抗變化，因此發(fā)生反射，對(duì)信號(hào)產(chǎn)生影響。那么什么情況下可以忽略這一影響，又在什么情況下我們必須考慮它的影響？
- 關(guān)鍵字： PCB走線 反射 走線寬度 阻抗變化 信號(hào)時(shí)延
FPGA設(shè)計(jì)系統(tǒng)時(shí)鐘的影響因素及其分析
- 時(shí)鐘是整個(gè)電路最重要、最特殊的信號(hào)，系統(tǒng)內(nèi)大部分器件的動(dòng)作都是在時(shí)鐘的跳變沿上進(jìn)行， 這就要求時(shí)鐘信號(hào)時(shí)延差要非常小， 否則就可能造成時(shí)序邏輯狀態(tài)出錯(cuò)；因而明確FPGA設(shè)計(jì)中決定系統(tǒng)時(shí)鐘的因素，盡量較小時(shí)鐘的延時(shí)對(duì)保證設(shè)計(jì)的穩(wěn)定性有非常重要的意義。
- 關(guān)鍵字： 信號(hào)時(shí)延 系統(tǒng)時(shí)鐘 FPGA
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信號(hào)時(shí)延介紹
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