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高效率嵌入式程序開發(fā)

引言　　在多媒體、通信等計算復(fù)雜度高的應(yīng)用中，為了滿足制造費用、功耗、性能以及實時性等諸多限制條件的要求，嵌入式系統(tǒng)程序往往需要特殊設(shè)計。這使得設(shè)計師在設(shè)計面向特定應(yīng)用的嵌入式軟件時，需要有一套切實可行的編程準則。而在實際程序設(shè)計中，工程師尤其需要考慮對變量的使用和循環(huán)程序的處理。　　變量使用　　在進行實際程序開發(fā)時，變量的使用至關(guān)重要,其中使用全局變量比向函數(shù)傳遞參數(shù)更加有效，這樣免去了函數(shù)調(diào)用時參數(shù)入棧和出棧的需要。當然，使用全局變量會對程序有一些副
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DCS控制器中采用ARM處理器的冗余設(shè)計

在自動化的許多領(lǐng)域，有效性的要求越來越高，因而對自動化系統(tǒng)的容錯水平的要求也變得越來越高，尤其在設(shè)備停機代價非常大的場合。為了滿足這些嚴格的要求，在DCS系統(tǒng)中通常采用冗余技術(shù)，這樣才能夠滿足這些領(lǐng)域所需要的安全性、可靠性和有效性的標準。　　在DCS控制系統(tǒng)中，分布處理單元是系統(tǒng)關(guān)鍵的部分。當前這些分布處理單元的控制器往往是基于86系列CPU建構(gòu)的，這種架構(gòu)目前被廣泛采用。但是由于86系列分布處理單元的特點，導(dǎo)致現(xiàn)在的控制器處理單元存在很多的缺點，如放熱量大等。
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基于ARM uCLinux的網(wǎng)絡(luò)控制系統(tǒng)設(shè)計與實現(xiàn)

　　隨著網(wǎng)絡(luò)和通信技術(shù)的發(fā)展，嵌入式系統(tǒng)現(xiàn)已進入高速發(fā)展階段。并在社會各個領(lǐng)域得到了廣泛的應(yīng)用。本文介紹了一種采用ARM+uCLinux作為開發(fā)平臺。實現(xiàn)基于TCP／IP的遠程系統(tǒng)監(jiān)控．從而取代傳統(tǒng)單片機來實現(xiàn)數(shù)據(jù)采集、預(yù)處理和通信功能；并依靠互聯(lián)網(wǎng)將數(shù)據(jù)向上位機傳送，同時支持遠端客戶對設(shè)備進行遠程控制，從而實現(xiàn)遠程監(jiān)控功能的具體方法。　　1 系統(tǒng)平臺的構(gòu)建　　本系統(tǒng)由嵌入式平臺服務(wù)器、前端控制器、前端傳感器、客戶端和配置PC 組成。開發(fā)時可通過配置PC來下載系統(tǒng)和應(yīng)用軟件。嵌入式系統(tǒng)平臺能夠收集
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基于FPGA的智能控制器設(shè)計及測試方法研究

摘要：通過模糊自整定PID控制器的設(shè)計，本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實現(xiàn)的智能控制器設(shè)計及測試新方法。首先，通過MATLAB仿真，得出智能控制器的結(jié)構(gòu)和參數(shù)。然后，基于VHDL進行智能控制器的數(shù)字化實現(xiàn)及其開環(huán)測試。在此基礎(chǔ)上，通過分析一般智能控制器的測試特點，采用DSP Builder構(gòu)建閉環(huán)測試系統(tǒng)，Modelsim運行DSP Builder生成文件來驗證QuartusII中所做VHDL設(shè)計的測試方法。實驗表明，該測試方法能有效模擬控制器的
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DSP在無線傳感系統(tǒng)中的應(yīng)用

　　1. 引言　　在現(xiàn)代信息社會中，目標辨識已經(jīng)得到了廣泛的應(yīng)用。例如超市中貨物的識別、圖書館中書刊的識別、銀行磁卡等都是目標識別系統(tǒng)應(yīng)用的實例。尤其是近年來，自動識別方法在許多服務(wù)領(lǐng)域、在貨物銷售與后勤分配方面、在商業(yè)部門、在生產(chǎn)企業(yè)和材料流通領(lǐng)域、在智能交通管理等方面得到了快速的普及和推廣。　　在幾年前，條形碼——紙帶在識別系統(tǒng)領(lǐng)域引起了一場革命并得到了廣泛的認同與應(yīng)用。但是隨著現(xiàn)代社會的發(fā)展，這種技術(shù)在越來越多的情況下不能滿足人們的需求了。條形碼雖然便宜，但它的不足之處在于存儲能力小以及不能
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第五屆全國高校嵌入式系統(tǒng)教學(xué)研討會圓滿落幕

　　2007年7月22日，由中國電子學(xué)會、中國軟件行業(yè)協(xié)會嵌入式系統(tǒng)分會主辦，中國電子學(xué)會嵌入式系統(tǒng)專家委員會承辦，北京博創(chuàng)興業(yè)科技有限公司、北京航空航天大學(xué)出版社、《單片機與嵌入式系統(tǒng)應(yīng)用》雜志社等協(xié)辦的 “第五屆全國高校嵌入式系統(tǒng)教學(xué)研討會”在北京航空航天大學(xué)如心會議中心圓滿落幕。　　中國科學(xué)院、中國工程院王越院士，中國工程院倪光南院士，中國電子學(xué)會劉汝林秘書長、劉明亮副秘書長，中國科協(xié)羅平主任，中國軟件行業(yè)協(xié)會嵌入式系統(tǒng)分會郭淳學(xué)秘書長，北京航空航天大學(xué)何立民教授、王田苗教授等國內(nèi)著名的專家、領(lǐng)
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基于PIC單片機的電波數(shù)碼顯示時鐘的設(shè)計

電波鐘是新興的準確計時產(chǎn)品，是把原子振動的頻率引出來作為計時基準.設(shè)計以PIC16F873單片機為核心，由接收單元，中央處理顯示單元和電源單元三個主要部分構(gòu)成，用于接收原子發(fā)射臺以超長波間歇性發(fā)射的信號，以獲得更加準確的時間，在軍事和科學(xué)實驗以及人們?nèi)粘Ｉ钪卸加袕V泛的應(yīng)用前景。
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一種基于CPLD的曼徹斯特編解碼器設(shè)計

引言　　雖然計算機通信的方法和手段多種多樣，但都必須依靠數(shù)據(jù)通信技術(shù)。數(shù)據(jù)通信就是將數(shù)據(jù)信號加到數(shù)據(jù)傳輸信道上進行傳輸，并在接收點將原始發(fā)送的數(shù)據(jù)正確地恢復(fù)過來。由于計算機產(chǎn)生的一般都是數(shù)字信號，因此計算機之間的通信實際上都屬于數(shù)據(jù)通信。曼徹斯特碼編解碼器是1553B總線接口中不可缺少的重要組成部分。曼徹斯特碼編解碼器設(shè)計的好壞直接影響總線接口的性能。在數(shù)控測井系統(tǒng)和無線監(jiān)控等領(lǐng)域，曼徹斯特碼編解碼器都有廣泛應(yīng)用。 1 數(shù)據(jù)通信系統(tǒng)結(jié)構(gòu) 　　　圖1所示是數(shù)據(jù)通信系統(tǒng)的基本構(gòu)成。在計算機通信中
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嵌入式智能人機界面與PLC的通訊

　　1、引言　　近年來，“嵌入式”一詞越來越多的被人們提及，嵌入式產(chǎn)品被應(yīng)用到各行各業(yè)。與嵌入式相關(guān)的技術(shù)如嵌入式產(chǎn)品，嵌入式系統(tǒng)的研究等也被列為“十五” 家發(fā)展的重點方向。　　嵌入式系統(tǒng) (Embedded System)被定義為：以應(yīng)用為中心，以計算機技術(shù)為基礎(chǔ)，軟件硬件可裁剪，適應(yīng)對功能、可靠性、成本、體積、功耗嚴格要求的專用計算機系統(tǒng)。　　隨著工業(yè)自動化的發(fā)展，基于PLC，單片機等設(shè)備的自動化系統(tǒng)，自動化設(shè)備越來越普及，幾乎遍布所有自動化領(lǐng)域，
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基于VxWorks的多DSP系統(tǒng)的多任務(wù)程序設(shè)計

　　近年來，計算機產(chǎn)品的應(yīng)用領(lǐng)域越來越廣，數(shù)字信號處理器的發(fā)展表現(xiàn)得尤為明顯。DSP芯片制造商和DSP板開發(fā)商利用自身的優(yōu)勢不斷開發(fā)出多DSP結(jié)構(gòu)的產(chǎn)品來滿足這種需求。通常的DSP設(shè)備是與嵌入式系統(tǒng)相結(jié)合，來實時地完成某一特定任務(wù)。隨著信號采集速度和處理速度的要求越來越高，許多領(lǐng)域都需要進行多處理器運算，其中包括醫(yī)學(xué)、圖像處理、軍事、工業(yè)控制、電信等許多領(lǐng)域。多處理器系統(tǒng)可以根據(jù)所需實現(xiàn)的功能和處理器的性能來調(diào)節(jié)處理結(jié)點的數(shù)目，使系統(tǒng)達到最佳的性能價格比。　　實際上，只有從芯片開始仔細設(shè)計，才能方便
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Altera宣布其Cyclone III FPGA提供對EtherCAT IP支持

　　Altera公司日前宣布為EtherCAT技術(shù)協(xié)會的EtherCAT協(xié)議提供知識產(chǎn)權(quán)(IP)支持。此前IP是針對Cyclone® II器件，現(xiàn)在將針對Altera新的低成本、低功耗Cyclone III FPGA。　　EtherCAT技術(shù)協(xié)會執(zhí)行總監(jiān)Martin Rostan說：“在競爭非常激烈的工廠自動化設(shè)備市場上，企業(yè)正在尋找能夠迅速突出產(chǎn)品優(yōu)勢的新功能和特性。Cyclone III FPGA實現(xiàn)對EtherCAT的支持，使設(shè)計人員能夠以高性價比方式，輕松加入實時以太網(wǎng)功能?！? 　　
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利用FPGA實現(xiàn)UART的設(shè)計

引言　　隨著計算機技術(shù)的發(fā)展和廣泛應(yīng)用，尤其是在工業(yè)控制領(lǐng)域的應(yīng)用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設(shè)備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計數(shù)等問題，這使串行通信技術(shù)比并行通信技術(shù)更為復(fù)雜。串／并轉(zhuǎn)換可用軟件實現(xiàn)，也可用硬件實現(xiàn)。用軟件實現(xiàn)串行傳送大多采用循環(huán)移位指令將一個字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統(tǒng)的性能。更為方便的實現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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基于雙嵌入式處理器的高清數(shù)字電視設(shè)計

　　1 引言　　隨著數(shù)字傳輸技術(shù)和圖像處理技術(shù)的提高，電視技術(shù)正逐步從SDTV（Standard Definition TV，標準清晰度電視）過渡到HDTV（High Definition TV，高清晰度電視）。高清數(shù)字電視符合人們對高品質(zhì)的數(shù)字多媒體播放和高性能的網(wǎng)絡(luò)信息終端的需要，具備廣闊的市場前景，其基于嵌入式系統(tǒng)技術(shù)的實現(xiàn)也成為嵌入式領(lǐng)域的新熱點[1-2]。　　高清電視是指播放畫質(zhì)超過720p或者1080i的高清晰度電視系統(tǒng)（i表示隔行掃描，p表示逐行掃描）。目前標清的播放畫質(zhì)為480i，
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降低FPGA功耗的設(shè)計

　　使用這些設(shè)計技巧和ISE功能分析工具來控制功耗　　新一代 FPGA的速度變得越來越快，密度變得越來越高，邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢？很多設(shè)計抉擇可以影響系統(tǒng)的功耗，這些抉擇包括從顯見的器件選擇到細小的基于使用頻率的狀態(tài)機值的選擇等。　　為了更好地理解本文將要討論的設(shè)計技巧為什么能夠節(jié)省功耗，我們先對功耗做一個簡單介紹。　　功耗包含兩個因素：動態(tài)功耗和靜態(tài)功耗。動態(tài)功耗是指對器件內(nèi)的容性負載充放電所需的功耗。它很大程度上取決于頻率、電壓和負載
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具有硬件互斥的控制電路設(shè)計方法

　　在控制系統(tǒng)設(shè)計時，硬件互斥現(xiàn)象是很常見的，互斥電路功能可用硬件實現(xiàn)，也可以用系統(tǒng)加軟件實現(xiàn)。用硬件電路來實現(xiàn)指定的控制功能比用軟件來實現(xiàn)穩(wěn)定性好，處理速度更快得多。隨著大規(guī)模集成電路技術(shù)發(fā)展，用硬件來處理特定的功能的發(fā)展趨勢日趨明顯，隨著SOPC技術(shù)的發(fā)展，軟體的硬化已日益成為人們研究的熱點，專用功能的ASIC芯片越來越多。在進行計算機操作系統(tǒng)設(shè)計時，互斥理論用來處理并發(fā)過程對臨界資源的共享；在進行控制系統(tǒng)設(shè)計時，電路的不同邏輯狀態(tài)也常有互斥現(xiàn)象。如多個輸入信號共享一個處理電路而輸入信號同時作用于電路
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