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          EEPW首頁(yè) >> 主題列表 >> 可重構(gòu)

          沐“安”之澤暉,創(chuàng)“芯”之華章

          • 1? ?信息安全決定于可靠的“芯”當(dāng)前的數(shù)字信息產(chǎn)業(yè)構(gòu)建在半導(dǎo)體之上,且依賴度越來越強(qiáng),如果芯片安全得不到保證,則任何形式的信息安全都無從談起,這對(duì)行業(yè)發(fā)展舉足輕重,并且覆蓋和滲透到各類信息網(wǎng)絡(luò)體系及產(chǎn)品的方方面面。隨著信息安全深入人心,安全芯片正在成為一個(gè)特殊的產(chǎn)業(yè),成為越來越多從事解決方案公司的關(guān)注焦點(diǎn)和標(biāo)準(zhǔn)配置。出于對(duì)安全芯片最新概念和演進(jìn)的興趣,在北京上地海淀創(chuàng)業(yè)園,筆者與無錫沐創(chuàng)集成電路設(shè)計(jì)有限公司總經(jīng)理朱敏博士進(jìn)行了交流。作為網(wǎng)絡(luò)安全芯片領(lǐng)域的領(lǐng)跑者,沐創(chuàng)致力于以可重構(gòu)計(jì)算
          • 關(guān)鍵字: 202107  安全  可重構(gòu)  

          基于NETFPGA的可重構(gòu)科學(xué)計(jì)算平臺(tái)

          • 本項(xiàng)目的研究目標(biāo)是探索和建立圖形化數(shù)學(xué)算法向硬件轉(zhuǎn)換的理論方法,研究開發(fā)數(shù)學(xué)算法向硬件邏輯轉(zhuǎn)換的工具,與科學(xué)計(jì)算軟件相結(jié)合建立起基于FPGA陣列的科學(xué)計(jì)算平臺(tái)原型。研究目標(biāo)結(jié)構(gòu)流程如下:
          • 關(guān)鍵字: 可重構(gòu)  科學(xué)計(jì)算平臺(tái)  FPGA  NET  

          動(dòng)態(tài)可重構(gòu)的智能光載無線接入技術(shù)(二)

          • 2 智能光載無線網(wǎng)絡(luò)的媒體訪問控制層技術(shù)在構(gòu)建有效網(wǎng)絡(luò)的基礎(chǔ)上,還需要考慮怎樣實(shí)現(xiàn)網(wǎng)絡(luò)內(nèi)部公平有效的資 ...
          • 關(guān)鍵字: 動(dòng)態(tài)  可重構(gòu)  智能光載  無線接入  

          動(dòng)態(tài)可重構(gòu)的智能光載無線接入技術(shù)(一)

          • 1 新型網(wǎng)絡(luò)體系結(jié)構(gòu)要實(shí)現(xiàn)智能化的光載無線網(wǎng)絡(luò),設(shè)計(jì)一個(gè)好的網(wǎng)絡(luò)體系結(jié)構(gòu)是首先需要考慮的問題。結(jié)合目前 ...
          • 關(guān)鍵字: 動(dòng)態(tài)  可重構(gòu)  智能光載  無線接入  

          基于FPGA的實(shí)驗(yàn)室可重構(gòu)信號(hào)源的設(shè)計(jì)

          • 摘要 介紹了以直接頻率合成技術(shù)DDS為基礎(chǔ)的信號(hào)發(fā)生器基本工作原理及設(shè)計(jì)過程,并以單片機(jī)和FPGA為核心實(shí)現(xiàn)了波形、頻率、幅值均可調(diào)節(jié)的信號(hào)發(fā)生器設(shè)計(jì)。經(jīng)測(cè)試驗(yàn)證,該信號(hào)發(fā)生器取得了理想的結(jié)果,達(dá)到了設(shè)計(jì)要求
          • 關(guān)鍵字: FPGA  實(shí)驗(yàn)室  可重構(gòu)  信號(hào)源    

          基于DDS IP核及Nios II的可重構(gòu)信號(hào)源設(shè)計(jì)

          • SOPC(System on a Programmable Chip,片上可編程系統(tǒng))是Altera公司提出的一種靈活、高效的SOC解決方案。它將處理器、存儲(chǔ)器、I/O接口、LVDS、CDR等系統(tǒng)設(shè)計(jì)需要的功能模塊集成到一個(gè)可編程邏輯器件上,構(gòu)建一個(gè)可
          • 關(guān)鍵字: Nios  DDS  IP核  可重構(gòu)    

          基于ARM和CPLD的可重構(gòu)檢測(cè)系統(tǒng)設(shè)計(jì)

          • 引言
            檢測(cè)系統(tǒng)的可重構(gòu)設(shè)計(jì)是檢測(cè)技術(shù)的發(fā)展方向??芍貥?gòu)設(shè)計(jì)是指利用可重用的軟硬件資源,根據(jù)不同的應(yīng)用需求,靈活地改變自身體系結(jié)構(gòu)的設(shè)計(jì)方法。對(duì)于檢測(cè)系統(tǒng)而言,可重構(gòu)可以分為軟件可重構(gòu)和硬件可重
          • 關(guān)鍵字: CPLD  ARM  可重構(gòu)  檢測(cè)系統(tǒng)設(shè)計(jì)    

          可重構(gòu)波束天線滿足大數(shù)據(jù)流需要

          • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
          • 關(guān)鍵字: 可重構(gòu)  波束天線  數(shù)據(jù)流量  無線電基站  

          FPGA的可重構(gòu)測(cè)控系統(tǒng)應(yīng)用設(shè)計(jì)

          • 1 可重構(gòu)測(cè)控系統(tǒng)的提出
            測(cè)控系統(tǒng)一般是指基于計(jì)算機(jī)實(shí)現(xiàn)數(shù)據(jù)采集和控制的系統(tǒng)。測(cè)控系統(tǒng)在工業(yè)現(xiàn)場(chǎng)控制、家庭數(shù)字化管理、通信和網(wǎng)絡(luò)等方面應(yīng)用廣泛,并不斷向低成本、高速、高性能、智能化、開放化方向邁進(jìn)。但現(xiàn)
          • 關(guān)鍵字: FPGA  可重構(gòu)  測(cè)控系統(tǒng)  應(yīng)用設(shè)計(jì)    

          可重構(gòu)計(jì)算:高效靈活的計(jì)算技術(shù)

          • 在大眾已經(jīng)習(xí)慣的計(jì)算模式中,處理器和專用集成電路(ASIC)一直是兩大主流。伴隨著應(yīng)用領(lǐng)域特別是嵌入式環(huán)境對(duì)系統(tǒng)的性能、能耗、上市時(shí)間等指標(biāo)需求的不斷提高,傳統(tǒng)的計(jì)算模式暴露出了種種弊端??芍貥?gòu)計(jì)算技術(shù)集
          • 關(guān)鍵字: 可重構(gòu)  計(jì)算  計(jì)算技術(shù)    

          使用RapidIO技術(shù)搭建可重構(gòu)信號(hào)處理平臺(tái)

          • 摘要:軍事領(lǐng)域常選擇ADI公司的TS201芯片用于信號(hào)處理平臺(tái),但由于其采用基于電路交換的LINK口進(jìn)行連接,...
          • 關(guān)鍵字: FPGA  RapidIO  可重構(gòu)  信號(hào)處理  DSP  LINK口  

          基于平均Q因子的可重構(gòu)光網(wǎng)絡(luò)性能監(jiān)控

          • 本文主要探討了一種基于平均Q因子的可重構(gòu)光網(wǎng)絡(luò)性能監(jiān)控技術(shù)。此方法利用異步眼圖抽樣。不需要時(shí)鐘同步。文中通過大量數(shù)值仿真得出了抽樣點(diǎn)數(shù)對(duì)估計(jì)Q值的直接影響。
          • 關(guān)鍵字: Q因子  可重構(gòu)  網(wǎng)絡(luò)性能監(jiān)控    

          基于對(duì)EPCS在線編程的FPGA可重構(gòu)方法

          • 0 引言
            可重構(gòu)體系結(jié)構(gòu)已經(jīng)成為FPGA系統(tǒng)開發(fā)的研究熱點(diǎn),并已有許多令人矚目的研究成果及產(chǎn)品應(yīng)用。FPGA可重構(gòu)的應(yīng)用為用戶提供了方便的系統(tǒng)升級(jí)模式,同時(shí)也實(shí)現(xiàn)了基于相同硬件系統(tǒng)的不同工作模式功能。在當(dāng)
          • 關(guān)鍵字: EPCS  FPGA  編程  可重構(gòu)    

          可重構(gòu)系統(tǒng)功耗相關(guān)的硬件任務(wù)調(diào)度算法

          • 面向可重構(gòu)系統(tǒng),提出了一種功耗相關(guān)的硬件任務(wù)調(diào)度算法(Energy-Efficient Hardware Task Schedu-ling,EEHTS)。動(dòng)態(tài)電壓調(diào)整(Dynamic Voltage Scaling,DVS)技術(shù)通過在軟件任務(wù)運(yùn)行時(shí)動(dòng)態(tài)改變CPU的運(yùn)行電壓而降低系統(tǒng)功耗。類似地,EEHTS算法在硬件任務(wù)調(diào)度時(shí)動(dòng)態(tài)改變FPGA的工作頻率,達(dá)到降低功耗的目的。模擬實(shí)驗(yàn)結(jié)果表明,EEHTS算法在不影響硬件任務(wù)截止期要求的前提下,可以有效降低系統(tǒng)功耗。
          • 關(guān)鍵字: 可重構(gòu)  功耗  系統(tǒng)  任務(wù)調(diào)度算法    

          Cache結(jié)構(gòu)的低功耗可重構(gòu)技術(shù)研究

          • 在分析Cache性能的基礎(chǔ)上介紹了當(dāng)前低功耗Cache的設(shè)計(jì)方法,提出了一種可重構(gòu)Cache模型和動(dòng)態(tài)可重構(gòu)算法。Cache模型能夠在程序運(yùn)行過程中改變相聯(lián)度和大小,動(dòng)態(tài)可重構(gòu)算法能夠在運(yùn)行時(shí)針對(duì)不同的應(yīng)用程序?qū)芍貥?gòu)Cache進(jìn)行配置。通過對(duì)Cache的動(dòng)態(tài)配置,不僅可以提高Cache命中率,還能夠有效降低處理器的功耗。
          • 關(guān)鍵字: Cache  低功耗  可重構(gòu)  技術(shù)研究    
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