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同步頭法文章進入同步頭法技術(shù)社區(qū)

基于FPGA的跳頻系統(tǒng)快速同步算法設(shè)計與實現(xiàn)

同步技術(shù)是跳頻系統(tǒng)的核心。本文針對FPGA的跳頻系統(tǒng)，設(shè)計了一種基于獨立信道法，同步字頭法和精準(zhǔn)時鐘相結(jié)合的快速同步方法，同時設(shè)計了基于雙圖案的改進型獨立信道法，同步算法協(xié)議，協(xié)議幀格式等。該設(shè)計使用VHDL硬件語言實現(xiàn)，采用Altera公司的EP3C16 E144C8作為核心芯片，并在此硬件平臺上進行了功能驗證。實際測試表明，該快速同步算法建立時間短、同步穩(wěn)定可靠。
關(guān)鍵字：跳頻快速同步 FPGA 獨立信道法同步頭法

共1條 1/1 1

同步頭法介紹

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