復(fù)位 文章 進(jìn)入復(fù)位技術(shù)社區(qū)
不復(fù)位調(diào)試的小技巧
- 01 前言在產(chǎn)品開發(fā)時，經(jīng)常會碰到在測試過程中或設(shè)備出廠后才發(fā)現(xiàn)程序異常，但當(dāng)重新對設(shè)備仿真調(diào)試時卻復(fù)現(xiàn)不出現(xiàn)場的問題，或者只能通過保存的日志信息艱難分析代碼運行到了何處而導(dǎo)致的異常。 遇到這種場景，也并非無路可循。原則上只要我們通過仿真器調(diào)試時，做到代碼不被重新下載覆蓋，MCU 不被復(fù)位，就可能保留當(dāng)前程序運行的狀態(tài)，讓 Bug 無處藏身。02 實現(xiàn)方法首先，我們將編譯完成的工程燒錄到 MCU,保證 MCU 中所運行的代碼與要仿真的工程代碼一致，這樣從 MCU 獲取的程序位置才能與調(diào)試符號信息
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【E課堂】幾組實用FPGA原理設(shè)計圖
- FPGA(Field-Programmable?Gate?Array)，即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。FPGA的開發(fā)相對于傳統(tǒng)PC、單片機(jī)的開發(fā)有很大不同。FPGA以并行運算為主，以硬件描述語言來實現(xiàn);相比于PC或單片機(jī)(無論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別，也造成了FPGA開發(fā)入
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FPGA研發(fā)之道(8)架構(gòu)設(shè)計漫談(三)時鐘和復(fù)位
- 接口確定以后，F(xiàn)PGA內(nèi)部如何規(guī)劃?首先需要考慮就是時鐘和復(fù)位。 時鐘：根據(jù)時鐘的分類，可以分為邏輯時鐘，接口時鐘，存儲器時鐘等; (1)邏輯時鐘取決與邏輯的關(guān)鍵路徑，最終值是設(shè)計和優(yōu)化的結(jié)果，從經(jīng)驗而不是實際出發(fā)：低端FPGA(cyclone spantan)工作頻率在40-80Mhz之間，而高端器件(stratix virtex)可達(dá)100-200Mhz之間，根據(jù)各系列的先后性能會有所提升，但不是革命性的。 (2)接口時鐘，異步信號的時序一般也是通過FPGA片內(nèi)同步邏輯產(chǎn)生，一般
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嵌入式軟件開發(fā)之： 復(fù)位和初始化
- 13.5 復(fù)位和初始化 任何運行在實際硬件上的嵌入式應(yīng)用程序，都必須在啟動時實現(xiàn)一些基本的系統(tǒng)初始化。本節(jié)將對此予以詳細(xì)討論。 13.5.1 初始化序列 圖13.14顯示了一個適用于ARM嵌入式系統(tǒng)的初始化序列。 圖13.14 ARM嵌入式系統(tǒng)的初始化序列 系統(tǒng)啟動時立即執(zhí)行復(fù)位處理程序，然后進(jìn)入$Sub$$main()的代碼執(zhí)行。 復(fù)位處理程序是用匯編語言編寫的代碼塊，它在系統(tǒng)復(fù)位時執(zhí)行，完成系統(tǒng)初始化操作。對于具有局部存儲器的內(nèi)核，如
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復(fù)位監(jiān)控知多少
- 本文旨面向初級工程師或是剛剛升遷的而又想掌握一些技術(shù)管理者們。 微處理器是一個復(fù)雜又單一的東西。它啟動的方式一成不變，嚴(yán)格、準(zhǔn)確地重復(fù)地執(zhí)行著函數(shù)功能。我們可以當(dāng)微處理器已經(jīng)穩(wěn)定進(jìn)入啟動程序后，發(fā)送一個復(fù)位操作來讓微處理器執(zhí)行正確的程序指令。當(dāng)復(fù)位信號結(jié)束，微處理器的部分寄存器(根據(jù)微處理器型號而不同)將會重新初始化為默認(rèn)值。微處理器也會從一個固定的地址重新開始執(zhí)行。因此，設(shè)計一個復(fù)位方案對于避免系統(tǒng)鎖死、執(zhí)行程序出錯或者是非易失性flash讀寫錯誤導(dǎo)致的系統(tǒng)崩潰將是非常致關(guān)重要的。 其實
- 關(guān)鍵字： 微處理器 復(fù)位 復(fù)位電路
全面剖析數(shù)字電路中的復(fù)位設(shè)計
- 隨著數(shù)字化設(shè)計和SoC的日益復(fù)雜，復(fù)位架構(gòu)也變得非常復(fù)雜。在實施如此復(fù)雜的架構(gòu)時，設(shè)計人員往往會犯一些低級錯誤，這些錯誤可能會導(dǎo)致亞穩(wěn)態(tài)、干擾或其他系統(tǒng)功能故障。本文討論了一些復(fù)位設(shè)計的基本的結(jié)構(gòu)性問題。在每個問題的最后，都提出了一些解決方案。 復(fù)位域交叉問題 1. 問題 在一個連續(xù)設(shè)計中，如果源寄存器的異步復(fù)位不同于目標(biāo)寄存器的復(fù)位，并且在起點寄存器的復(fù)位斷言過程中目標(biāo)寄存器的數(shù)據(jù)輸入發(fā)生異步變化，那么該路徑將被視為異步路徑，盡管源寄存器和目標(biāo)寄存器都位于同一個時鐘域，在源寄存器的復(fù)位斷言過程中可
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單片機(jī)可靠性設(shè)計的解決方案-軟件篇
- 1、指令冗余 CPU取指令過程是先取操作碼，再取操作數(shù)。在程序的關(guān)鍵地方人為的插入一些單字節(jié)指令，或?qū)⒂行巫止?jié)指令重寫稱為指令冗余，通常是在雙字節(jié)指令和三字節(jié)指令后插入兩個字節(jié)以上的NOP指令。這樣即使跑飛程序飛到雙字節(jié)指令和三字節(jié)指令操作數(shù)上。由于窄操作指令NOP的存在，避免了后面的指令被錯誤地執(zhí)行，為程序納入正軌做好準(zhǔn)備。此外，對系統(tǒng)流向起重要作用的指令，如RET、RETI、LCALI.、LJMP,JC等，可以在這些指令之后插入兩條NOP指令，可將跑飛程序納入正軌，以確保這些重要指令的執(zhí)行。指令冗
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單片機(jī)可靠性設(shè)計的解決方案-硬件篇
- 單論單片機(jī)硬件系統(tǒng)設(shè)計解決方案，一般從三個方面分析：優(yōu)選設(shè)計方案、增加冗余和容錯率、采用硬件抗干擾。本文詳細(xì)的介紹了優(yōu)化這三個方面對單片硬件可靠性帶來的好處。 1、選優(yōu)設(shè)計 在系統(tǒng)硬件設(shè)計和加工時，應(yīng)該選用質(zhì)量好的接插件，設(shè)計好工藝結(jié)構(gòu);選用合格的元器件，進(jìn)行嚴(yán)格的測試、篩選和老化;設(shè)計時技術(shù)參數(shù)(如負(fù)載)要留有一定的余量或降額使用元器件;提高印制板和組裝的質(zhì)量。 2、采用硬件抗干擾措施 來自供電系統(tǒng)以及通過導(dǎo)線傳輸、電磁耦合等產(chǎn)生的電磁干擾信號，是單片機(jī)系統(tǒng)工作不穩(wěn)定的重要因素，在系統(tǒng)硬件設(shè)計時
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同步異步復(fù)位與亞穩(wěn)態(tài)可靠性設(shè)計
- 異步復(fù)位相比同步復(fù)位： 1. 通常情況下(已知復(fù)位信號與時鐘的關(guān)系)，最大的缺點在于異步復(fù)位導(dǎo)致設(shè)計變成了 ...
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復(fù)位介紹
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