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浮點(diǎn)矩陣相乘IP核并行改進(jìn)的設(shè)計(jì)與實(shí)現(xiàn)

基于Altera浮點(diǎn)IP核實(shí)現(xiàn)浮點(diǎn)矩陣相乘運(yùn)算時(shí)，由于矩陣階數(shù)的增大，造成消耗的器件資源雖增加但系統(tǒng)性能反而下降的問(wèn)題，針對(duì)現(xiàn)有IP核存在數(shù)據(jù)加載不連貫、存儲(chǔ)帶寬不均勻的不足，提出采用并行化數(shù)據(jù)存儲(chǔ)、依據(jù)查找表加載數(shù)據(jù)和處理數(shù)據(jù)的方式對(duì)IP核進(jìn)行改進(jìn)。然后將改進(jìn)的浮點(diǎn)矩陣運(yùn)算在FPGA中實(shí)現(xiàn)，經(jīng)過(guò)Quartus、Matlab軟件聯(lián)合仿真并進(jìn)行結(jié)果比對(duì)，其誤差不超過(guò)萬(wàn)分之一，且節(jié)省了器件資源、提升了系統(tǒng)性能。仿真結(jié)果表明該設(shè)計(jì)可行，有利于提高諸多高性能領(lǐng)域浮點(diǎn)矩陣的運(yùn)算速度。
關(guān)鍵字： IP核浮點(diǎn)矩陣運(yùn)算存儲(chǔ)方式

數(shù)據(jù)存放問(wèn)題非常重要，然而在實(shí)際應(yīng)用中卻是錯(cuò)事連連。經(jīng)常會(huì)出現(xiàn)掉盤、卷鎖死等諸多問(wèn)題，嚴(yán)重影響了整體系統(tǒng) ...
關(guān)鍵字：存儲(chǔ)方式技術(shù)解析

C51字節(jié)數(shù)據(jù)、整型數(shù)據(jù)以及長(zhǎng)整型數(shù)據(jù)在存儲(chǔ)器中的存儲(chǔ)方式各是怎樣的?答:字符變量(char)無(wú)論是unsigned c ...
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