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          基于FPGA的高速導(dǎo)航解算硬件實(shí)現(xiàn)

          • 摘要:針對(duì)現(xiàn)有小型無人機(jī)導(dǎo)航系統(tǒng)的解算速度慢、多處理器核心臃腫可靠性差的缺點(diǎn),實(shí)現(xiàn)了一種僅使用單一FPGA作為數(shù)據(jù)處理核心的小型高速導(dǎo)航解算系統(tǒng)。該系統(tǒng)對(duì)飛機(jī)運(yùn)動(dòng)方程組和導(dǎo)航方程組進(jìn)行并行化分解,對(duì)相互獨(dú)
          • 關(guān)鍵字: 并行計(jì)算  FPGA  姿態(tài)解算  導(dǎo)航解算  

          一種于FPGA的高速導(dǎo)航解算系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

          •   摘要:針對(duì)現(xiàn)有小型無人機(jī)導(dǎo)航系統(tǒng)的解算速度慢、多處理器核心臃腫可靠性差的缺點(diǎn),實(shí)現(xiàn)了一種僅使用單一FPGA作為數(shù)據(jù)處理核心的小型高速導(dǎo)航解算系統(tǒng)。該系統(tǒng)對(duì)飛機(jī)運(yùn)動(dòng)方程組和導(dǎo)航方程組進(jìn)行并行化分解,對(duì)相互獨(dú)立的中間變量進(jìn)行并行計(jì)算,使得單個(gè)運(yùn)算周期能夠同時(shí)進(jìn)行6次浮點(diǎn)運(yùn)算,在不盲目增加硬件消耗的條件下有效提高了解算速度。仿真和實(shí)驗(yàn)結(jié)果表明系統(tǒng)能夠高效地進(jìn)行導(dǎo)航信息解算,在小型無人機(jī)的導(dǎo)航控制領(lǐng)域有重要的工程應(yīng)用價(jià)值。   導(dǎo)航解算是小型無人機(jī)導(dǎo)航控制的基礎(chǔ),小型無人機(jī)機(jī)動(dòng)性強(qiáng),為了完成自主導(dǎo)航任務(wù),必
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          導(dǎo)航解算介紹

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