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          一種基于多發(fā)射天線的差分空時編碼

          • 摘要:一般的空時編碼解碼時接收端需要信道狀態(tài)信息(CSI),因而必須獲得精確的信道估計(jì);而差分空時編碼(DSTC)接收端解碼時不需要CSI,因而不需要信道估計(jì)。在信道衰落快或信息傳輸速率高的情況下,實(shí)時而精確的信道
          • 關(guān)鍵字: 空時  編碼  差分  天線  發(fā)射  基于  

          北斗衛(wèi)星導(dǎo)航系統(tǒng)的廣域差分與完好性服務(wù)

          • 衛(wèi)星導(dǎo)航是運(yùn)動載體通過接收導(dǎo)航衛(wèi)星發(fā)送的導(dǎo)航信號,以導(dǎo)航衛(wèi)星作為動態(tài)已知點(diǎn),實(shí)時地測定自身的位置和速度,進(jìn)而實(shí)現(xiàn)導(dǎo)航的過程。衛(wèi)星導(dǎo)航的基本功能就是向各類用戶(靜止的或運(yùn)動的)實(shí)時提供準(zhǔn)確、連續(xù)的位置、速
          • 關(guān)鍵字: 差分  完好  服務(wù)  廣域  系統(tǒng)  衛(wèi)星  導(dǎo)航  北斗  

          π/4-DQPSK差分解調(diào)器的數(shù)字化FPGA設(shè)計(jì)與實(shí)現(xiàn)

          • 摘要:給出了采用FPGA設(shè)計(jì)芯片技術(shù)對QPSK解調(diào)器進(jìn)行設(shè)計(jì)的實(shí)現(xiàn)方法。該方法可將解調(diào)器中原有的多種專用芯片的功能集成在一片大規(guī)??删幊踢壿嬈骷﨔PGA上,從而實(shí)現(xiàn)了高度集成化和小型化。仿真結(jié)果表明,該方案具有突
          • 關(guān)鍵字: DQPSK  FPGA  差分  解調(diào)器    

          兩級差分晶體管功放的制作

          在單端應(yīng)用中采用差分 I/O 放大器

          • 引言

            最近在低壓硅鍺和 BiCMOS 工藝技術(shù)領(lǐng)域的進(jìn)步已經(jīng)允許設(shè)計(jì)和生產(chǎn)速度非常高的放大器了。因?yàn)檫@些工藝技術(shù)是低壓的,所以大多數(shù)放大器的設(shè)計(jì)都納入了差分輸入和輸出,以恢復(fù)并最大限度地提高總的輸出信號擺幅
          • 關(guān)鍵字: 單端應(yīng)用  差分  放大器    

          一種共基差分低噪聲放大器設(shè)計(jì)

          • 摘要:在無線通信終端中,低噪聲放大器是射頻接收系統(tǒng)中的第一級有源電路,對系統(tǒng)性能有重要影響。在深入分析噪聲的基礎(chǔ)上,提出一種采用共基差分輸入結(jié)構(gòu)的低噪聲放大器,電路包括可控增益放大器和增益控制電路。該
          • 關(guān)鍵字: 共基  差分  低噪聲  放大器設(shè)計(jì)    

          ADC驅(qū)動器或差分放大器設(shè)計(jì)指南

          • 作為應(yīng)用工程師,我們經(jīng)常遇到各種有關(guān)差分輸入型高速模數(shù)轉(zhuǎn)換器(ADC)的驅(qū)動問題。事實(shí)上,選擇正確的ADC驅(qū)動器和配置極具挑戰(zhàn)性。為了使魯棒性ADC電路設(shè)計(jì)多少容易些,我們匯編了一套通用“路障”及解決方
          • 關(guān)鍵字: 設(shè)計(jì)  指南  放大器  差分  驅(qū)動器  ADC  

          討論差分信號鏈在3G和4G無線應(yīng)用中的性能和優(yōu)點(diǎn)

          • 通信系統(tǒng)設(shè)計(jì)的主要挑戰(zhàn)之一是如何成功捕獲高保真度信號。為了避免強(qiáng)干擾效應(yīng)、信號失真和靈敏度降低,蜂窩通信系統(tǒng)必須滿足蜂窩標(biāo)準(zhǔn)的嚴(yán)格要求,比如具有高動態(tài)范圍、高輸入線性度和低噪聲的碼分多址(CDMA)和寬帶CD
          • 關(guān)鍵字: 無線應(yīng)用  性能  優(yōu)點(diǎn)  4G  3G  差分  信號  討論  

          通過低電壓差分信號(LVDS)傳輸高速信號

          • 低電壓差分信號(LVDS)非常適合時鐘分配、一點(diǎn)到多點(diǎn)之間的信號傳輸。本文描述了使用LVDS將高速信號分配到多個目的端的方法。 在一個數(shù)字系統(tǒng)中,當(dāng)各個子系統(tǒng)需要相同的參考時鐘源協(xié)同工作時,時鐘分配非常重要
          • 關(guān)鍵字: 信號  傳輸  高速  LVDS  通過  差分  電壓  

          分立元件耳機(jī)放大電路以及差分功放仿真電路

          差分信號線的分析和LAYOUT

          • 隨著近幾年對速率的要求快速提高,新的總線協(xié)議不斷的提出更高的速率。傳統(tǒng)的總線協(xié)議已經(jīng)不能夠滿足要求了。串行總線由于更好的抗干擾性,和更少的信號線,更高的速率獲得了眾多設(shè)計(jì)者的青睞。而串行總線又尤以差分
          • 關(guān)鍵字: LAYOUT  差分  信號線  分析    
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          差分介紹

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