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          基于FPGA的高速時(shí)鐘數(shù)據(jù)恢復(fù)電路的實(shí)現(xiàn)

          • 0 引言
            時(shí)鐘數(shù)據(jù)恢復(fù)電路是高速收發(fā)器的核心模塊,而高速收發(fā)器是通信系統(tǒng)中的關(guān)鍵部分。隨著光纖在通信中的應(yīng)用,信道可以承載的通信速率已經(jīng)可以達(dá)到GHz,從而使得接收端的接收速率成為限制通信速率的主要瓶頸
          • 關(guān)鍵字: FPGA  時(shí)鐘數(shù)據(jù)  恢復(fù)電路    
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          恢復(fù)電路介紹

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