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慢門限恒虛警處理電路文章進入慢門限恒虛警處理電路技術(shù)社區(qū)

基于FPGA的慢門限恒虛警處理電路設(shè)計及其仿真

雷達信號的檢測多是在干擾背景下進行，如何從干擾中提取目標信號，不僅要求有一定的信噪比，而且必需有恒虛警處理設(shè)備。恒虛警處理是雷達信號處理的重要組成部分，慢門限恒虛警處理主要是針對接收機熱噪聲，文中介紹一種基于FPGA嵌入式設(shè)計的慢門限恒虛警處理電路，給出了仿真模型及仿真結(jié)果，并已將其用于某檢測器中，取得了良好的經(jīng)濟效益。
關(guān)鍵字：慢門限恒虛警處理電路內(nèi)部噪聲 FPGA

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慢門限恒虛警處理電路介紹

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